[发明专利]三维存储结构制作方法、存储结构、存储器及电子设备在审
申请号: | 201711184313.7 | 申请日: | 2017-11-23 |
公开(公告)号: | CN107946306A | 公开(公告)日: | 2018-04-20 |
发明(设计)人: | 霍宗亮;周文斌;张磊;杨鹏 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11551 | 分类号: | H01L27/11551;H01L27/11578;H01L21/8242;H01L27/108;H01L29/06 |
代理公司: | 北京辰权知识产权代理有限公司11619 | 代理人: | 刘广达 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 三维 存储 结构 制作方法 存储器 电子设备 | ||
1.一种三维存储结构制作方法,其特征在于,包括:
在衬底上形成凹陷区;
在所述凹陷区形成三维存储器件;
在非凹陷区形成外围电路。
2.根据权利要求1所述的三维存储结构制作方法,其特征在于,所述在衬底上形成凹陷区,包括:
采用刻蚀工艺在衬底上刻蚀出凹陷区,所述凹陷区的深度大于或等于待制作的三维存储器件的厚度。
3.根据权利要求1所述的三维存储结构制作方法,其特征在于,在非凹陷区形成外围电路之前,还包括:;
全面形成第一隔离层;
对所述第一隔离层进行全面平坦化;
所述在非凹陷区形成外围电路,包括:
在对应于非凹陷区的第一隔离层上形成外围电路。
4.根据权利要求1所述的三维存储结构制作方法,其特征在于,在非凹陷区形成外围电路之后,还包括:
全面形成第二隔离层;
对所述第二隔离层进行全面平坦化;
基于所述第二隔离层,形成所述外围电路与所述三维存储器件之间的金属连线。
5.一种三维存储结构,其特征在于,包括:衬底、三维存储器件和外围电路;
所述衬底上设置有凹陷区和非凹陷区;
所述三维存储器件设于所述衬底上的凹陷区;
所述外围电路设于所述衬底上的非凹陷区。
6.根据权利要求5所述的三维存储结构,其特征在于,所述凹陷区的深度大于或等于所述三维存储器件的厚度。
7.根据权利要求5所述的三维存储结构,其特征在于,还包括:第一隔离层;
所述第一隔离层设于所述三维存储器件与所述外围电路之间。
8.根据权利要求5所述的三维存储结构,其特征在于,还包括:第二隔离层和金属连线;
所述第二隔离层设于所述外围电路之上;
所述金属连线设于所述第二隔离层之上,并穿过所述第二隔离层连接所述外围电路和所述三维存储器件。
9.一种三维存储器,其特征在于,所述三维存储器中设置有权利要求5至8任一项所述的三维存储结构。
10.一种电子设备,其特征在于,所述电子设备中设置有权利要求9所述的三维存储器。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
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H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的