[发明专利]移位寄存器单元及其驱动方法、栅极驱动电路、显示装置在审

专利信息
申请号: 201711315757.X 申请日: 2017-12-11
公开(公告)号: CN107784977A 公开(公告)日: 2018-03-09
发明(设计)人: 袁丽君;韩明夫;韩承佑;姚星;王志冲;商广良;郑皓亮 申请(专利权)人: 京东方科技集团股份有限公司
主分类号: G09G3/3266 分类号: G09G3/3266;G11C19/28
代理公司: 北京中博世达专利商标代理有限公司11274 代理人: 贾莹
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 移位寄存器 单元 及其 驱动 方法 栅极 电路 显示装置
【说明书】:

技术领域

发明涉及显示技术领域,尤其涉及一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置。

背景技术

随着显示技术的急速进步,作为显示装置核心的半导体元件技术也随之得到了飞跃性的进步。对于现有的显示装置而言,有机发光二极管(Organic Light Emitting Diode,OLED)作为一种电流型发光器件,因其所具有的自发光、快速响应、宽视角和可制作在柔性衬底上等特点而越来越多地被应用于高性能显示领域当中。

OLED显示装置的亚像素中设置有像素电路,该像素电路具有多个不同的信号端。现有技术中,针对该像素电路的每一个信号端,需要在非显示区域设置一个与该信号端相连接的驱动电路,该驱动电路用于向与其相连接的信号端提供相应的电压。然而,这样一来,多个不同的驱动电路占用的布线空间较大,不利于窄边框设计。

发明内容

本发明的实施例提供一种移位寄存器单元及其驱动方法、栅极驱动电路、显示装置,解决了OLED像素电路的多个不同的信号端分别对应一个驱动电路,导致非显示区域布线空间较小的问题。

为达到在一些实施例中,目的,本发明的实施例采用如下技术方案:

本申请实施例的一方面,提供一种移位寄存器单元,包括:第一输出子电路、第二输出子电路以及第三输出子电路中的至少两个子电路;所述移位寄存器单元还包括前端电路;所述前端电路与信号输入端、第一时钟信号端、第二时钟信号端、第一电压端、第二电压端以及所述信号输出端连接,所述前端电路用于接收所述信号输入端的电压,并在所述第一时钟信号端、所述第二时钟信号端的控制下,将所述第二时钟信号端的电压或所述第二电压端的电压输出至所述信号输出端;所述第一输出子电路连接第三时钟信号端、所述第二电压端、所述信号输出端、复位信号输出端以及选通信号输出端;所述第一输出子电路用于在所述第三时钟信号端的控制下,将所述信号输出端的电压输出至所述复位信号输出端,并将所述第二电压端的电压输出至所述选通信号输出端;所述第二输出子电路连接第四时钟信号端、所述第二电压端、所述信号输出端、所述复位信号输出端以及所述选通信号输出端;所述第二输出子电路用于在所述第四时钟信号端的控制下,将所述信号输出端的电压输出至所述选通信号输出端,并将所述第二电压端的电压输出至所述复位信号输出端;所述第三输出子电路连接所述第一电压端、所述信号输出端、所述第二电压端以及发光控制信号输出端;所述第三输出子电路用于在所述信号输出端的控制下,将所述第二电压端的电压输出至所述发光控制信号输出端;或者,所述第三输出子电路用于在所述第一电压端的控制下,将所述第一电压端的电压输出至所述发光控制信号输出端。

可选的,所述第一输出子电路包括第一晶体管和第二晶体管;所述第一晶体管的栅极连接所述第三时钟信号端,第一极连接所述信号输出端,第二极与所述复位信号输出端相连接;所述第二晶体管的栅极连接所述第三时钟信号端,第一极所述选通信号输出端连接,第二极与所述第二电压端相连接。

可选的,所述第二输出子电路包括第三晶体管和第四晶体管;所述第三晶体管的栅极连接所述第四时钟信号端,第一极连接所述信号输出端,第二极与所述选通信号输出端相连接;所述第四晶体管的栅极连接所述第四时钟信号端,第一极连接所述复位信号输出端,第二极与所述第二电压端相连接。

可选的,所述第三输出子电路包括第十三晶体管和第十四晶体管;所述第十三晶体管的栅极和第一极连接所述第一电压端,第二极与所述发光控制信号输出端相连接;所述第十四晶体管的栅极连接所述信号输出端,第一极连接所述发光控制信号输出端,第二极与所述第二电压端相连接;其中,所述第十四晶体管的宽长比大于所述第十三晶体管的宽长比。

可选的,所述前端电路包括上拉控制子电路、下拉控制子电路、上拉子电路、下拉子电路;所述上拉控制子电路与信号输入端、第一时钟信号端、上拉节点连接;所述上拉控制子电路用于在所述第一时钟信号端的控制下,将所述信号输入端的电压输出至所述上拉节点;所述上拉子电路与第二时钟信号端、所述上拉节点以及信号输出端连接;所述上拉子电路用于在所述上拉节点的控制下,将所述第二时钟信号端的电压输出至所述信号输出端;所述下拉控制子电路与所述第一时钟信号端、第一电压端、所述上拉节点以及下拉节点连接;所述下拉控制子电路用于在所述第一时钟信号端和所述上拉节点的控制下,将所述第一电压端和所述第一时钟信号端的电压传输至所述下拉节点;所述下拉子电路与所述下拉节点、第二电压端以及所述信号输出端连接;所述下拉子电路用于在所述下拉节点的控制下,将所述第二电压端的电压传输至所述信号输出端。

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