[发明专利]LDPC的乱序译码实现方法及装置有效
| 申请号： | 201711376656.3 | 申请日： | 2017-12-19 |
| 公开（公告）号： | CN109936378B | 公开（公告）日： | 2022-08-26 |
| 发明（设计）人： | 戴晶;燕威;谢静 | 申请（专利权）人： | 北京紫光展锐通信技术有限公司 |
| 主分类号： | H03M13/11 | 分类号： | H03M13/11 |
| 代理公司： | 北京兰亭信通知识产权代理有限公司 11667 | 代理人： | 赵永刚 |
| 地址： | 100191 北京市*** | 国省代码： | 北京;11 |
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| 摘要： | |||
| 搜索关键词： | ldpc 译码 实现 方法 装置 | ||
1.一种LDPC的乱序译码实现方法，其特征在于，包括：
针对LDPC码所使用的基图，选择母序列，其中，所述母序列为根据所述基图不同码率的LDPC码而预设的针对最大行数的乱序序列；
根据译码所需的行索引号，从所述母序列中选择译码用的行块的乱序序列；
按照所述译码用的行块的乱序序列对所述LDPC码的基础矩阵进行行乱序；
对乱序后的基础矩阵的行进行分层；
对分层后的基础矩阵进行流水线译码；
所述根据译码所需的行索引号，从所述母序列中选择译码用的行块的乱序序列包括：从所述母序列中选择译码所需的行索引号，组成子序列，作为译码用的行块的乱序序列。
2.根据权利要求1所述的方法，其特征在于，所述对乱序后的基础矩阵的行进行分层包括：按照硬件并行能力所决定的层大小，对乱序后的基础矩阵的行进行分层。
3.根据权利要求2所述的方法，其特征在于，所述按照硬件并行能力所决定的层大小，对乱序后的基础矩阵的行进行分层包括：根据硬件并行能力确定可并行处理的校验矩阵的行块数量，根据可并行处理的校验矩阵的行块数量对乱序后的每个校验矩阵的行块进行分层，其中，所述基础矩阵的行即所述校验矩阵的行块。
4.一种LDPC的乱序译码实现装置，其特征在于，包括：
第一选择单元，用于针对LDPC码所使用的基图，选择母序列，其中，所述母序列为根据所述基图不同码率的LDPC码而预设的针对最大行数的乱序序列；
第二选择单元，用于根据译码所需的行索引号，从所述母序列中选择译码用的行块的乱序序列；
乱序单元，用于按照所述译码用的行块的乱序序列对所述LDPC码的基础矩阵进行行乱序；
分层单元，用于对乱序后的基础矩阵的行进行分层；
译码单元，用于对分层后的基础矩阵进行流水线译码；
所述第二选择单元，还用于从所述母序列中选择译码所需的行索引号，组成子序列，作为译码用的行块的乱序序列。
5.根据权利要求4所述的装置，其特征在于，所述分层单元，用于按照硬件并行能力所决定的层大小，对乱序后的基础矩阵的行进行分层。
6.根据权利要求5所述的装置，其特征在于，所述分层单元，用于根据硬件并行能力确定可并行处理的校验矩阵的行块数量，根据可并行处理的校验矩阵的行块数量对乱序后的每个校验矩阵的行块进行分层，其中，所述基础矩阵的行即所述校验矩阵的行块。
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