[发明专利]具有打包带用缺口的半导体集成电路零部件托盘有效
申请号: | 201711423616.X | 申请日: | 2017-12-25 |
公开(公告)号: | CN109592177B | 公开(公告)日: | 2020-12-25 |
发明(设计)人: | 本堂成彬 | 申请(专利权)人: | 神农电气产业株式会社 |
主分类号: | B65D19/38 | 分类号: | B65D19/38;B65D21/032;B65D85/86 |
代理公司: | 北京华夏正合知识产权代理事务所(普通合伙) 11017 | 代理人: | 蒋国伟;孙桂江 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 具有 打包 缺口 半导体 集成电路 零部件 托盘 | ||
1.一种具有打包带用缺口的半导体集成电路零部件托盘,其形成为俯视观察时呈大致四边形形状,
其构成为:
在沿着所述半导体集成电路零部件托盘的表面的周缘部且比该周缘部稍靠内侧的位置形成有具有规定高度的外周壁,
在使多个所述半导体集成电路零部件托盘堆叠的情况下,所述表面的周缘部与位于上层的另一所述半导体集成电路零部件托盘的背面的周缘部抵接,
其特征在于,
沿着4个部位中的至少一个部位的下边形成有用于捆上打包带的缺口,其中:所述4个部位是指所述半导体集成电路零部件托盘的沿着长边方向延伸的两个侧表面或沿着短边方向延伸的两个侧表面的距各端缘3.4cm以内的部位;所述打包带捆扎多个所述半导体集成电路零部件托盘,
所述缺口的深度尺寸比所述外周壁的规定的高度尺寸短。
2.一种具有打包带用缺口的半导体集成电路零部件托盘,其形成为俯视观察时呈大致四边形形状,
其构成为:
在沿着所述半导体集成电路零部件托盘的表面的周缘部且比该周缘部稍靠内侧的位置形成有具有规定高度的外周壁,
在使多个所述半导体集成电路零部件托盘堆叠的情况下,所述表面的周缘部与位于上层的另一所述半导体集成电路零部件托盘的背面的周缘部抵接,
其特征在于,
沿着位于4个部位中的至少一个部位的上方的部分的所述外周壁形成有用于捆上打包带的缺口,其中:所述4个部位是指所述半导体集成电路零部件托盘的沿着长边方向延伸的两个侧表面或沿着短边方向延伸的两个侧表面的距各端缘3.4cm以内的部位;所述打包带捆扎多个所述半导体集成电路零部件托盘,
所述缺口的深度尺寸比所述外周壁的规定的高度尺寸短。
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