[实用新型]一种电池分容的集成式电路有效
申请号: | 201720918842.4 | 申请日: | 2017-07-26 |
公开(公告)号: | CN207234387U | 公开(公告)日: | 2018-04-13 |
发明(设计)人: | 梁柱;陈贵华;饶睦敏;李瑶 | 申请(专利权)人: | 深圳市沃特玛电池有限公司 |
主分类号: | H02H7/18 | 分类号: | H02H7/18;H01M10/42 |
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地址: | 518000 广东省深圳市*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 电池 集成 电路 | ||
【技术领域】
本实用新型涉及电池技术领域,尤其涉及一种电池分容的集成式电路。
【背景技术】
电池的生产与使用需要经过化成与分容等一系列充放电步骤才能形成成品电池。电池的化成是指对新生产的电池进行初次充电,电池的分容是指对电池充放电后根据充放电过程中测得的容量筛选出符合一定容量要求的电池。电池做好之后,虽然尺寸一致,但电池的容量存在差异,电动汽车中的动力电池,通过并联及串联连接而成,如果不进行电池分容,成组的电池容量将存在较大的差异,放电时,存在一部分电池一放完电,另一部分电池还有电;充电时,存在一部分电池已充满电,另一部分电池还欠压,极易造成电池的过充过放,损坏电池。因此,为了确保动力电池的一致性,通常对生产好的按照一定的规范充满电,而后按照规范的恒定电流放完电,电池放完电所用的时间与放电电流的乘积就是电池的容量。现有的电池容量测量电路测量误差较大,不能自主控制,进而影响电池的分容。
鉴于此,实有必要提供一种新的电池分容的集成式电路以克服上述缺陷。
【实用新型内容】
本实用新型的目的是提供一种充放电源对电池充电或电池对充放电源放电的能量转换效率更高,集成式的电路设计,元器件少,节约成本,且能够准确测量出电池的容量的电池分容的集成式电路。
为了实现上述目的,本实用新型提供一种电池分容的集成式电路,包括充放电源、第一开关单元、电感、采样单元、电池、第一控制模块、第二控制模块及第二开关单元;所述第一开关单元与所述充放电源、所述电感及所述第一控制模块相连,所述采样单元与所述电感、所述第二开关单元及所述第一控制模块相连,所述第二开关单元与所述电池及所述第二控制模块相连,所述电池与所述第一控制模块相连,所述第一控制模块与所述第二控制模块相连;所述充放电源通过所述第一开关单元、所述电感、所述采样单元及所述第二开关单元对所述电池进行充电,所述电池通过所述第二开关单元、所述采样单元、所述电感及所述第一开关单元对所述充放电源进行放电;所述第一开关单元包括第一电子开关及第二电子开关;所述第二控制模块通过所述第一控制模块控制充放电源对电池进行充电或电池对充放电源进行放电;所述采样单元用于采集充放电源对电池进行充电的充电电流或电池对充放电源进行放电的放电电流并将采集到的充电电流或放电电流传输至所述第一控制模块,所述第一控制模块还检测充放电源对电池进行充电的充电电压或电池对充放电源进行放电的放电电压,所述第二控制模块控制所述第二开关单元的导通与截止;当所述第二控制模块通过所述第一控制模块控制充放电源对电池进行充电时,所述第一控制模块根据检测到的充电电压及接收到的充电电流输出第一脉冲信号至所述第一电子开关,控制所述第一电子开关的导通与截止频率,以控制充放电源对电池的充电电流或充电电压;当所述第二控制模块通过所述第一控制模块控制电池对充放电源进行放电时,所述第一控制模块根据检测到的放电电压及接收到的放电电流输出第二脉冲信号至所述第二电子开关,控制所述第二电子开关的导通与截止频率,以控制电池对充放电源的放电电流或放电电压。
在一个优选实施方式中,所述第一控制模块包括第一芯片、第二芯片、第三芯片及第一至第四电阻;所述第一芯片包括第一电流反馈引脚、第二电流反馈引脚、第一电压反馈引脚、第二电压反馈引脚、第一增益引脚、第二增益引脚、第三增益引脚、第四增益引脚及输出引脚;所述第二芯片包括第一输入引脚、第二输入引脚、第三输入引脚、第一输出引脚及第二输出引脚;所述第三芯片包括第一输入引脚、第二输入引脚、第一输出引脚及第二输出引脚;所述第一芯片的第一电流反馈引脚及第二电流反馈引脚与所述采样单元相连,所述第一芯片的第一电压反馈引脚与所述电池的正极相连,所述第一芯片的第二电压反馈引脚通过所述第四电阻接地,所述第一芯片的第一增益引脚通过所述第一电阻与所述第一芯片的第二增益引脚相连,所述第一芯片的第三增益引脚通过所述第二电阻与所述第一芯片的第四增益引脚相连,所述第一芯片的输出引脚与所述第二芯片的第一输入引脚相连,所述第二芯片的第二输入引脚与所述第二控制模块相连,所述第二芯片的第一输出引脚与所述第三芯片的第一输入引脚相连,所述第二芯片的第二输出引脚与所述第三芯片的第二输入引脚相连,所述第三芯片的第一输出引脚与所述第一电子开关相连,所述第三芯片的第二输出引脚与所述第二电子开关相连。
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