[实用新型]集成电路与系统有效

专利信息
申请号: 201721260614.9 申请日: 2017-09-28
公开(公告)号: CN207380710U 公开(公告)日: 2018-05-18
发明(设计)人: M·唐蒂尼;G·迪斯特法诺;S·阿本达;A·L·戴内彻 申请(专利权)人: 意法半导体股份有限公司;意法半导体(鲁塞)公司
主分类号: G06F21/71 分类号: G06F21/71;G06F21/60
代理公司: 北京市金杜律师事务所 11256 代理人: 王茂华;张昊
地址: 意大利阿格*** 国省代码: 暂无信息
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摘要:
搜索关键词: 集成电路 系统
【权利要求书】:

1.一种集成电路,其特征在于,包括:

一个或多个知识产权(IP)核;

一个或多个通用输入/输出(GPIO)接口,每个GPIO接口均具有一个或多个端口;以及

一个或多个安全电路,每个安全电路均耦合在IP核与GPIO接口之间,其中安全电路在操作中基于所述IP核的安全状态的指示、所述GPIO接口的安全状态的指示或者所述IP核的安全状态的指示与所述GPIO接口的安全状态的指示两者选择性地启用耦合至所述安全电路的所述IP核与所述GPIO接口之间的通信。

2.根据权利要求1所述的集成电路,其特征在于,所述安全电路是所述IP核与所述GPIO接口之间的双向通信通道的一部分。

3.根据权利要求2所述的集成电路,其特征在于,所述安全电路在操作中选择性地在两个方向上启用所述IP核与所述GPIO接口之间的通信。

4.根据权利要求3所述的集成电路,其特征在于,所述GPIO接口具有多个端口,并且在操作中相对于所述多个端口执行多路复用/解复用。

5.根据权利要求1所述的集成电路,其特征在于,一个所述IP核与一个所述GPIO接口之间的每个通信通道均包括一个所述安全电路。

6.根据权利要求1所述的集成电路,其特征在于,包括耦合至所述一个或多个安全电路的一个或多个存储器,其中在操作中,所述一个或多个存储器存储所述一个或多个IP核的安全状态的指示和所述一个或多个GPIO接口的安全状态的指示。

7.根据权利要求6所述的集成电路,其特征在于,安全控制电路的存储器存储所述一个或多个IP核的安全状态的指示,并且所述GPIO接口的GPIO控制电路的存储器存储所述一个或多个GPIO接口的安全状态的指示。

8.根据权利要求7所述的集成电路,其特征在于,所述一个或多个IP核的安全状态的指示和所述一个或多个GPIO接口的安全状态的指示是软件可编程的。

9.根据权利要求1所述的集成电路,其特征在于,所述GPIO接口的一个或多个端口中的每一个均具有相应的安全状态,并且所述安全电路在操作中基于所述端口的安全状态选择性地启用所述IP核与所述GPIO接口的端口之间的通信。

10.根据权利要求1所述的集成电路,其特征在于,所述安全电路包括数字逻辑电路。

11.根据权利要求1所述的集成电路,其特征在于,包括芯片上系统(SoC)。

12.根据权利要求1所述的集成电路,其特征在于,所述安全电路在操作中:

当所述IP核的安全状态的指示表示所述IP核是安全的且所述GPIO接口的安全状态的指示表示所述GPIO接口是安全的时,启用所述IP核与所述GPIO接口之间的通信;

当所述IP核的安全状态的指示表示所述IP核是不安全的且所述GPIO接口的安全状态的指示表示所述GPIO接口是不安全的时,启用所述IP核与所述GPIO接口之间的通信;

当所述IP核的安全状态的指示表示所述IP核是安全的且所述GPIO接口的安全状态的指示表示所述GPIO接口是不安全的时,禁用所述IP核与所述GPIO接口之间的通信;以及

当所述IP核的安全状态的指示表示所述IP核是不安全的且所述GPIO接口的安全状态的指示表示所述GPIO接口是安全的时,禁用所述IP核与所述GPIO接口之间的通信。

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