[实用新型]LED显示屏行列合一显示结构及LED显示屏有效

专利信息
申请号: 201721425176.7 申请日: 2017-10-31
公开(公告)号: CN207097383U 公开(公告)日: 2018-03-13
发明(设计)人: 颜小平;杨璨源;曹春权;吴泽佑 申请(专利权)人: 深圳市易事达电子有限公司
主分类号: G09F9/33 分类号: G09F9/33
代理公司: 广州华进联合专利商标代理有限公司44224 代理人: 何平
地址: 518100 广东省深圳市龙华*** 国省代码: 广东;44
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摘要:
搜索关键词: led 显示屏 行列 合一 显示 结构
【说明书】:

技术领域

实用新型涉及LED显示屏显示结构,特别是涉及LED显示屏行列合一显示结构及LED显示屏。

背景技术

目前LED显示屏的架构主要为:行管IC(integrated circuit,集成电路)连接LED灯的正极,列恒流IC连接LED灯的负极,行IC与列IC(以下简称“行列IC”)分开设置,行列IC间不直接通讯,而是通过接收卡进行协调与配合。

这样的设计存在以下缺陷:行列IC分开,集成度低,PCB线路复杂,成本高,且由于行列IC分开,通信与协调不直接,在需要协调时,反应较慢,存在难以克服的耦合问题,影响后续的开发设计。

随着科技的发展,IC的功能设计也日益进步,已有IC能够实现行信号与列恒流输出。因此,有必要根据IC技术的发展提供一种行列合一显示结构。

实用新型内容

基于此,有必要提供一种LED显示屏行列合一显示结构及LED显示屏。

一种LED显示屏行列合一显示结构,其包括控制器、至少二控制芯片以及多个LED像素点;所述控制器具有电源连接端、接地端、时钟信号输出端与数据信号输出端;所述控制芯片包括时钟信号输入端、数据信号输入端、数据信号级联输出端、至少一行扫描信号输出端以及至少一组列恒流输出端;所述电源连接端用于接入外部电源,所述接地端用于接地,所述时钟信号输出端分别与各所述控制芯片的所述时钟信号输入端连接,所述数据信号输出端与一控制芯片的所述数据信号输入端连接,该控制芯片的所述数据信号级联输出端与下一控制芯片的所述数据信号输入端连接;每组列恒流输出端包括一红光列恒流输出端、一绿光列恒流输出端与一蓝光列恒流输出端;多个LED像素点矩阵排列,所述矩阵具有X行Y列LED像素点,且每个LED像素点包括一红灯、一绿灯与一蓝灯;各行扫描信号输出端与各行LED像素点一一对应设置,每一所述行扫描信号输出端分别连接与其对应的一行LED像素点中各个LED像素点的红灯的正极、绿灯的正极与蓝灯的正极;各组列恒流输出端与各列LED像素点一一对应设置;每一组列恒流输出端中,该组列恒流输出端的红光列恒流输出端分别连接与其对应的一列LED像素点中各个LED像素点的红灯的负极,该组列恒流输出端的绿光列恒流输出端分别连接与其对应的一列LED像素点中各个LED像素点的绿灯的负极,该组列恒流输出端的蓝光列恒流输出端分别连接与其对应的一列LED像素点中各个LED像素点的蓝灯的负极。

在其中一个实施例中,所述至少一行扫描信号输出端的数量与所述至少一组列恒流输出端的数量相同设置。

在其中一个实施例中,所述控制芯片包括四个所述行扫描信号输出端与四组所述列恒流输出端。

在其中一个实施例中,每一所述控制芯片与四行四列LED像素点相对应。

在其中一个实施例中,各所述控制芯片通过上一控制芯片的所述数据信号级联输出端与下一控制芯片的所述数据信号输入端连接以实现数据信号级联。

在其中一个实施例中,级联的所述控制芯片中,一个行扫描信号输出端所连接的LED像素点的数量小于32个,且一组列恒流输出端所连接的LED像素点的数量小于32个。

在其中一个实施例中,X小于等于32。

在其中一个实施例中,Y小于等于32。

在其中一个实施例中,所述红灯为红光LED芯片,所述绿灯为绿光LED芯片,所述蓝灯为蓝光LED芯片。

一种LED显示屏,其包括如上述任一项所述LED显示屏行列合一显示结构。

上述LED显示屏行列合一显示结构及LED显示屏,采用了行集成电路与列集成电路统一封装于控制芯片的设计方式,在此基础上精心设计了电路及其连接关系,提升了产品的集成度,简化了PCB线路,降低了产品成本;进一步地,在此基础上,不需要再区分R/G/B列和行的单独输入,采用一个数据信号输出端即可输出处理一个像素点的列信号和R/G/B行信号,并控制不同的红、绿、蓝的灯,由此简化了前端输入线路,把传统的多根数据信号线合并为1根;并且,PCB连线简单,布板容易,可以减少PCB设计层数,进而降低了PCB板的设计成本、生产成本与制作周期。

附图说明

图1为本实用新型一个实施例的示意图。

图2为本实用新型另一个实施例的示意图。

具体实施方式

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