[实用新型]锁相环电路以及集成电路芯片有效

专利信息
申请号: 201721473651.8 申请日: 2017-11-08
公开(公告)号: CN208015709U 公开(公告)日: 2018-10-26
发明(设计)人: E·欧萨利维利;M·爱玛克;T·达克 申请(专利权)人: 德克萨斯仪器股份有限公司
主分类号: H03L7/085 分类号: H03L7/085;H03L7/099;H03L7/18
代理公司: 北京纪凯知识产权代理有限公司 11245 代理人: 赵志刚;赵蓉民
地址: 美国德*** 国省代码: 美国;US
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摘要:
搜索关键词: 电路 集成电路芯片 锁相环电路 开关信号 控制电流 非重叠 配置 转换器 输出信号生成 本实用新型 受控振荡器 相位检测器 输出信号 线性电流 线性频率 分频器 锁相环 近似
【权利要求书】:

1.一种锁相环电路,其特征在于包括:

分频器,其经配置以基于输入信号生成第一组非重叠开关信号;

相位检测器,其经配置以基于输入信号和PLL输出信号生成第二组非重叠开关信号;

至少一个线性频率-模拟转换器,其经配置以生成具有基于所述第一组非重叠开关信号和所述第二组非重叠开关信号的振幅的控制信号;以及

线性振荡器,其经配置以基于所述控制信号的振幅生成所述PLL输出信号以具有近似所述输入信号的频率和相位。

2.根据权利要求1所述的锁相环电路,其特征在于,所述至少一个线性频率-模拟转换器被配置为至少一个线性频率-电流转换器,所述至少一个线性频率-电流转换器被配置以基于所述输入信号的频率生成所述控制信号作为控制电流,并且进一步被配置以基于所述输入信号与所述PLL输出信号之间的相位差以反馈的方式调节所述控制电流的振幅以将所述PLL输出信号与所述输入信号基本上相位对齐。

3.根据权利要求1所述的锁相环电路,其特征在于,所述分频器和所述相位检测器被配置以生成对应于所述输入信号的频率的比率的第一组非重叠开关信号和对应于所述输入信号与所述PLL输出信号之间的相位差的第二组非重叠开关信号。

4.根据权利要求3所述的锁相环电路,其特征在于,所述分频器包括经配置以生成所述第一组非重叠开关信号作为第一开关信号和第二开关信号的逻辑,所述第一开关信号和第二开关信号具有近似等于所述输入信号的频率的频率并且具有近似50%的占空比,其中所述相位检测器包括经配置以生成所述第二组非重叠开关信号作为第三开关信号和第四开关信号的逻辑,在稳定状态下,所述第三开关信号和第四开关信号具有近似等于所述输入信号的频率的一半的频率并且具有基于所述输入信号和所述PLL输出信号的频率之间的相位差的占空比。

5.根据权利要求1所述的锁相环电路,其特征在于所述至少一个线性频率- 模拟转换器包括:

第一线性频率-模拟转换器,其经配置以基于第一组非重叠开关信号生成第一控制信号部分,所述第一控制信号部分具有基于所述输入信号的频率的振幅;以及

第二线性频率-模拟转换器,其经配置以基于第二组非重叠开关信号生成第二控制信号部分,所述第二控制信号部分具有基于所述输入信号的频率和所述输入信号与所述PLL输出信号之间的相位差的振幅,其中所述控制信号的振幅等于所述第一控制信号部分和所述第二控制信号部分相对于输出节点的差值。

6.根据权利要求5所述的锁相环电路,其特征在于,所述第一线性频率-模拟转换器包括输出滤波器,所述输出滤波器互连第一控制信号生成器和第一控制信号输出晶体管装置,所述第一控制信号输出晶体管装置被布置为相对于所述第一控制信号生成器的电流镜以向所述输出节点提供所述第一控制信号部分,并且其中所述第二线性频率-模拟转换器包括第二控制信号生成器和第二控制信号输出晶体管装置,所述第二控制信号输出晶体管装置被布置为相对于所述第二控制信号生成器的电流镜以提供来自所述输出节点的第二控制信号。

7.根据权利要求5所述的锁相环电路,其特征在于,所述第一线性频率-模拟转换器和所述第二线性频率-模拟转换器被布置使得在稳态期间所述第一控制信号部分的振幅近似所述第二控制信号的振幅的两倍。

8.根据权利要求5所述的锁相环电路,其特征在于,所述第一线性频率-模拟转换器包括经由所述第一组非重叠开关信号控制的第一开关电容器电流源,所述第一开关电容器电流源被配置以生成与第一控制晶体管装置相关联的第一栅极电压以设定所述第一控制信号部分的振幅,并且其中所述第二线性频率-模拟转换器包括经由所述第二组非重叠开关信号控制的第二开关电容器电流源,所述第二开关电容器电流源被配置以生成与第二控制晶体管装置相关联的第二栅极电压以设定所述第二控制信号部分的振幅。

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