[实用新型]一种汽车安全驾驶辅助雷达处理系统有效
申请号: | 201721535731.1 | 申请日: | 2017-11-14 |
公开(公告)号: | CN207704024U | 公开(公告)日: | 2018-08-07 |
发明(设计)人: | 高元正 | 申请(专利权)人: | 武汉雷博合创电子科技有限公司 |
主分类号: | G01S13/93 | 分类号: | G01S13/93 |
代理公司: | 北京知呱呱知识产权代理有限公司 11577 | 代理人: | 吕学文;朱红涛 |
地址: | 430011 湖北省武汉市江岸*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 雷达回波信号 数据处理模块 接口控制 雷达 汽车安全驾驶 汽车中控系统 数据传输模块 本实用新型 时钟源模块 采集模块 处理系统 调制波形 发射波形 辅助雷达 控制电路 射频前端 信号滤波 物体位置信息 发送目标 辅助决策 目标识别 汽车驾驶 射频信号 运动信息 数据处理 探测 | ||
1.一种汽车安全驾驶辅助雷达处理系统,其特征在于:它包括:雷达射频前端(1)、雷达发射波形控制电路(2)、信号滤波与采集模块(3)、时钟源模块(4)、接口控制及数据处理模块(5)以及数据传输模块(6);
所述接口控制及数据处理模块(5)通过所述雷达发射波形控制电路(2)连接所述雷达射频前端(1);所述雷达发射波形控制电路(2)接收所述接口控制及数据处理模块(5)的指令,用于产生调制波形;所述雷达射频前端(1)用于接收调制波形、产生射频信号并接收雷达回波信号;
所述雷达射频前端(1)与所述信号滤波与采集模块(3)相连,所述信号滤波与采集模块(3)用于对所述雷达射频前端(1)发送的雷达回波信号进行滤波及AD转换;
所述信号滤波与采集模块(3)与所述接口控制及数据处理模块(5)相连,所述接口控制及数据处理模块(5)接收AD转换后的雷达回波信号,进行数据处理并进行目标识别;
所述接口控制及数据处理模块(5)通过所述数据传输模块(6)与汽车中控系统相连,用于向所述汽车中控系统发送目标识别结果;
所述时钟源模块(4)分别与所述雷达发射波形控制电路(2)、所述接口控制及数据处理模块(5)连接,用于提供时钟。
2.如权利要求1所述的一种汽车安全驾驶辅助雷达处理系统,其特征在于:所述雷达射频前端(1)包括:相互连接的1发2收微带天线(11)与高集成度片上雷达收发芯片(12);所述高集成度片上雷达收发芯片(12)与所述雷达发射波形控制电路(2)连接。
3.如权利要求2所述的一种汽车安全驾驶辅助雷达处理系统,其特征在于:所述信号滤波与采集模块(3)包括:相互连接的4路低通滤波电路(31)与4通道同步信号采集电路(32);所述4路低通滤波电路(31)与所述高集成度片上雷达收发芯片(12)连接,所述4通道同步信号采集电路(32)与所述接口控制及数据处理模块(5)相连。
4.如权利要求3所述的一种汽车安全驾驶辅助雷达处理系统,其特征在于:所述接口控制及数据处理模块(5)包括:内部集成PL可编程逻辑电路及PS处理系统电路的FPGA芯片(51)以及分别与所述FPGA芯片(51)连接的DDR3芯片组(52)、Flash芯片(53);所述FPGA芯片(51)与所述雷达发射波形控制电路(2)、所述4通道同步信号采集电路(32)相连,通过所述PL可编程逻辑电路实现对调制波形的控制以及对AD转换后的雷达回波信号的预处理,在所述PS处理系统电路中实现对预处理后雷达回波信号的目标识别;所述DDR3芯片组(52)用于存储待处理的AD转换后的雷达回波信号以及预处理后的AD转换后的雷达回波信号;所述Flash芯片(53)用于存储目标识别程序。
5.如权利要求4所述的一种汽车安全驾驶辅助雷达处理系统,其特征在于:所述数据传输模块(6)包括:用于传输的CAN总线接口(65)以及用于调试的RJ45接口(61)、RS-232接口(63);所述CAN总线接口(65)、所述RJ45接口(61)、所述RS-232接口(63)均与所述FPGA芯片(51)连接。
6.如权利要求4或5所述的一种汽车安全驾驶辅助雷达处理系统,其特征在于:所述时钟源模块(4)包括:50MHz晶振芯片(41)以及33MHz晶振芯片(42);所述50MHz晶振芯片(41)与所述雷达发射波形控制电路(2)、所述FPGA芯片(51)连接,用于向所述雷达发射波形控制电路(2)以及所述FPGA芯片(51)中的PL可编程逻辑电路提供同步时钟;所述33MHz晶振芯片(42)与所述FPGA芯片(51)连接,用于向所述FPGA芯片(51)中的PS处理系统电路提供时钟。
7.如权利要求5所述的一种汽车安全驾驶辅助雷达处理系统,其特征在于:所述数据传输模块(6)还包括:用于传输的RS-485接口(62)以及USB2.0接口(64);所述RS-485接口(62)以及所述USB2.0接口(64)均与所述FPGA芯片(51)连接。
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