[实用新型]基于PCIe接口的数据处理、波形产生和信号采集设备有效

专利信息
申请号: 201721925149.6 申请日: 2017-12-29
公开(公告)号: CN207650692U 公开(公告)日: 2018-07-24
发明(设计)人: 肖金明;夏传玉;张乐乐;王辉;李阳;方春伟;李一峰 申请(专利权)人: 烟台易尚电子科技有限公司
主分类号: G06F1/12 分类号: G06F1/12;G06F13/40
代理公司: 烟台上禾知识产权代理事务所(普通合伙) 37234 代理人: 刘志毅
地址: 264000 山东省烟台市*** 国省代码: 山东;37
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摘要:
搜索关键词: 时钟管理电路 缓存 数据交互控制 信号采集设备 波形产生 数据处理 输出时钟频率 本实用新型 上位机数据 核心组件 输入时钟 数据缓存 数据交互 数据转发 子板卡 外部 拓展
【权利要求书】:

1.基于PCIe接口的数据处理、波形产生和信号采集设备,其特征在于,包括:FPGA、PCIe接口电路、SFP接口、时钟管理电路、HSMC接口以及QDR缓存,其中,

所述FPGA为核心组件,完成与PCIe接口电路、SFP接口、时钟管理电路、HSMC接口以及QDR缓存的数据交互控制;

所述PCIe接口电路连接至所述FPGA,用于完成该设备与上位机数据的交互;所述PCIe接口电路与所述FPGA之间为双向连接;

所述SFP接口设为多个,多个SFP接口连接至所述FPGA,以进行数据的交互控制,完成高速数字信号从光纤到FPGA的接收和从FPGA到光纤的转发;多个SFP接口与FPGA之间通过高速差分线双向连接;

所述时钟管理电路连接有内时钟和外部的外时钟,还与所述FPGA、HSMC接口相连接,在FPGA的控制下完成对内、外时钟及HSMC接口输入时钟的选择,并对需要输出的时钟频率进行控制;

所述HSMC接口连接至所述FPGA,用于连接拓展子板卡;所述HSMC接口与FPGA双向连接,完成数据交互,同时与时钟管理电路双向连接,用于时钟的交互;

所述QDR缓存设为一个或多个,连接至所述FPGA,用于完成FPGA数据转发前的少量数据缓存;所述QDR缓存与FPGA之间双向连接。

2.根据权利要求1所述的基于PCIe接口的数据处理、波形产生和信号采集设备,其特征在于,该设备还有端口供同步触发信号单向连接至FPGA,用于与外部设备数据采集的同时触发。

3.根据权利要求1或2所述的基于PCIe接口的数据处理、波形产生和信号采集设备,其特征在于,还设有电源管理电路,所述电源管理电路为设备中各组件提供所需的电力。

4.根据权利要求1或2所述的基于PCIe接口的数据处理、波形产生和信号采集设备,其特征在于,还设有温度传感器,单向连接到FPGA,实时监测板卡芯片的温度。

5.根据权利要求1或2所述的基于PCIe接口的数据处理、波形产生和信号采集设备,其特征在于,还设有风扇,所述风扇在设备上电后启动,给设备散热。

6.根据权利要求1或2所述的基于PCIe接口的数据处理、波形产生和信号采集设备,其特征在于,所述FPGA选用Altera Stratix IV系列芯片。

7.根据权利要求1或2所述的基于PCIe接口的数据处理、波形产生和信号采集设备,其特征在于,所述FPGA连接有SFP接口指示灯,以显示SFP接口的工作状态。

8.根据权利要求1或2所述的基于PCIe接口的数据处理、波形产生和信号采集设备,其特征在于,所述时钟管理电路使用AD9520芯片,通过SPI接口与FPGA双向连接。

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