[发明专利]用于机器人的数据通信总线在审
| 申请号： | 201780015817.8 | 申请日： | 2017-03-07 |
| 公开（公告）号： | CN108885445A | 公开（公告）日： | 2018-11-23 |
| 发明（设计）人： | L·斯马尔;J·塞尔 | 申请（专利权）人： | 软银机器人欧洲公司 |
| 主分类号： | G05B19/418 | 分类号： | G05B19/418 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 刘瑜;王英 |
| 地址： | 法国*** | 国省代码： | 法国;FR |
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| 摘要： | |||
| 搜索关键词： | 数据通信总线 复杂可编程逻辑器件 放大器 速度传送数据 解串器电路 使用传感器 固件程序 双向串行 速度要求 从设备 低压差 预定义 致动器 主设备 互连 信令 异构 通信 机器人 关联 | ||
【权利要求书】：
1.一种包括数据通信总线的系统，所述数据通信总线包括复杂可编程逻辑器件，其中，所述复杂可编程逻辑器件被配置为同时以不同的通信速度传送数据帧。
2.如权利要求1所述的系统，还包括至少一个主设备，所述至少一个主设备与一个或多个与多个通信速率/速度要求相关联的异构从设备互连。
3.如权利要求2所述的系统，其中，所述主设备适于存储多个预定义的固件程序，并且其中，一个或多个从设备包括适于存储至少一个固件程序的非易失性存储器。
4.如权利要求3所述的系统，其中，所述主设备适于通过刷新一个或多个从设备各自的固件程序来控制所述一个或多个从设备。
5.如权利要求2至4中任一项所述的系统，其中，所述主设备包括易失性存储缓冲器，通往有效时钟信息的通路；用于对微处理器或微控制器进行互连的接口，以及被配置为收集令牌以确定所述易失性存储缓冲器中的读操作和/或写操作的硬件电路。
6.如权利要求2至4中任一项所述的系统，其中，所述主设备至少包括具有通信接口和闪存的微处理器。
7.如前述权利要求中任一项所述的系统，还包括一个或多个传感器和/或一个或多个致动器。
8.如前述权利要求中任一项所述的系统，其中，所述复杂可编程逻辑器件包括具有嵌入式逻辑和低压差分信令放大器的高速以及双向串行器/解串器。
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