[发明专利]用于通用串行总线(USB)系统的功率节省系统和方法有效

专利信息
申请号: 201780028422.1 申请日: 2017-04-13
公开(公告)号: CN109074146B 公开(公告)日: 2020-06-05
发明(设计)人: C·E·怀恩米勒;J·R·博耶特;R·C·迪恩斯;Z·朱 申请(专利权)人: 高通股份有限公司
主分类号: G06F1/324 分类号: G06F1/324;G06F1/3215;G06F1/3234;G06F1/3287;G06F1/3237
代理公司: 上海专利商标事务所有限公司 31100 代理人: 陈炜;亓云
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 通用 串行 总线 usb 系统 功率 节省 方法
【权利要求书】:

1.一种用于在U3功率状态期间降低通用串行总线物理层中的功耗的方法,其中在进入所述U3功率状态时信号检测电路被关断并且中频时钟被置于低功率状态,所述方法包括:

在U3功率状态期间,在通用串行总线物理层处接收参考时钟信号;

在所述U3功率状态期间,在接收到所述参考时钟信号中的边沿时唤醒所述通用串行总线物理层中的中频时钟;

在所述U3功率状态期间并且基于接收到所述中频时钟的时钟信号,唤醒信号检测电路;以及

使用所述信号检测电路来检测线路上的低频周期性信号。

2.如权利要求1所述的方法,其特征在于,接收所述参考时钟信号包括接收32千赫兹(32kHz)的参考时钟信号。

3.如权利要求1所述的方法,其特征在于,接收所述参考时钟信号包括从具有晶体振荡器的功率管理集成电路(PMIC)接收所述参考时钟信号。

4.如权利要求1所述的方法,其特征在于,进一步包括进入所述U3功率状态。

5.如权利要求1所述的方法,其特征在于,唤醒所述中频时钟包括唤醒锁频环(FLL)时钟源。

6.如权利要求1所述的方法,其特征在于,在接收到所述参考时钟信号中的边沿时唤醒所述通用串行总线物理层中的所述中频时钟包括在上升沿唤醒所述中频时钟。

7.如权利要求1所述的方法,其特征在于,在接收到所述参考时钟信号中的边沿时唤醒所述通用串行总线物理层中的所述中频时钟包括在下降沿唤醒所述中频时钟。

8.如权利要求1所述的方法,其特征在于,进一步包括:在检测到所述低频周期性信号时,将所述通用串行总线物理层唤醒到U0活跃功率状态。

9.如权利要求8所述的方法,其特征在于,将所述通用串行总线物理层唤醒到所述U0活跃功率状态包括在所述通用串行总线物理层内的控制系统处生成中断并将所述中断传递到通用串行总线物理层控制器。

10.如权利要求1所述的方法,其特征在于,唤醒所述中频时钟包括将所述中频时钟唤醒4微秒。

11.如权利要求10所述的方法,其特征在于,检测所述线路上的低频周期性信号包括对所述线路进行采样1微秒。

12.如权利要求10所述的方法,其特征在于,唤醒所述中频时钟包括允许所述中频时钟在所述4微秒中的2微秒里稳定下来。

13.一种通用串行总线物理层,包括:

输入,其被配置成接收参考时钟信号;

线路输入,其被配置成接收低频周期性信号;

中频时钟;

信号检测电路,其被配置成检测所述线路输入上的低频周期性信号;以及

控制系统,其被配置成:

在进入U3功率状态时关断所述信号检测电路并且将所述中频时钟置于低功率状态;

在U3低功率状态期间,在接收到所述参考时钟信号中的边沿时唤醒所述中频时钟;

在所述U3低功率状态期间并且基于接收到所述中频时钟的时钟信号,唤醒所述信号检测电路;

从所述信号检测电路接收关于在所述线路输入上检测到所述低频周期性信号的指示。

14.如权利要求13所述的通用串行总线物理层,其特征在于,所述中频时钟包括锁频环(FLL)时钟源。

15.如权利要求13所述的通用串行总线物理层,其特征在于,所述参考时钟信号包括32千赫兹(32kHz)时钟信号。

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