[发明专利]可切换拓扑机器有效
申请号: | 201780059323.X | 申请日: | 2017-10-24 |
公开(公告)号: | CN109791534B | 公开(公告)日: | 2023-10-27 |
发明(设计)人: | W·J·布泰拉;S·C·小斯蒂利;R·J·迪施勒 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F15/173 | 分类号: | G06F15/173;G06F9/38 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 刘瑜;王英 |
地址: | 美国加*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 切换 拓扑 机器 | ||
实施例涉及包括管芯上的多个处理器分片的计算设备,该多个处理器分片可以具有多个可切换拓扑。计算设备的拓扑可以包括一个或多个虚拟电路。虚拟电路可以包括多个处理器分片。拓扑的虚拟电路的处理器分片可以包括配置向量,以控制处理器分片与相邻处理器分片之间的连接。计算设备的第一拓扑可以对应于程序的计算的第一阶段,并且计算设备的第二拓扑可以对应于程序的计算的第二阶段。可以描述和/或要求保护其他实施例。
相关申请
本申请要求享有于2017年6月29日提交的题为“SWITCHABLE TOPOLOGY MACHINE”的美国申请15/637,581的优先权,该申请要求享有于2016年10月26日提交的题为“Switchable Topology Machine”的美国临时申请62/413,160的优先权。
政府权利
本公开是在政府支持下以与Intel Federal LLC的合同No.#H98230-13-D-0124完成的。合同可能已经由国防部(DoD)授予。政府在本公开中拥有一定的权利。
技术领域
本公开的实施例总体上涉及计算技术领域,并且更具体地涉及多个处理器分片的计算。
背景技术
本文提供的背景描述是出于总体上呈现公开内容的上下文的目的。除非在本文中另有说明,否则本部分中描述的材料不是本申请中的权利要求的现有技术,并且不因包含在本部分中而被认为是现有技术。
可以将管芯上的多核心或多核心芯片组织成处理器分片的一维阵列或二维阵列,其中每个处理器分片可以是处理器,或简称为分片。每个处理器分片可以是包括高速缓存和开关的计算单元、处理引擎或中央处理单元(CPU)。多个处理器分片可以根据拓扑彼此耦合。可以在管芯上形成大量处理器分片,例如,多于500个处理器分片。管芯上的大量处理器分片可能增加通信复杂度。此外,多个处理器分片的拓扑可以是固定的,并且在程序的计算期间不能改变。
附图说明
通过以下具体实施方式,结合附图,将容易理解实施例。为了有助于理解本说明书,相同的附图标记表示相同的结构元素。在附图的图中通过示例的方式而非通过限制的方式来说明实施例。
图1示出了根据各种实施例的示例计算设备,其包括管芯上的多个处理器分片以及包括多个处理器分片的虚拟电路(VC)。
图2示出了根据各种实施例的另一示例计算设备,其包括具有可切换的多个拓扑的管芯上的多个处理器分片。
图3示出了根据各种实施例的示例处理器分片,其包括控制器、可编程互连和多个接口块。
图4示出了根据各种实施例的处理器分片的示例控制器,其用于控制可编程互连与多个接口块之间的连接。
图5示出了根据各种实施例的示例配置向量,其存储在处理器分片的存储器中以控制可编程互连与多个接口块之间的连接。
图6示出了根据各种实施例的VC段在两个不同的处理器分片之间的示例形成。
图7-8示出了根据各种实施例的在形成两个VC的过程期间的仲裁的示例。
图9示出了根据各种实施例的处理器分片的控制器对可编程互连与多个接口块之间的连接进行控制的示例过程。
图10示出了根据各种实施例的适用于实践本公开的各个方面的示例设备。
图11示出了根据各种实施例的具有用于实践参考图1-10描述的方法的指令的存储介质。
具体实施方式
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