[发明专利]用于将修改后的数据从易失性存储器清除到持久性第二存储器的装置、系统和方法在审
申请号: | 201810234420.4 | 申请日: | 2018-03-21 |
公开(公告)号: | CN108628783A | 公开(公告)日: | 2018-10-09 |
发明(设计)人: | J.凌;R.阿加瓦尔;D.刘;W.陈 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F13/28 | 分类号: | G06F13/28 |
代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 李雪娜;杨美灵 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 控制器 第二存储器 存储器 存储器控制器 功率控制单元 持久性 读取 易失性存储器 存储器读取 读取地址 发送信号 范围读取 数据传输 响应 耦合到 调用 | ||
1.一种用于将修改后的数据从易失性第一存储器清除到持久性第二存储器的装置,所述装置与第一存储器、第二存储器、处理器和功率控制单元进行通信,所述装置包括:
第一存储器控制器,其耦合到第一存储器并且包括至少一个可靠性、可用性和可服务性(RAS)控制器,其中每个RAS控制器读取第一存储器中的地址范围;以及
第二存储器控制器,其耦合到第二存储器,所述第二存储器包括非易失性存储器;
其中第一存储器控制器和第二存储器控制器操作以:
响应于第一存储器控制器从功率控制单元接收到命令,调用至少一个RAS控制器以从第一存储器从针对RAS控制器指定的至少一个地址范围读取数据;
由第二存储器控制器确定从第一存储器读取的数据是否包括修改后的数据;
由第二存储器控制器将确定为修改后的从第一存储器读取的数据传输到第二存储器;以及
响应于RAS控制器完成读取地址范围中的数据,由第一存储器控制器向功率控制单元发送信号以指示,针对RAS控制器指定的地址范围中的修改后的数据被清除到第二存储器。
2.根据权利要求1所述的装置,其中第二存储器控制器还要丢弃由RAS控制器从第一存储器读取的数据而不传输到第二存储器,所述数据不包括修改后的数据。
3.根据权利要求1所述的装置,所述装置耦合到电池,其中电池供应功率给第一存储器控制器和第二存储器控制器,而至少一个RAS控制器从所述地址范围读取数据直到RAS控制器已经从所述地址范围读取所有数据,并且第二存储器控制器已经将由至少一个RAS控制器读取的修改后的数据传输到第二存储器。
4.根据权利要求1所述的装置,其中第一存储器包括多个存储器管芯,其中,至少一个RAS控制器包括多个RAS控制器,每一个与在到存储器管芯中的至少一个的至少一个存储器通道中的地址范围相关联,其中,每个RAS控制器接收命令并且作为响应读取RAS控制器的地址范围处的数据,并且其中每个RAS控制器响应于读取所有地址范围中的数据而发送信号以通知功率控制单元:针对RAS控制器的地址范围中的修改后的数据被清除。
5.根据权利要求1所述的装置,其中至少一个RAS控制器被配置为具有在初始化期间来自初始化固件的针对RAS控制器指定的地址范围。
6.根据权利要求1所述的装置,其中响应于所述命令,第一存储器控制器将所有未决写入数据排出到第一存储器,并且其中至少一个RAS控制器响应于第一存储器控制器将所有未决写入数据排出到第一存储器而从所述地址范围读取数据。
7.根据权利要求1所述的装置,其中功率控制单元响应于从至少一个RAS控制器中的每一个接收到信号而发起针对处理器的断电操作,所述信号指示针对RAS控制器指定的地址范围处的任何修改后的数据被读取。
8.根据权利要求1所述的装置,其中所述至少一个RAS控制器还要:
在接收到来自功率控制单元的命令之前,在正常操作模式下操作以持续地读取在针对RAS控制器指定的至少一个地址范围的每一个处的数据,以对所读取的数据执行错误校正并且写回到第一存储器;以及
终止针对所述命令的正常操作模式。
9.根据权利要求1所述的装置,其中第一存储器提供对第二存储器的高速缓存,其中在正常操作模式期间,第二存储器控制器接收对第二存储器中的所请求的数据的直接存储器请求并且确定所请求的数据是否被高速缓存在第一存储器中,其中从第一存储器返回第一存储器中的所读取的所请求的数据,并且其中响应于写入请求,写入数据被写入第一存储器。
10.根据权利要求1-10中任一项所述的装置,其中第一存储器包括动态随机存取存储器(DRAM),并且其中第二存储器包括非易失性存储器设备。
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