[发明专利]集成电路及用于操作有多个存储器单元的集成电路的方法有效

专利信息
申请号: 201810254088.8 申请日: 2018-03-26
公开(公告)号: CN108735246B 公开(公告)日: 2023-04-11
发明(设计)人: 清崎健 申请(专利权)人: 半导体元件工业有限责任公司
主分类号: G11C5/06 分类号: G11C5/06;G11C5/14
代理公司: 北京派特恩知识产权代理有限公司 11270 代理人: 王美石;姚开丽
地址: 美国亚*** 国省代码: 暂无信息
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摘要:
搜索关键词: 集成电路 用于 操作 有多个 存储器 单元 方法
【权利要求书】:

1.一种集成电路,其特征在于,所述集成电路包括:

电压发生器,所述电压发生器被配置成生成第一电压和第二电压;

电压控制电路,所述电压控制电路被配置成根据预定参数生成电压控制信号;

数据处理电路,所述数据处理电路耦接到所述电压控制电路和所述电压发生器,所述数据处理电路包括存储器单元,其中所述存储器单元被配置成:

根据预定时间周期在活动状态和空闲状态下工作,所述预定时间周期包括第一时间段和第二时间段;以及

根据时钟频率工作,其中所述时钟频率是所述预定参数的倍数;

选择器电路,所述选择器电路耦接在所述电压控制电路与所述数据处理电路之间并且对所述电压控制信号作出响应,其中:

所述选择器电路被配置成将所述第一电压和所述第二电压中的一者选择性地耦接到所述存储器单元;

所述电压控制电路根据所述第一时间段和所述第二时间段将所述电压控制信号传输到所述选择器电路;

在与所述活动状态重合时所述第一电压耦接到所述存储器单元;以及

在与所述空闲状态重合时所述第二电压耦接到所述存储器单元。

2.根据权利要求1所述的集成电路,其特征在于:

所述预定时间周期等于所述预定参数的倒数;

所述第一时间段等于所述时钟频率的倒数;并且

所述第二时间段等于所述预定时间周期与所述第一时间段的差值。

3.根据权利要求1所述的集成电路,其特征在于:

在所述第一时间段期间,所述存储器单元在所述活动状态下工作;并且

在所述第二时间段期间,所述存储器单元在所述空闲状态下工作。

4.根据权利要求1所述的集成电路,其特征在于:

当所述存储器单元在所述活动状态下工作时,所述存储器单元能够读取和写入数据;并且

当所述存储器单元在所述空闲状态下工作时,所述存储器单元:

能够保持先前写入的数据;并且

不能够读取和写入新数据。

5.根据权利要求1所述的集成电路,其特征在于:

所述电压控制电路在所述第一时间段期间将所述第一电压耦接到所述存储器单元;并且

所述电压控制电路在所述第二时间段期间将所述第二电压耦接到所述存储器单元。

6.根据权利要求1所述的集成电路,其特征在于:

所述预定参数是采样频率;并且

所述采样频率是根据人类听觉范围选择的。

7.根据权利要求1所述的集成电路,其特征在于:

所述第一电压小于所述存储器单元的最大工作电压并且大于所述存储器单元的最小工作电压;并且

所述第二电压小于所述存储器单元的所述最小工作电压并且大于所述存储器单元的最小保持电压。

8.一种用于操作具有多个存储器单元的集成电路的方法,其特征在于,所述方法包括:

生成具有基于采样频率的时钟频率的时钟信号;

利用电压发生器生成第一电压和第二电压;

利用所述电压发生器同时在第一输出端子处输出所述第一电压以及在第二输出端子处输出所述第二电压;

在活动状态期间将所述第一电压选择性地耦接到来自所述多个存储器单元的至少一个存储器单元;并且

在空闲状态期间将所述第二电压选择性地耦接到来自所述多个存储器单元的至少一个存储器单元;

其中:

在预定时间周期期间,所述多个存储器单元在所述活动状态和所述空闲状态下工作;并且

所述预定时间周期等于所述采样频率的倒数。

9.根据权利要求8所述的方法,其特征在于:

所述第一电压小于所述多个存储器单元的最大工作电压并且大于所述多个存储器单元的最小工作电压;并且

所述第二电压小于所述多个存储器单元的所述最小工作电压并且大于所述多个存储器单元的最小保持电压。

10.根据权利要求8所述的方法,其特征在于:

所述多个存储器单元在第一预定时间段期间在所述活动状态下工作;

所述多个存储器单元在第二预定时间段期间在所述空闲状态下工作;并且

所述第一预定时间段和所述第二预定时间段之和等于所述预定时间周期。

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