[发明专利]一种载波跟踪方法及装置有效

专利信息
申请号: 201810365767.2 申请日: 2018-04-23
公开(公告)号: CN108600134B 公开(公告)日: 2020-01-17
发明(设计)人: 邓中亮;姜海君;李宁;莫君;贾步云;边新梅;唐宗山;范时伟;杨寅;刘雯 申请(专利权)人: 北京邮电大学
主分类号: H04L27/00 分类号: H04L27/00
代理公司: 11413 北京柏杉松知识产权代理事务所(普通合伙) 代理人: 项京;马敬
地址: 100876 *** 国省代码: 北京;11
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摘要:
搜索关键词: 频率差信号 门限 频率差 减小 载波跟踪 次频率 复现 鉴频器 跟踪 鉴频
【说明书】:

发明实施例提供了一种载波跟踪方法及装置,其中,方法包括:获取鉴频器已鉴频的本次频率差信号;若本次频率差信号相较于本次频率差信号的上一次频率差信号变大,则将本次频率差信号中的频率差与增大后的门限值进行比较,得到本次频率差信号中的频率差大于增大后的门限值,增大后的门限值是基于本次频率差信号及本次频率差信号的上N次频率差信号进行变大确定的;反之,将本次频率差信号的频率差与减小后的门限值进行比较,得到本次频率差信号中的频率差小于减小后的门限值;基于本次频率差信号中的频率差大于增大后的门限值,跟踪本地复现载波的频率;基于本次频率差信号中的频率差小于减小后的门限值,跟踪本地复现载波的相位。

技术领域

本发明涉及通信技术领域,特别是涉及一种载波跟踪方法及装置。

背景技术

随着接收机的飞速发展,载波跟踪作为接收机的关键技术之一,也得到了快速发展。目前载波跟踪的方法有多种实现方式,下面以一种实现方式为例进行说明。

这种实现方式中的载波跟踪环路包含:积分清除器,FPGA(Field-ProgrammableGate Array,现场可编程门阵列)、NCO(numerical controlled oscillator,数字控制振荡器)。这个FPGA可以依次实现如下功能,比如,实现FLL(Frequency Lock Loop,锁频环)对积分清除器输出的积分清除信号进行鉴频、实现PLL(Phase Lock Loop,锁相环)对FLL输出信号进行鉴相,以及实现滤波器对PLL输出信号及对FLL输出信号进行滤波的功能。

一般FLL先工作,使本地复现载波的频率收敛于接收信号载波之后;PLL再工作,进入跟踪状态,该跟踪状态用于对本地复现载波的频率与相位进行跟踪。利用PLL和FLL分开单独工作,来实现载波跟踪的方法过程中,具体步骤如下:

第一步,积分清除器接收已剥离出的接收信号载波和本地复现载波,将剥离出的接收信号载波和本地复现载波中的高频信号进行滤除,将滤除高频信号后的信号,作为积分清除信号;

第二步,FLL接收积分清除器的积分清除信号,对该积分清除信号中的本地复现载波的频率,进行迁移至接收信号载波的频率上,得出本地复现载波与接收信号载波的频率差信号,若判断结果为频率差信号中的频率差大于预定的门限值,则执行第三步;若判断结果为频率差信号中的频率差小于预定的门限值,则执行第四步;

第三步,利用二阶滤波环路及三阶滤波环路,对频率差信号进行滤波,得到滤波后的信号;利用滤波后的信号,调整NCO,NCO输出调整后的本地复现载波的频率,将调整后的本地复现载波的频率输出至积分清除器,返回继续执行第一步。

第四步,说明可以进入跟踪状态,FLL停止工作,PLL开始工作,得到本地复现载波与接收信号载波的相位差;将FLL的输出信号及PLL的输出信号进行滤波,得到滤波后的信号;利用滤波后的信号,利用滤波后的信号,调整NCO,NCO调整本地复现载波的频率及相位,以完成对本地复现载波的频率及相位进行跟踪;

第五步,在PLL工作时,若频率差信号中的频率差大于上述预定的门限值,则返回执行第一步。

然而,发明人在实现本发明的过程中,发现现有技术中载波跟踪方法实现载波跟踪,至少存在如下问题:

上述FLL得到的频率差信号中的频率差可能在预设的门限值附近频繁地小幅度跳动,也就是说,上述频率差信号中的频率差一会小于预定的门限值,一会又大于预定的门限值,这样会导致PLL和FLL进行频繁的切换,容易跟踪失锁。

发明内容

本发明实施例的目的在于提供一种载波跟踪方法及装置,以解决现有技术FLL得到的频率差信号中的频率差可能在预设的门限值附近频繁地小幅度跳动,导致PLL和FLL进行频繁的切换,容易跟踪失锁的问题。具体技术方案如下:

第一方面,本发明实施例提供了一种载波跟踪方法,包括:

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