[发明专利]可抑制电磁干扰的显示装置及显示驱动电路有效
申请号: | 201810496008.X | 申请日: | 2018-05-22 |
公开(公告)号: | CN110517644B | 公开(公告)日: | 2021-01-26 |
发明(设计)人: | 蔡学宏;陈蔚宗;王裕霖;林柏辛 | 申请(专利权)人: | 元太科技工业股份有限公司 |
主分类号: | G09G3/34 | 分类号: | G09G3/34 |
代理公司: | 北京律诚同业知识产权代理有限公司 11006 | 代理人: | 梁挥;祁建国 |
地址: | 中国台湾新竹科*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 可抑制 电磁 干扰 显示装置 显示 驱动 电路 | ||
1.一种显示装置,其特征在于,包括:
基板;
主动阵列,设置于该基板上,该主动阵列包括多条数据线、多条闸极线以及多个像素,该些数据线纵横交错于该些闸极线,该些像素耦接于该些数据线与该些闸极线的交错处;
显示驱动器,设置于该基板上,该显示驱动器用以回应调节后序列数据时脉信号,产生用以驱动该些数据线及/或该些闸极线的信号;以及
薄膜晶体管调节电路,设置于该基板上并耦接该显示驱动器,该薄膜晶体管调节电路包括至少一个薄膜晶体管,并用以回应预设闸极偏压衰减序列数据时脉信号的振幅,以对该显示驱动器提供该调节后序列数据时脉信号;
其中,该薄膜晶体管的一端的漏极或源极接收该序列数据时脉信号,另一端的漏极或源极则是耦接至该显示驱动器以对其提供调节后序列数据时脉信号,该薄膜晶体管调节电路包括多个并联设置的薄膜晶体管,各该薄膜晶体管接于该序列数据时脉信号以及该调节后序列数据时脉信号之间,并受控于该预设闸极偏压。
2.一种显示装置,其特征在于,包括:
基板;
主动阵列,设置于该基板上,该主动阵列包括多条数据线、多条闸极线以及多个像素,该些数据线纵横交错于该些闸极线,该些像素耦接于该些数据线与该些闸极线的交错处;
显示驱动器,设置于该基板上,该显示驱动器用以回应调节后序列数据时脉信号,产生用以驱动该些数据线及/或该些闸极线的信号;以及
薄膜晶体管调节电路,设置于该基板上并耦接该显示驱动器,该薄膜晶体管调节电路包括至少一个薄膜晶体管,并用以回应预设闸极偏压衰减序列数据时脉信号的振幅,以对该显示驱动器提供该调节后序列数据时脉信号;
其中,该薄膜晶体管的一端的漏极或源极接收该序列数据时脉信号,另一端的漏极或源极则是耦接至该显示驱动器以对其提供调节后序列数据时脉信号,该薄膜晶体管调节电路包括多个串联设置的薄膜晶体管以形成薄膜晶体管串,该薄膜晶体管串接于该序列数据时脉信号以及该调节后序列数据时脉信号之间,并受控于该预设闸极偏压。
3.一种显示装置,其特征在于,包括:
基板;
主动阵列,设置于该基板上,该主动阵列包括多条数据线、多条闸极线以及多个像素,该些数据线纵横交错于该些闸极线,该些像素耦接于该些数据线与该些闸极线的交错处;
显示驱动器,设置于该基板上,该显示驱动器用以回应调节后序列数据时脉信号,产生用以驱动该些数据线及/或该些闸极线的信号;以及
薄膜晶体管调节电路,设置于该基板上并耦接该显示驱动器,该薄膜晶体管调节电路包括至少一个薄膜晶体管,并用以回应预设闸极偏压衰减序列数据时脉信号的振幅,以对该显示驱动器提供该调节后序列数据时脉信号;
其中,该薄膜晶体管的一端的漏极或源极接收该序列数据时脉信号,另一端的漏极或源极则是耦接至该显示驱动器以对其提供调节后序列数据时脉信号,该薄膜晶体管调节电路由单一个该薄膜晶体管实现,该薄膜晶体管接于该序列数据时脉信号以及该调节后序列数据时脉信号之间,并受控于该预设闸极偏压。
4.如权利要求1、2或3所述的显示装置,其特征在于,还包括:
印刷电路板,耦接该薄膜晶体管调节电路,该印刷电路板用以对该薄膜晶体管调节电路提供该序列数据时脉信号。
5.如权利要求1、2或3所述的显示装置,其特征在于,还包括:
电子墨水层,叠于该主动阵列之上。
6.一种显示驱动电路,用于驱动显示装置的主动阵列,其特征在于,包括:
显示驱动器,设置于基板上,该显示驱动器用以回应调节后序列数据时脉信号,产生用以驱动该主动阵列的信号;以及
薄膜晶体管调节电路,设置于该基板上并耦接该显示驱动器,该薄膜晶体管调节电路包括至少一个薄膜晶体管,并用以回应预设闸极偏压衰减序列数据时脉信号的振幅,其中,该薄膜晶体管的一端的漏极或源极接收该序列数据时脉信号,另一端的漏极或源极则是耦接至该显示驱动器以对该显示驱动器提供该调节后序列数据时脉信号,该薄膜晶体管调节电路包括多个并联设置的薄膜晶体管,各该薄膜晶体管接于该序列数据时脉信号以及该调节后序列数据时脉信号之间,并受控于该预设闸极偏压。
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