[发明专利]数据存储方法有效

专利信息
申请号: 201810668573.X 申请日: 2018-06-26
公开(公告)号: CN108876703B 公开(公告)日: 2022-11-08
发明(设计)人: 杨丽宁;苏睿 申请(专利权)人: 重庆京像微电子有限公司
主分类号: G06T1/60 分类号: G06T1/60
代理公司: 北京康信知识产权代理有限责任公司 11240 代理人: 赵囡囡;董文倩
地址: 401122 重庆*** 国省代码: 重庆;50
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摘要:
搜索关键词: 数据 存储 方法
【说明书】:

本发明公开了一种数据存储方法。其中,该方法包括:确定每帧图像的tile数量;将采集的第N帧第M个tile中第I个基本单元的视频图像信号一边写入DDR中进行信息压缩,一边预读信息压缩存储RAM中对应地址的数据;将信息压缩后的数据与预读取的数据进行比较,如果相同标识为1,后续该tile的其他基本单元的数据继续相同方式的操作;如果不同结束数据比较判断,并且将第N帧第M个tile的压缩信息写入该RAM对应地址当中;从所述DDR读取第N帧数据时,根据读取数据的tile选择对应的标识信号,如果标识为1,则该tile数据不进行读取操作,如果标识为0,则进行读取操作。本发明解决了由于现有技术中在解决降低帧间存储带宽的过程中导致的成本高实现难度大的技术问题。

技术领域

本发明涉及图像技术应用领域,具体而言,涉及一种数据存储方法。

背景技术

屏幕图像的分频率,由原来的702p以下的标清,到720p的准高清、再到1080p高清、到现在的4K,越来越高;屏幕图像的帧率也由原来的24fps到现在的常用60fps,甚至120fps,也越来越高。两路图像同步传输和显示也在工程设计中越来越多的应用起来。这种基于多路、高分辨率和高帧频的图像处理,再加上无损压缩的需求,其对图像像素存储提出了更高要求,内存存储的带宽、成本和功耗也越来越高。那么,如何降低内存存储带宽,降低图像处理的成本和功耗,是现在图像处理急需要解决的一个关键问题。降低图像存储带宽有两种方式,一种是降低一帧内图像在内存中的存储带宽;二是降低帧间(本帧图像与下帧图像)图像在内存中的存储带宽;本发明专利只针对帧间(本帧图像与下帧图像)图像的降带宽方法进行说明。本发明专利是提取前后连续两帧图像的相同特征来降低带宽的,对相同特征的图像不再进行重复、相同操作。而这种特性是图像的一个主要特性,普遍存在。

目前降低帧间存储带宽的方法主要有以下几种方式:

传统方案一:开辟片上RAM来存储本帧的数据,用下帧数据和本帧数据进行比较;

传统方案二:采用对原数据进行压缩的方式来存储图像。先对本帧数据进行压缩存储,然后再用下帧数据到来时,再将本帧数据进行解码后进行数据比对。

但是,传统方案一的实现方案主要存在以下缺点:该方式增加的片上存储ram增加了很大面积和功耗;该方式在工程实现中,针对低分辨率还可以接受,但是对于高分辨率如果采用fpga方案,会大大增加fpga选型的成本;如果是ASIC方案,会大大增加芯片面积;总之都要需要付出较大的成本,方案的性价比较低;

传统方案二的实现方案主要存在以下缺点:该方案增加的编解码处理,增加了很多的处理资源,导致面积和成本增加;该方案增加的编解码处理,实现难度大。

针对上述由于现有技术中在解决降低帧间存储带宽的过程中导致的成本高实现难度大的问题,目前尚未提出有效的解决方案。

发明内容

本发明实施例提供了一种数据存储方法,以至少解决由于现有技术中在解决降低帧间存储带宽的过程中导致的成本高实现难度大的技术问题。

根据本发明实施例的一个方面,提供了一种数据存储系统,包括:存储模块、写入模块、读取模块和信息提取模块,其中,信息提取模块,用于提取图像数据的特征,得到特征数据;写入模块的输出端与存储模块的输入端连接,写入模块的输入端与信息提取模块的输出端连接,用于控制特征数据写入存储模块;存储模块,用于通过双倍速率内存存储数据;读取模块的输入端与存储模块的输出端连接,用于控制从存储模块中提取特征数据。

可选的,数据存储系统还包括:数据处理模块,与读取模块的输出端连接,用于依据读取后的特征数据执行图像处理。

可选的,信息提取模块包括:信息比较单元、内存、写入接口和读取接口,其中,信息比较单元,用于将接收到的图像数据通过读取接口从内存中预先存储的数据进行比较,提取图像数据中的特征,得到特征数据;写入接口,用于将特征数据传输至写入模块。

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