[发明专利]外延片的制备方法及肖特基二极管在审
申请号: | 201810682428.7 | 申请日: | 2018-06-27 |
公开(公告)号: | CN108899277A | 公开(公告)日: | 2018-11-27 |
发明(设计)人: | 邢东;冯志红;赵向阳;王元刚 | 申请(专利权)人: | 中国电子科技集团公司第十三研究所 |
主分类号: | H01L21/3205 | 分类号: | H01L21/3205;H01L21/321;H01L29/872;H01L21/329 |
代理公司: | 石家庄国为知识产权事务所 13120 | 代理人: | 王政 |
地址: | 050051 *** | 国省代码: | 河北;13 |
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摘要: | |||
搜索关键词: | 制备 外延层 轻掺杂外延层 肖特基二极管 外延片 上表面 重掺杂 生长 半导体技术领域 反向击穿电压 衬底上表面 高频性能 降低器件 填充 | ||
1.一种外延片的制备方法,其特征在于,包括:
在衬底上表面生长重掺杂外延层;
在所述重掺杂外延层上表面生长轻掺杂外延层;
在所述轻掺杂外延层中制备凹槽,所述凹槽的深度小于所述轻掺杂外延层的厚度;
在制备凹槽后的轻掺杂外延层上表面生长二次外延层,所述二次外延层填充所述凹槽,且所述二次外延层的厚度大于所述凹槽的深度。
2.如权利要求1所述的外延片的制备方法,其特征在于,还包括:将所述二次外延层进行平坦化处理。
3.如权利要求1所述的外延片的制备方法,其特征在于,所述在所述轻掺杂外延层中制备凹槽,包括:
在所述轻掺杂外延层上表面涂覆光刻胶,经曝光、显影处理后,露出凹槽所在区域的轻掺杂外延层;
对所述轻掺杂外延层进行湿法腐蚀、干法腐蚀或刻蚀处理,去除凹槽所在区域的二次外延层;
去除所述光刻胶。
4.如权利要求1所述的外延片的制备方法,其特征在于,所述凹槽的深度大于所述轻掺杂外延层厚度的1/5,且小于所述轻掺杂外延层的4/5。
5.如权利要求1所述的外延片的制备方法,其特征在于,所述凹槽的形状为矩形、圆形、椭圆形和三角锥形中的任意一种或多种。
6.如权利要求1所述的外延片的制备方法,其特征在于,所述重掺杂外延层的掺杂浓度范围为1018/cm3至5×1018/cm3,所述轻掺杂外延层的掺杂浓度范围为1015/cm3至1018/cm3,所述二次延层的掺杂浓度范围为1016/cm3至1018/cm3,且所述二次外延层的掺杂浓度与所述轻掺杂外延层的掺杂浓度不同。
7.如权利要求1所述的外延片的制备方法,其特征在于,所述重掺杂外延层的厚度大于0.5微米,所述轻掺杂外延层的厚度大于0.1微米,所述二次外延层的厚度小于所述轻掺杂外延层的厚度。
8.一种外延片,其特征在于,所述外延片通过如权利要求1至7任一项所述的外延片的制备方法制备得到。
9.一种肖特基二极管,其特征在于,所述肖特基二极管在如权利要求8所述的外延片上制备得到。
10.一种肖特基二极管的制备方法,其特征在于,包括:如权利要求1至7任一项所述的外延片的制备方法;
还包括:
去除所述外延片的二次外延层和轻掺杂外延层,露出阴极电极所在区域的重掺杂外延层和阳极焊盘所在区域的重掺杂外延层,并在露出的重掺杂外延层的上表面分别制备阴极电极和阳极焊盘;
制备隔离所述阴极电极和所述阳极焊盘的隔离沟槽;
在所述二次外延层上表面生长介质层,露出阳极电极所在的区域的二次外延层,并在露出的二次外延层的上表面制备阳极电极;
制备连接所述阳极电极和所述阳极焊盘的阳极空气桥。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造