[发明专利]处理中断优先级的电路系统有效

专利信息
申请号: 201810802685.X 申请日: 2018-07-20
公开(公告)号: CN110737616B 公开(公告)日: 2021-03-16
发明(设计)人: 费晓行;费善健 申请(专利权)人: 瑞昱半导体股份有限公司
主分类号: G06F13/26 分类号: G06F13/26
代理公司: 北京康信知识产权代理有限责任公司 11240 代理人: 梁丽超;田喜庆
地址: 中国台*** 国省代码: 台湾;71
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摘要:
搜索关键词: 处理 中断 优先级 电路 系统
【说明书】:

一种处理中断优先级的电路系统,电路系统如一片上系统(SoC),在其中运行的中断优先级处理方法中,片上系统中的处理器在执行工作时,当接收到访问一临界区的高优先级中断时,系统设计高优先级中断为恒开,但禁止访问临界区,如此,即设置一低优先级中断,以访问并处理高优先级中断所要访问的数据,当返回低优先级中断后,处理器将判断是否唤醒之前高优先级中断未处理完的工作,若尚有工作,即由处理器以一任务继续处理高优先级中断未处理完的工作。所披露的电路系统可以在保持有关中断的特性外,还保持系统处理重要任务的实时性。

技术领域

一种中断处理的电路系统,特别是一种为了要达成有些高优先级中断在处理过程中始终打开,并保持有关中断特性,所提出的具有中断优先级机制的片上系统。

背景技术

片上系统(System on Chip,SoC)为一种整合多种功能的系统的单一晶片,并广泛被晶片设计者采用,设计片上系统时,设置有多个子系统(subsystems),或是子系统的子系统,子系统通过系统总线(bus)彼此通信。

因为片上系统中的子系统彼此分享共同的数据,传统上,子系统彼此之间运用了触发(trigger)中断(interrupt)的方式进行通信,作为控制数据存取的机制。所述中断是由系统内中央处理器(CPU)的中断控制器(interrupt controller)所处理的,中断控制器用以连接各种子系统和中央处理器,当有一个子系统产生中断后,需经过中断控制器的转发,信号才能到达中央处理器。

运作时,由子系统产生中断信号给片上系统中央处理器,由中央处理器的中断控制器接收到中断信号后,判断是由哪个子系统触发的中断,接着处理中断处理程序(Interrupt Service Routine,ISR),让子系统可以在不冲突的情况下共享数据。

图1显示现有片上系统的电路方框图。

一个设于电子系统中的片上系统包括有中央处理器110,其中设有管理中断信号的中断控制器115,其他共用资源示意列出有存储器111与传感器112,彼此通过总线10传递信息。片上系统中设有多个子系统101~105,也可能有子系统的子系统,子系统101~105是在片上系统中的一些模块,在需要共用资源时产生中断信号,中断控制器115接收某个子系统中断信号时,传播到其他子系统,达到中断管理的目的。

而多数处理实时信息的过程中,现有技术大多采用关中断(disabled interrupt)的方法来实现临界区的设置,当一个程序正在处理器上执行其临界区代码时,要防止其他程序再进入临界区访问,最简单直接的方法是禁止中断发生,称之为关中断(disableinterrupt)。

但是这种方法在禁止低优先级中断的同时,也关闭了高优先级中断,在很大程度上影响了系统处理的实时性。

发明内容

本发明提出一种处理中断优先级的电路系统,如一种在片上系统(SoC)的电路系统中,发明目的是利用片上系统中断优先级的特性,将高优先级中断设为恒开,但此高优先级中断的处理函数禁止访问临界区,而低优先级中断处理函数则允许访问临界区,通过此设定,一方面可继续使用传统关中断的方法实现临界区的设置,另外一方面可以保持系统处理的实时性。

根据一实施例,所述电路系统运行一中断优先级处理方法,并可应用在一实时操作系统中,当处理器正在执行一工作时,接收一访问临界区的高优先级中断,此时,因为高优先级中断禁止访问临界区,而通过一旗标状态或位元状态设置一低优先级中断访问并处理高优先级中断所要访问的临界区的数据。接着,当返回低优先级中断后,处理器将判断是否唤醒高优先级中断未处理完的工作,若尚有工作未完成,由处理器继续处理高优先级中断未处理完的工作。

在一实施例中,所述处理器原本执行的工作为一无须中断处理的普通任务,亦可为低优先级中断的任务。

根据电路系统实施例,电路系统可为一片上系统,其中包括一处理器以及一或多个子系统,处理器用以执行上述中断优先级处理方法。

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