[发明专利]Efuse控制器、Efuse系统及Efuse烧写方法有效

专利信息
申请号: 201810814382.X 申请日: 2018-07-23
公开(公告)号: CN108962329B 公开(公告)日: 2023-09-29
发明(设计)人: 蒋松鹰;姚炜 申请(专利权)人: 上海艾为电子技术股份有限公司
主分类号: G11C17/16 分类号: G11C17/16;G11C17/18
代理公司: 北京合智同创知识产权代理有限公司 11545 代理人: 李杰
地址: 200233 上海市徐汇*** 国省代码: 上海;31
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摘要:
搜索关键词: efuse 控制器 系统 方法
【说明书】:

本发明公开了一种Efuse控制器、Efuse系统及Efuse烧写方法,该Efuse控制器,包括:数据整形模块,第一输入端用于接收时钟输入信号,第二输入端用于接收数据输入信号,数据整形模块的输出端输出根据时钟输入信号对数据输入信号整形,生成整形输出信号;计数器,输入端用于接收时钟输入信号,输出端用于输出对时钟输入信号的计数结果;逻辑与门电路,两个输入端中的一个用于接收时钟输入信号,另一个输入端用于接收整形输出信号;逻辑与门电路的输出端用于连接Efuse模块的STROBE信号输入端;译码电路,两个输入端中的一个用于接收计数结果,另一个输入端用于接收整形输出信号;译码电路的输出端用于连接Efuse模块的数据信号输入端。实施本发明能实现简单有效地进行Efuse烧录。

技术领域

本发明涉及Efuse技术领域,特别涉及一种Efuse控制器、Efuse系统及Efuse烧写方法。

背景技术

Efuse技术广泛应用于对于芯片在量产时候的内部参数微调,对于大规模量产芯片时,稳定快速又简洁的Efuse烧录能大大提高芯片量产的良率。

现有专利文献提出了各种Efuse模块及烧录技术,比如CN106997782A,提供了一种EFUSE烧写方法及烧写电路,采用一恒流源与地址向量组合产生一恒流脉冲;通过对EFUSEIP进行校正,并且确定全地址范围内EFUSE bit的扫描电流值;通过选取扫描电流值的最大值,作为恒流源设定值,进行该EFUSE进行烧写测试,并对其它EFUSE进行数据下载。本发明通过恒流脉冲对EFUSE进行烧写,通过电流向量控制EFUSE烧写条件,以此保证EFUSE无论线路长短其烧写的条件一致,并且避免了过去EFUSE热效应的爆裂方式的烧断情况,而是采用电子迁移方式使其熔断,这样既提高了EFUSE烧写过程中的稳定性,又提高了EFUSE在高温下数据保持能。再比如CN107369472A,提供了一种Efuse模块烧写装置及其应用方法,所述Efuse模块设置于所述电路板上,包括第一端口和第二端口;所述电路板上设置有第一连接孔和第二连接孔;Efuse模块的第一端口通过第一导线与第一连接孔连接,Efuse模块的第二端口通过第二导线与第二连接孔连接;第一导线和第二导线分别与供电单元连接;所述第一连接孔可置入第一锁固件,以使得供电单元与第一导线断开连接;所述第二连接孔可置入第二锁固件,以使得供电单元与第二导线断开连接。由于Efuse模块在电路板上的走线都经过连接孔,因而设计一种夹具即可完成对不同产品的测试,大大降低了生产成本,提高了测试效率。

然而,以上烧录方法都比较复杂,故亟待提出一种简单有效的Efuse烧录方法及系统。

发明内容

有鉴于此,本发明旨在提供一种Efuse控制器、Efuse系统及Efuse烧写方法,以实现简单有效地进行Efuse烧录。

具体而言,本发明提供一种Efuse控制器,包括:数据整形模块,包括第一输入端、第二输入端和输出端,所述第一输入端用于接收时钟输入信号,所述第二输入端用于接收数据输入信号,所述数据整形模块的输出端输出根据所述时钟输入信号对所述数据输入信号整形,生成整形输出信号;计数器,输入端用于接收时钟输入信号,输出端用于输出对所述时钟输入信号的计数结果;逻辑与门电路,包括两个输入端及一个输出端,所述两个输入端中的一个用于接收时钟输入信号,另一个输入端用于接收所述整形输出信号;所述逻辑与门电路的输出端用于连接Efuse模块的STROBE信号输入端;译码电路,包括两个输入端及一个输出端,所述两个输入端中的一个用于接收所述计数结果,另一个输入端用于接收所述整形输出信号;所述译码电路的输出端用于连接Efuse模块的数据信号输入端。

进一步地,所述数据整形模块为一级触发器,所述一级触发器用于在所述时钟输入信号的每个周期的起始上升沿,根据所述数据输入信号整形触发生成整形输出信号。

进一步地,所述一级触发器具体用于在所述时钟输入信号的每个周期的起始上升沿,当所述数据输入信号为高电平时,生成高电平的整形输出信号;当所述数据输入信号为低电平时,生成低电平的整形输出信号。

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