[发明专利]通用型滤波器有效

专利信息
申请号: 201810814383.4 申请日: 2018-07-23
公开(公告)号: CN108683414B 公开(公告)日: 2023-09-22
发明(设计)人: 蒋松鹰;姚炜 申请(专利权)人: 上海艾为电子技术股份有限公司
主分类号: H03H11/38 分类号: H03H11/38
代理公司: 北京合智同创知识产权代理有限公司 11545 代理人: 李杰
地址: 200233 上海市徐汇*** 国省代码: 上海;31
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摘要:
搜索关键词: 通用型 滤波器
【权利要求书】:

1.一种通用型滤波器,其特征在于,包括:

数据延迟寄存单元,包括:时钟信号输入端,用于接收时钟信号;第一时钟信号计数结果输入端,用于接收对所述时钟信号的计数结果;第一输入端用于接收数字输入信号;第二输入端用于接收数字输出信号;第一输出端用于输出所述数字输入信号在延迟所述时钟信号的一拍后的第一延迟数字输入信号;第二输出端用于输出所述数字输入信号在延迟所述时钟信号的两拍后的第二延迟数字输入信号;第三输出端用于输出所述数字输出信号在延迟所述时钟信号的一拍后的第一延迟数字输出信号;第四输出端用于输出所述数字输入信号在延迟所述时钟信号的两拍后的第二延迟数字输出信号;

时分复用逻辑运算累积单元,包括:

第一数据输入端,用于接收所述数字输入信号;

第二数据输入端,用于接收所述第一延迟数字输入信号;

第三数据输入端,用于接收所述第二延迟数字输入信号;

第四数据输入端,用于接收所述第一延迟数字输出信号;

第五数据输入端,用于接收所述第二延迟数字输出信号;

第二时钟信号计数结果输入端,用于接收对所述时钟信号的计数结果;

第一滤波参数输入端、第二滤波参数输入端、第三滤波参数输入端、第四滤波参数输入端、第五滤波参数据输入端、以及逻辑运算累积信号输出端;

所述时分复用逻辑运算累积单元用于在所述时钟信号的预定节拍得到所述数字输入信号与第一滤波参数的第一乘积;在所述时钟信号的预定节拍的后一个节拍得到所述第一延迟数字输入信号与第二滤波参数的第二乘积,进而得到所述第一乘积与所述第二乘积相加的第一和值;在所述时钟信号的预定节拍的后两个节拍得到所述第二延迟数字输入信号与第三滤波参数的第三乘积,进而得到所述第一和值与所述第三乘积相加的第二和值;在所述时钟信号的预定节拍的后三个节拍得到所述第一延迟数字输出信号与第四滤波参数的第四乘积,进而得到所述第一和值与所述第四乘积相减的第一差值;在所述时钟信号的预定节拍的后四个节拍得到所述第二延迟数字输出信号与第五滤波参数的第五乘积,进而得到所述第一差值与所述第四乘积相减的第二差值,并通过所述逻辑运算累积信号输出端输出第二差值;

饱和运算单元,用于对所述第二差值进行饱和运算,得到并输出所述数字输出信号。

2.如权利要求1所述的通用型滤波器,其特征在于,所述通用型滤波器还包括旁路选择单元,包括:

第一旁路信号输入端,用于接收所述数字输入信号;

第二旁路信号输入端,用于接收所述数字输出信号或第一延迟数字输出信号;

旁路使能信号输入端,用于接收旁路使能信号;

滤波信号输出端,用于根据所述旁路使能信号,选择输出所述第一旁路信号输入端的输入信号或者选择输出所述第二旁路信号输入端的输入信号。

3.如权利要求1或2所述的通用型滤波器,其特征在于,所述数据延迟寄存单元包括:

串联的第一数据延迟寄存器及第二数据延迟寄存器,所述第一数据延迟寄存器的输入端作为所述第一输入端;所述第二数据延迟寄存器的输入端作为所述第一输出端;所述第二数据延迟寄存器的输出端作为所述第二输出端;

串联的第三数据延迟寄存器及第四数据延迟寄存器,所述第三数据延迟寄存器的输出端作为所述第三输出端;所述第四数据延迟寄存器的输出端作为所述第四输出端。

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