[发明专利]一种数据处理方法、装置、设备、系统、FPGA板卡及其组合在审
申请号: | 201810871133.4 | 申请日: | 2018-08-02 |
公开(公告)号: | CN109032982A | 公开(公告)日: | 2018-12-18 |
发明(设计)人: | 张闯;陈继承;阚宏伟 | 申请(专利权)人: | 郑州云海信息技术有限公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38;G06F13/40;G06F13/42 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 罗满 |
地址: | 450018 河南省郑州市*** | 国省代码: | 河南;41 |
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摘要: | |||
搜索关键词: | 单独执行 数据处理 计算机可读存储介质 伸缩性 计算资源池 资源利用率 扩展性 标识信息 计算资源 内部总线 内存单元 唯一对应 运算单位 小粒度 组合本 维度 调度 申请 | ||
本发明实施例公开了一种数据处理方法、装置、设备、计算机可读存储介质、系统、FPGA板卡及其组合。其中,FPGA板卡包括通过内部总线相连的多个vFPGA单元;每个vFPGA单元均包括内存单元,且唯一对应一个标识信息;各vFPGA单元用于单独执行计算任务。本申请提供的技术方案的优点在于,将FPGA板卡以更小粒度划分为多个vFPGA单元,各vFPGA单元单独执行计算任务,即每个vFPGA单元为FPGA板卡上的最小运算单位,从而解决了FPGA板卡作为一个整体单位进行计算资源的划分和调度导致的资源无法充分的利用和发挥的弊端,有效的提升了FPGA板卡的资源利用率;FPGA板卡计算资源池化以更小维度进行,有利于提升整个系统的伸缩性和扩展性。
技术领域
本发明实施例涉及FPGA加速板卡技术领域,特别是涉及一种数据处理方法、装置、设备、系统、计算机可读存储介质、FPGA板卡及其组合。
背景技术
FPGA(Field-Programmable Gate Array,现场可编程门阵列)为在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物,是一种新型的异构计算平台加速器件,由可编程的逻辑块和互联网络组成,可在不同逻辑下执行多个线程,实现流水线并行处理,具有较强的并行处理能力。FPGA在大数据处理领域具有诸多优势,如采用流水线方式实现并行计算、低功耗、动态可重构等。
随着云计算、大数据的快速发展,在FPGA加速云中,FPGA板卡作为一个整体单位进行计算资源的划分和调度,当FPGA板卡有限,而需要调用的FPGA个数较多时,尽管每个FPGA板卡上的资源仍有剩余,但是FPGA为整体单位,导致FPGA计算资源得不到充分的利用和发挥,无法满足现实需求,整个系统的伸缩性和扩展性也较差。
发明内容
本发明实施例的目的是提供一种数据处理方法、装置、设备、系统、计算机可读存储介质、FPGA板卡及其组合,有效的提高了FPGA计算资源的利用率,提升了系统的伸缩性和扩展性。
为解决上述技术问题,本发明实施例提供以下技术方案:
本发明实施例一方面提供了一种FPGA板卡,包括通过内部总线相连的多个vFPGA单元;
每个vFPGA单元均包括内存单元,且唯一对应一个标识信息;
各vFPGA单元用于单独执行计算任务。
本发明实施例还提供了一种FPGA板卡组合,包括第一FPGA板卡和第二FPGA板卡;
所述第一FPGA板卡和所述第二FPGA板卡通过各自的MAC模块互联于网络,且通过各自MAC模块唯一对应的MAC地址进行识别,以实现板间数据的交互;
所述第一FPGA板卡和所述第二FPGA板卡均包括多个通过内部总线相连、用于单独执行计算任务的vFPGA单元;每个vFPGA单元均包括内存单元,且唯一对应一个标识信息。
可选的,所述第一FPGA板卡和第二FPGA板卡通过40G光纤网络光口互连。
本发明实施例另一方面提供了一种数据处理方法,基于FPGA板卡,包括:
获取FPGA板卡的MAC地址和各vFPGA的标识信息;
根据所述MAC地址判断待处理数据是否为所述FPGA板卡的数据;
若是,则根据各vFPGA的标识信息将所述待处理数据发送至所属的vFPGA进行数据处理;
若否,则将所述待处理处理发送至网络,以使相应的目标FPGA板卡对其进行数据处理;
其中,所述FPGA板卡包括多个通过内部总线相连、用于单独执行计算任务的vFPGA单元;每个vFPGA单元均包括内存单元,且唯一对应一个标识信息。
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