[发明专利]一种时钟信号发生系统及电子设备在审

专利信息
申请号: 201810877960.4 申请日: 2018-08-03
公开(公告)号: CN109062322A 公开(公告)日: 2018-12-21
发明(设计)人: 黄永俊;冀荣福 申请(专利权)人: 合肥联宝信息技术有限公司
主分类号: G06F1/06 分类号: G06F1/06
代理公司: 北京金信知识产权代理有限公司 11225 代理人: 刘锋;吴崇
地址: 230601 安徽省合肥市经*** 国省代码: 安徽;34
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摘要:
搜索关键词: 时钟模块 电子设备 显卡芯片 时钟信号发生系统 时钟信号 信号输出端 信号输入端 使能信号 时钟发生器 节约
【权利要求书】:

1.一种时钟信号发生系统,用于为电子设备的显卡芯片提供时钟信号,其特征在于,将所述电子设备的CPU的第一时钟模块作为时钟发生器,所述第一时钟模块的信号输出端与所述显卡芯片的第二时钟模块的信号输入端连接,当所述第一时钟模块接收到使能信号时,所述第一时钟模块向所述第二时钟模块发出时钟信号。

2.如权利要求1所述的时钟信号发生系统,其特征在于,还包括控制模块,所述控制模块与所述第一时钟模块的使能端连接,所述控制模块向所述第一时钟模块发送使能信号,以控制所述第一时钟模块开始向所述第二时钟模块发出时钟信号。

3.如权利要求2所述的时钟信号发生系统,其特征在于,还包括供电电源,所述供电电源为所述CPU和所述显卡芯片供电。

4.如权利要求3所述的时钟信号发生系统,其特征在于,所述供电电源还与所述控制模块连接,当所述供电电源为所述CPU和所述显卡芯片供电时,所述供电电源控制所述控制模块向所述第一时钟模块发送使能信号。

5.如权利要求4所述的时钟信号发生系统,其特征在于,所述控制模块包括MOS管,所述MOS管的源极接地,所述MOS管的漏极与所述第一时钟模块的使能端连接,所述MOS管的栅极与所述供电电源连接。

6.如权利要求5所述的时钟信号发生系统,其特征在于,所述MOS管的栅极与所述供电电源的指示信号端连接,当所述供电电源的输出电源稳定时,所述指示信号端向所述MOS管的栅极发出高电平信号。

7.如权利要求3所述的时钟信号发生系统,其特征在于,还包括放大器模块,所述第一时钟模块的输出端通过所述放大器模块与所述第二时钟模块的输入端连接。

8.如权利要求7所述的时钟信号发生系统,其特征在于,所述放大器模块包括差分输入单端输出放大器,所述第一时钟模块发出差分时钟信号,所述差分输入单端输出放大器将所述差分时钟信号转换为单端时钟信号,并发送至所述第二时钟模块。

9.如权利要求7所述的时钟信号发生系统,其特征在于,所述供电电源为所述放大器模块供电。

10.一种电子设备,其特征在于,包括CPU和显卡芯片,所述CPU的第一时钟模块的信号输出端与所述显卡芯片的第二时钟模块的信号输入端连接,当所述第一时钟模块接收到使能信号时,所述第一时钟模块向所述第二时钟模块发出时钟信号。

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