[发明专利]存储器管理方法以及存储控制器在审

专利信息
申请号: 201811001141.X 申请日: 2018-08-30
公开(公告)号: CN110874281A 公开(公告)日: 2020-03-10
发明(设计)人: 萧又华;张嘉维 申请(专利权)人: 深圳大心电子科技有限公司
主分类号: G06F11/10 分类号: G06F11/10
代理公司: 北京同立钧成知识产权代理有限公司 11205 代理人: 张晓霞;臧建明
地址: 518057 广东省深圳市南山*** 国省代码: 广东;44
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摘要:
搜索关键词: 存储器 管理 方法 以及 存储 控制器
【权利要求书】:

1.一种存储器管理方法,适用于可复写式非易失性存储器模块,其中所述非易失性存储器模块具有多个字线,并且每一所述多个字线由多个存储单元构成,其中所述多个存储单元中的每一个存储单元用以被程序化以存储对应不同的多个葛雷码的其中之一的比特值,所述方法包括:

读取目标字线,以获得原始数据,并且根据所述原始数据来识别对应所述目标字线的多个存储单元的多个原始葛雷码索引值;

对所述原始数据执行解码操作,以获得解码后数据,并且根据所述解码后数据来识别对应所述多个存储单元的多个解码后葛雷码索引值;

根据所述多个原始葛雷码索引值与所述多个解码后葛雷码索引值来计算对应所述多个存储单元的多个葛雷码绝对偏离值;以及

根据所述多个葛雷码绝对偏离值来识别所述多个存储单元中的一或多个异常存储单元,并且记录所述一或多个异常存储单元至异常存储单元表,其中所述一或多个异常存储单元的葛雷码绝对偏离值大于偏离门槛值。

2.根据权利要求1的存储器管理方法,其中所述不同的多个葛雷码依据第一顺序排列,其中

所述多个葛雷码所对应的多个葛雷码索引值用以表示所述多个葛雷码依据所述第一顺序所排列的顺序。

3.根据权利要求2的存储器管理方法,其中上述根据所述多个原始葛雷码索引值与所述多个解码后葛雷码索引值来计算对应所述多个存储单元的所述多个葛雷码绝对偏离值的步骤包括:

将所述多个原始葛雷码索引值与所述多个解码后葛雷码索引值之间的多个差值作为多个葛雷码偏离值;以及

将所述多个葛雷码偏离值的绝对值作为所述多个葛雷码绝对偏离值。

4.根据权利要求1的存储器管理方法,其中所述偏离门槛值为1,断路偏离门槛值为1,并且短路偏离门槛值为-1,

其中所述一或多个异常存储单元中具有断路现象的第一异常存储单元的葛雷码偏离值大于所述断路偏离门槛值,

其中所述一或多个异常存储单元中具有短路现象的第二异常存储单元的葛雷码偏离值小于所述短路偏离门槛值。

5.根据权利要求1的存储器管理方法,其中所述异常存储单元表包括:

第一栏位,其中所述第一栏位用以记录所述多个字线各自的异常存储单元的位置;以及

第二栏位,其中所述第二栏位用以记录所述多个字线各自的异常存储单元的总数。

6.一种存储控制器,用于控制配置有可复写式非易失性存储器模块的存储装置,其中所述非易失性存储器模块具有多个字线,并且每一所述多个字线由多个存储单元构成,其中所述多个存储单元中的每一个存储单元用以被程序化以存储对应不同的多个葛雷码的其中之一的比特值,所述存储控制器包括:

连接接口电路,用以耦接至主机系统;

存储器接口控制电路,用以耦接至所述可复写式非易失性存储器模块;

错误检查与校正电路,用以进行解码操作;

字线管理电路单元;以及

处理器,耦接至连接接口电路、所述存储器接口控制电路、所述错误检查与校正电路与所述字线管理电路单元,

其中所述处理器用以指示所述存储器接口控制电路读取目标字线,以获得原始数据,其中所述字线管理电路单元用以根据所述原始数据来识别对应所述目标字线的多个存储单元的多个原始葛雷码索引值,

其中所述处理器还用以指示所述错误检查与校正电路对所述原始数据执行所述解码操作,以获得解码后数据,其中所述字线管理电路单元还用以根据所述解码后数据来识别对应所述多个存储单元的多个解码后葛雷码索引值,

其中所述字线管理电路单元还用以根据所述多个原始葛雷码索引值与所述多个解码后葛雷码索引值来计算对应所述多个存储单元的多个葛雷码绝对偏离值,

其中所述字线管理电路单元还用以根据所述多个葛雷码绝对偏离值来识别所述多个存储单元中的一或多个异常存储单元,并且记录所述一或多个异常存储单元至异常存储单元表,其中所述一或多个异常存储单元的葛雷码绝对偏离值大于偏离门槛值。

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