[发明专利]一种适用于单相级联变换器的多维均压空间矢量调制方法有效
申请号: | 201811037372.6 | 申请日: | 2018-09-06 |
公开(公告)号: | CN109245663B | 公开(公告)日: | 2021-03-30 |
发明(设计)人: | 舒泽亮;林宏健;钱奕;闫晗;朱磊磊;柳明;何晓琼 | 申请(专利权)人: | 西南交通大学 |
主分类号: | H02P27/06 | 分类号: | H02P27/06;H02P21/14 |
代理公司: | 成都点睛专利代理事务所(普通合伙) 51232 | 代理人: | 葛启函 |
地址: | 610031 四*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 一种 适用于 单相 级联 变换器 多维 空间 矢量 调制 方法 | ||
1.一种适用于单相级联变换器的多维均压空间矢量调制方法,所述单相级联变换器中的AC-DC整流器包括n个级联的子模块,其中n为正整数;其特征在于,所述多维均压空间矢量调制方法包括如下步骤:
步骤一、将所述n个子模块的端口电压对应的标幺化值组成矢量,初始时刻将所述n个子模块的端口电压对应的标幺化值全设为0;
步骤二、将所述单相级联变换器的交流侧输出调制波作为参考矢量Vref,利用两个相邻矢量合成所述参考矢量Vref;将所述两个相邻矢量中电平值较大的一个定义为大矢量Vmax,将所述两个相邻矢量中电平值较小的一个定义为小矢量Vmin,所述大矢量Vmax的电平值kmax和小矢量Vmin的电平值kmin的计算方法如式(1):
其中floor为向下取整函数,V*ref为所述参考矢量Vref的标幺值;
当所述单相级联变换器的交流侧输出调制波大于所述单相级联变换器的三角载波时,将所述小矢量Vmin作为所述n个子模块的端口电压对应的标幺化值组成的矢量,小矢量Vmin作用时间为Tmin;
当所述单相级联变换器的交流侧输出调制波小于所述单相级联变换器的三角载波时,将所述大矢量Vmax作为所述n个子模块的端口电压对应的标幺化值组成的矢量,大矢量Vmax作用时间为Tmax;
则
Ts为一个调制周期;
步骤三、分别计算所述n个子模块的直流侧输出电压与平均电压的误差,所述平均电压为将所述n个子模块的直流侧输出电压之和除以n得到的电压值;
步骤四、将步骤三中得到的所述n个子模块的误差取绝对值后按从大到小的顺序进行排列;
步骤五、按照步骤四排列的顺序,从误差绝对值最大的子模块开始均压,直到将误差绝对值最小的子模块均压后完成一个调制周期内的模块间均压,并返回步骤三进行下一个调制周期内的模块间均压;
将误差取绝对值为第i大的子模块定义为第i个子模块,前n-1个子模块中对第i个子模块进行均压的具体方法为:
首先判断该调制周期内未进行模块间均压时所述n个子模块的总端口电平与所述小矢量Vmin的电平值kmin的关系,
当该调制周期内未进行模块间均压时所述n个子模块的总端口电平等于所述小矢量Vmin的电平值kmin时,若第i个子模块的直流侧输出电压Vdci大于平均电压Vave,且所述单相级联逆变器的输入电流小于0,或第i个子模块的直流侧输出电压Vdci小于平均电压Vave,且所述单相级联逆变器的输入电流大于0,将第i个子模块的端口电平Qi增大一个单位电压值;
当该调制周期内未进行模块间均压时所述n个子模块的总端口电平不等于所述小矢量Vmin的电平值kmin时,若第i个子模块的直流侧输出电压Vdci大于平均电压Vave,且所述单相级联逆变器的输入电流大于0,或第i个子模块的直流侧输出电压Vdci小于平均电压Vave,且所述单相级联逆变器的输入电流小于0,将第i个子模块的端口电平Qi减小一个单位电压值;
否则将第i个子模块的端口电平Qi保持不变;
在对第i个子模块进行均压时,所述第i个子模块的端口电平Qi需满足式(3):
max[k-2(n-i)-Q1-Q2-...-Qi-1,-2]≤Qi≤min[k+2(n-i)-Q1-Q2-...-Qi-1,2] (3)
其中max为取最大值函数,min为取最小值函数,k为将所述第i个子模块进行均压后的所述n个子模块的总端口电平;
对第n个子模块的均压方法为:
首先判断该调制周期内未进行模块间均压时所述n个子模块的总端口电平与所述参考矢量的标幺值为V*ref的关系,当所述n个子模块的总端口电平大于所述参考矢量的标幺值为V*ref时,将所述小矢量Vmin的电平值kmin减去前n-1个子模块经过均压之后的端口电平作为第n个子模块的目标端口电平,当该调制周期内未进行模块间均压时所述n个子模块的总端口电平不大于所述参考矢量的标幺值为V*ref时,将所述大矢量Vmax的电平值kmax减去前n-1个子模块经过均压之后的端口电平作为第n个子模块的目标端口电平;随后对所述第n个子模块未均压时的端口电平进行处理使得第n个子模块均压之后的端口电平等于所述第n个子模块的目标端口电平。
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