[发明专利]LDPC根据闪存组件错误率调变核编译码速率的方法有效
| 申请号： | 201811247400.7 | 申请日： | 2018-10-24 |
| 公开（公告）号： | CN109379087B | 公开（公告）日： | 2022-03-29 |
| 发明（设计）人： | 陈育鸣;李庭育;洪振洲;魏智汎 | 申请（专利权）人： | 江苏华存电子科技有限公司 |
| 主分类号： | H03M13/11 | 分类号： | H03M13/11 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 226300 江苏*** | 国省代码： | 江苏;32 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | |||
| 搜索关键词： | ldpc 根据 闪存 组件 错误率 调变核编 译码 速率 方法 | ||
【权利要求书】：
1.一种LDPC根据闪存组件错误率调变核编译码速率的方法，其特征在于：包括以下步骤：
步骤一：在主控芯片内部的低密度奇偶校验控制器内配置多组不同运算矩阵与运算序列；
步骤二：利用系统软件程序或硬件自动管理执行和检查码字译码信号；
步骤三：依照实际运作状况，配合数据组件控制器运作挑选对应的矩阵来做运算，在错误位数低的需求下使用行权重低的矩阵，在错误位高的需求下使用行权重高的矩阵；
所述步骤一中主控芯片内部设置有低密度奇偶校验控制器及数据组件控制器；
所述低密度奇偶校验控制器内部设置有校验位产生单元及检查纠错单元，所述校验位产生单元配置有若干生成矩阵，所述检查纠错单元配置有若干校验矩阵；
所述数据组件控制器内部配置有若干数据组件。
下载完整专利技术内容需要扣除积分，VIP会员可以免费下载。
该专利技术资料仅供研究查看技术是否侵权等信息，商用须获得专利权人授权。该专利全部权利属于江苏华存电子科技有限公司，未经江苏华存电子科技有限公司许可，擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作，请联系【客服】
本文链接：http://www.vipzhuanli.com/pat/books/201811247400.7/1.html，转载请声明来源钻瓜专利网。
- 同类专利
- 专利分类
