[发明专利]一种智能茶艺机AI芯片版图设计方法在审

专利信息
申请号: 201811254607.7 申请日: 2018-10-25
公开(公告)号: CN109376431A 公开(公告)日: 2019-02-22
发明(设计)人: 宋玉玺 申请(专利权)人: 烟台市奥境数字科技有限公司
主分类号: G06F17/50 分类号: G06F17/50
代理公司: 北京金硕果知识产权代理事务所(普通合伙) 11259 代理人: 李丹凤
地址: 264000 山东省烟台市莱山*** 国省代码: 山东;37
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摘要:
搜索关键词: 芯片版图 智能 布线设计 芯片 集成电路模块 布局设计 初始种群 电路布图 迭代策略 迭代算法 规划布局 时序收敛 遗传算法 优化目标 交互性 启发式 自适应 布线 多块 连线 网表 走线 试探 搜索 检查
【说明书】:

发明公开了一种智能茶艺机AI芯片版图设计方法。主要包括:A.首先规划布局布线设计的原则和方向,减少布线面积,对门级网表进行时序收敛性检查;B.将集成电路模块看作遗传算法中的初始种群,以布局面积为优化目标对智能茶艺机AI芯片进行布局设计;C.利用路径试探搜索来确定元件之间的连线,通过启发式迭代算法对智能茶艺机AI芯片进行布线设计;D.通过智能茶艺机AI芯片版图多块划分降低电路布图的复杂性,完成智能茶艺机AI芯片版图设计。该方法具有较好的交互性和合理性,运用自适应迭代策略,减少设计的重复性和降低复杂性,布线速度快,布局合理,走线归整有序。

技术领域

本发明涉及一种智能茶艺机AI芯片版图设计方法,属于集成电路设计、数学、物理领域。

背景技术

随着智能家居的发展,智能茶艺机受到越来越多喜欢饮茶人士的喜爱。智能茶艺机可以智能定制,数据化调配,智能温控,自动上水,洗杯,消毒等,这些功能全是由内部人工智能芯片所控制,因此,如何设计一款集成电路版图良好的芯片显得尤为重要。随着集成电路工艺制造复杂的多层结构和元器件多样性发展,一些集成电路达不到设计要求。现有的集成电路版图设计计算复杂度高、难度较大,布线速度较慢且面积大,使得芯片的面积较大,交互性差。

发明内容

为解决上述问题,本发明的目的在于提供一种具有较好的交互性和合理性的智能茶艺机AI芯片版图设计方法,运用自适应迭代策略,减少设计的重复性和降低复杂性,布线速度快,布局合理,走线归整有序。

本发明解决其问题所采用的技术方案,包括以下步骤:

A.首先规划布局布线设计的原则和方向,减少布线面积,对门级网表进行时序收敛性检查;

B.将集成电路模块看作遗传算法中的初始种群,以布局面积为优化目标对智能茶艺机AI芯片进行布局设计;

C.利用路径试探搜索来确定元件之间的连线,通过启发式迭代算法对智能茶艺机AI芯片进行布线设计;

D.通过智能茶艺机AI芯片版图多块划分降低电路布图的复杂性,完成智能茶艺机AI芯片版图设计。

本发明的有益效果是:

在集成电路版图设计难度越来越大的情况下,本发明具有较好的交互性和合理性,运用自适应迭代策略,减少设计的重复性和降低复杂性,布线速度快,布局合理,走线归整有序。

附图说明

图1一种智能茶艺机AI芯片版图设计方法的整体流程图。

图2智能茶艺机AI芯片布局设计流程图。

图3布线设计结构图。

具体实施方式

参照图1至图3,本发明所述的方法包括以下步骤:

A.首先规划布局布线设计的原则和方向,减少布线面积,对门级网表进行时序收敛性检查;

智能茶艺机AI芯片中所含的基本元素有元件和连线,连线面积占比很大,因此需要提前规划布线的原则和方向,减少布线面积,从而减少芯片的大小。在布局前对输入门级网表进行时序收敛性检查,从而判定门级网表能否与布局布线设计流程连续收敛。若差别较大,则需对门级网表进行分析并优化,否则将影响后面的布局布线设计。

①门级网表检查:利用用户的时间约束文件,无布局布线干扰的检查门级网表的时序信息;

②网表优化:利用优化工具实现门级网表对布局布线的连续时序传递。

B.将集成电路模块看作遗传算法中的初始种群,以布局面积为优化目标对智能茶艺机AI芯片进行布局设计(如图2);

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