[发明专利]一种三维存储器件及其制备方法有效
申请号: | 201811260872.6 | 申请日: | 2018-10-26 |
公开(公告)号: | CN109461740B | 公开(公告)日: | 2021-02-02 |
发明(设计)人: | 王启光 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11578 | 分类号: | H01L27/11578 |
代理公司: | 北京派特恩知识产权代理有限公司 11270 | 代理人: | 王亮;张颖玲 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 一种 三维 存储 器件 及其 制备 方法 | ||
本发明公开了一种三维存储器件的制备方法,所述方法包括以下步骤:提供基底结构,所述基底结构包括交替堆叠的金属栅极和第一材料层;去除所述金属栅极之间的第一材料层,形成金属栅极层间沟槽;形成保护层,所述保护层至少填充所述金属栅极层间沟槽的端部,且所述保护层使得所述金属栅极层间沟槽内部保留有气隙。
技术领域
本发明涉及存储器件技术领域,尤其涉及一种三维存储器件及其制备方法。
背景技术
存储器(Memory)是现代信息技术中用于保存信息的记忆设备。随着各类电子设备对集成度和数据存储密度的需求的不断提高,普通的二维存储器件越来越难以满足要求,在这种情况下,三维(3D)存储器件应运而生。
三维存储器件由于具有较高的存储密度、可控的生产成本、合适的编擦速度及保持特性,已经成为非易失存储市场中的主流产品。通常,三维存储器件结构可以包括在竖直方向上排列的多层金属栅极,所述金属栅极之间通过SiO2介质层隔开。然而,为了提高存储密度,三维存储器件中的金属栅极叠层数目越来越多,排布越来越多密集,随之而来的,金属栅极之间的SiO2介质层厚度需要适当减薄以减少应力影响。如此,由于金属栅极间距减小、金属栅极之间的SiO2介质层变薄,金属栅极之间的寄生电容值必然增大,这将直接导致RC延迟效应明显,最终使得存储器件响应速度下降。
由此可见,如何改善三维存储器件中金属栅极间的RC延迟效应,提高器件的整体性能,成为本领域现阶段亟需解决的技术问题。
发明内容
有鉴于此,本发明的主要目的在于提供一种三维存储器件及其制备方法。
为达到上述目的,本发明的技术方案是这样实现的:
本发明实施例提供了一种三维存储器件的制备方法,所述方法包括以下步骤:
提供基底结构,所述基底结构包括交替堆叠的金属栅极和第一材料层;
去除所述金属栅极之间的第一材料层,形成金属栅极层间沟槽;
形成保护层,所述保护层至少填充所述金属栅极层间沟槽的端部,且所述保护层使得所述金属栅极层间沟槽内部保留有气隙。
上述方案中,所述保护层覆盖所述金属栅极层间沟槽的端部之外的区域,所述保护层未填满所述区域因而在所述区域形成所述气隙。
上述方案中,所述保护层覆盖最顶层所述金属栅极。
上述方案中,所述提供基底结构的步骤具体包括:
提供半导体衬底,在所述半导体衬底上形成由第一材料层和第二材料层交替堆叠的叠层结构;
刻蚀所述叠层结构,形成栅线隔槽,所述栅线隔槽暴露所述半导体衬底的上表面;
去除所述第二材料层,形成栅极沟槽;
在所述栅极沟槽中执行金属栅极填充,形成包括交替堆叠的金属栅极和第一材料层的所述基底结构。
上述方案中,所述去除金属栅极之间的第一材料层具体包括:
去除次底层所述金属栅极以上的第一材料层,最底层所述金属栅极与次底层所述金属栅极之间的第一材料层予以保留。
上述方案中,形成所述保护层的方法包括:
沿所述栅线隔槽的侧壁沉积保护层,所述保护层至少覆盖所述基底结构的表面,且所述保护层至少覆盖在所述金属栅极的朝向所述栅线隔槽的侧壁处以及所述金属栅极层间沟槽的朝向所述栅线隔槽的端部。
上述方案中,所述保护层材料包括二氧化硅。
上述方案中,采用化学气相沉积工艺沉积所述保护层;
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的