[发明专利]一种优化沟槽的肖特基结势磊二极管及其制作方法在审
申请号: | 201811270466.8 | 申请日: | 2018-10-29 |
公开(公告)号: | CN109087858A | 公开(公告)日: | 2018-12-25 |
发明(设计)人: | 张振中;郝建勇;和巍巍;汪之涵;孙军 | 申请(专利权)人: | 深圳基本半导体有限公司 |
主分类号: | H01L21/329 | 分类号: | H01L21/329;H01L29/872 |
代理公司: | 深圳新创友知识产权代理有限公司 44223 | 代理人: | 徐罗艳 |
地址: | 518000 广东省深圳市南山区*** | 国省代码: | 广东;44 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | |||
搜索关键词: | 二极管 肖特基结 上表面 沉积 制作 产品加工周期 产品制造成本 干法刻蚀工艺 湿法腐蚀 湿法刻蚀 工艺流程 掺杂区 光罩 刻蚀 去胶 涂胶 显影 优化 掺杂 曝光 | ||
1.一种优化沟槽的肖特基结势磊二极管,包括SiC基体(10)以及SiC基体上表面的沟槽P型离子注入掺杂区(20),其特征在于:所述SiC基体的上表面除所述沟槽P型离子注入掺杂区(20)所在位置以外,其它部分覆盖有第一SiO2薄膜层(31)和第二SiO2薄膜层(32);其中,所述第二SiO2薄膜层(32)位于所述第一SiO2薄膜层(31)之上,并且所述第二SiO2薄膜层(32)的面积小于所述第一SiO2薄膜层(31)的面积,使得所述第二SiO2薄膜层(32)和所述第一SiO2薄膜层(31)形成台阶。
2.如权利要求1所述的肖特基结势磊二极管,其特征在于:在所述SiC基体(10)的上表面边缘,所述第二SiO2薄膜层(32)和所述第一SiO2薄膜层(31)齐平;在靠近所述沟槽P型离子注入掺杂区(20)的边缘之处,所述第二SiO2薄膜层(32)与所述第一SiO2薄膜层(31)形成所述台阶。
3.如权利要求2所述的肖特基结势磊二极管,其特征在于:所述第二SiO2薄膜层(32)的厚度大于所述第一SiO2薄膜层(31)的厚度。
4.一种如权利要求1至3任一项所述的肖特基结势磊二极管的制作方法,其特征在于,包括如下步骤:
S1、提供一SiC基体,该SiC基体的上表面具有沟槽;
S2、在所述SiC基体的上表面除所述沟槽以外的其它部分依次沉积含硼的第一SiO2薄膜层、含磷的第二SiO2薄膜层;
S3、采用湿法刻蚀对所述第一SiO2薄膜层和所述第二SiO2薄膜层进行刻蚀,以形成所述台阶;
S4、对所述沟槽进行P型离子注入掺杂,形成所述沟槽P型离子注入掺杂区。
5.如权利要求4所述的肖特基结势磊二极管的制作方法,其特征在于:在步骤S3中,从靠近所述沟槽的位置开始进行刻蚀,并且根据刻蚀液对所述第一SiO2薄膜层和所述第二SiO2薄膜层的腐蚀速率的不同形成所述台阶。
6.如权利要求4所述的肖特基结势磊二极管的制作方法,其特征在于:步骤S2中沉积SiO2薄膜层的方法包括氧化生长法、化学气相沉积法、电子束蒸发法或射频磁控溅射法。
7.如权利要求4所述的肖特基结势磊二极管的制作方法,其特征在于:步骤S2中采用LPCVD工艺沉积含硼的第一SiO2薄膜层和含磷的第二SiO2薄膜层。
8.如权利要求4所述的肖特基结势磊二极管的制作方法,其特征在于:在所述第一SiO2薄膜层中,硼的含量为5~15wt%;在所述第二SiO2薄膜层中,磷的含量为2~10wt%。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于深圳基本半导体有限公司,未经深圳基本半导体有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
本文链接:http://www.vipzhuanli.com/pat/books/201811270466.8/1.html,转载请声明来源钻瓜专利网。
- 上一篇:一种GPP芯片的制作工艺
- 下一篇:一种半导体器件的制造方法
- 同类专利
- 专利分类
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造