[发明专利]一种综合接口控制设备及星载综合电子系统有效

专利信息
申请号: 201811392208.7 申请日: 2018-11-21
公开(公告)号: CN109542063B 公开(公告)日: 2020-10-16
发明(设计)人: 刘博;王豪;郭黎烨;程利甫;李小磊 申请(专利权)人: 上海航天计算机技术研究所
主分类号: G05B19/418 分类号: G05B19/418
代理公司: 上海汉声知识产权代理有限公司 31236 代理人: 胡晶
地址: 201108 *** 国省代码: 上海;31
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摘要:
搜索关键词: 一种 综合 接口 控制 设备 电子 系统
【权利要求书】:

1.一种综合接口控制设备,其特征在于,应用于星载综合电子系统,作为所述星载综合电子系统的综合电子管理单元和所述星载综合电子系统中的各单机数据交互的中转接口,包括:

母板;

综合处理模块,设于所述母板上,所述综合处理模块被配置为接收所述综合电子管理单元发送的遥控指令包以及遥测采集指令包,所述遥控指令包包括程控指令包,所述综合处理模块被配置为根据所述程控指令包以路由选通的方式向所述单机发送程控指令或OC指令;所述综合处理模块还被配置为接收所述单机的遥测信息,响应于所述遥测采集指令包,所述综合处理模块将各所述单机的所述遥测信息打包成遥测信息包发送至所述综合电子管理单元;

配电模块,被配置为对各所述单机进行配电控制和大电流的指令驱动控制,所述综合处理模块还被配置为所述程控指令包解析后向所述配电模块发送所述OC指令;

电源模块,所述配电模块还对所述电源模块进行供电,所述电源模块对所述母板提供工作电源;

其中,所述程控指令包由包头和数据区构成,所述包头含有下一级模块或单机的路由信息和数据域的字节长度信息,所述数据区中包含指令发送延时信息和功能识别信息以及指令数据,所述综合处理模块依次识别包头信息、数据区中的延时信息和功能识别信息后,将程控指令包按各单机标识分别存入数据缓存芯片中,并按预设的时延路由分发指令包至设备中各功能模块或通过串口发送至各单机,实现程控指令包二次转发的功能。

2.如权利要求1所述的综合接口控制设备,其特征在于,所述综合处理模块包括:

第一串口通信单元、第二串口通信单元、FPGA芯片、指令驱动芯片、数据缓存芯片;

其中,

所述遥控指令包以及所述遥测采集指令包经所述第一串口通信单元发送至所述FPGA芯片;所述FPGA芯片被配置为解析所述程控指令包,并根据各所述单机的标识以路由选通的方式向所述第二串口通信单元发送解析出的所述程控指令,所述第二串口通信单元将所述程控指令发送至各所述单机;

所述FPGA芯片还被配置为解析所述程控指令包,并选通所述指令驱动芯片发送解析出的所述OC指令,所述指令驱动芯片还将所述OC指令发送至所述配电模块;

所述第二串口通信单元被配置为接收各所述单机的遥测信息,并发送至所述FPGA芯片,所述数据缓存芯片被配置为缓存所述FPGA芯片接收的所述遥测信息;

所述FPGA芯片还被配置为响应于所述遥测采集指令包,将所述数据缓存芯片中缓存的所述遥测信息打包成所述遥测信息包发送至所述综合电子管理单元;

所述FPGA芯片还被配置为响应于所述遥测信息包发送至所述综合电子管理单元,所述FPGA芯片向所述第二串口通信单元发送所述遥测采集指令包中的遥测采集指令,所述第二串口通信单元向各所述单机转所述遥测采集指令。

3.如权利要求2所述的综合接口控制设备,其特征在于,所述配电模块包括若干继电器和NMOS管,所述继电器用于对所述单机的配电输出,所述NMOS管用于提供大电流的指令驱动,所述FPGA芯片还被配置为根据所述程控指令包功能识别码选通指令驱动芯片向所述继电器或所述NMOS管发送所述OC指令,所述OC指令用于控制所述继电器的通断。

4.如权利要求3所述的综合接口控制设备,其特征在于,所述综合处理模块还包括A/D转换芯片,所述A/D转换芯片连接有若干模拟门,所述FPGA芯片还被配置为控制所述模拟门的选通;

所述模拟门用于接收所述单机发送的模拟量形式的所述遥测信息。

5.如权利要求2所述的综合接口控制设备,其特征在于,所述第一串口通信单元包括第一串口接收芯片以及第一串口发送芯片;所述第二串口通信单元包括第二串口接收芯片以及第二串口发送芯片。

6.一种星载综合电子系统,其特征在于,包括权利要求1-5任意一项所述的综合接口控制设备。

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