[发明专利]通用串行总线控制电路有效
申请号: | 201811502581.3 | 申请日: | 2018-12-10 |
公开(公告)号: | CN111290981B | 公开(公告)日: | 2021-06-18 |
发明(设计)人: | 陈力辅 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40 |
代理公司: | 北京康信知识产权代理有限责任公司 11240 | 代理人: | 梁丽超;刘丹 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 通用 串行 总线 控制电路 | ||
1.一种控制电路,应用于一通用串行总线,该通用串行总线包含一第一通道配置接脚及一第二通道配置接脚,该控制电路包含:
一第一晶体管,具有一第一控制端;
一第一电阻群,耦接该第一通道配置接脚及该第一晶体管;
一第一肖特基二极管,具有一第一端及一第二端,该第一端耦接该第一控制端;
一第二晶体管,具有一第二控制端;
一第二电阻群,耦接该第二通道配置接脚及该第二晶体管;以及
一第二肖特基二极管,具有一第三端及一第四端,该第三端耦接该第二控制端,该第四端耦接该第一肖特基二极管的该第二端。
2.根据权利要求1所述的控制电路,其中该第一电阻群包含:
一第一电阻,耦接于该第一通道配置接脚与该第一控制端之间;
一第二电阻,耦接于该第一控制端与一参考电压之间;以及
一第三电阻,耦接于该第一通道配置接脚与该第一晶体管之间。
3.根据权利要求2所述的控制电路,其中该第二电阻群包含:
一第四电阻,耦接于该第二通道配置接脚与该第二控制端之间;
一第五电阻,耦接于该第二控制端与该参考电压之间;以及
一第六电阻,耦接于该第二通道配置接脚与该第二晶体管之间。
4.一种控制电路,应用于一通用串行总线,该通用串行总线包含一第一通道配置接脚及一第二通道配置接脚,该控制电路包含:
一第一晶体管,具有一第一控制端;
一第一电阻群,耦接该第一通道配置接脚及该第一晶体管;
一第三晶体管,具有一第一端及一第二端,该第一端耦接该第一控制端;
一第二晶体管,具有一第二控制端;
一第二电阻群,耦接该第二通道配置接脚及该第二晶体管;
一第四晶体管,具有一第三端及一第四端,该第三端耦接该第二控制端,该第四端耦接该第三晶体管的该第二端;以及
一偏压电路,耦接该第一通道配置接脚、该第二通道配置接脚、该第三晶体管的该第二端以及该第四晶体管的该第四端,用来根据该第一通道配置接脚及/或该第二通道配置接脚的电压提供一偏压至该第三晶体管的该第二端以及该第四晶体管的该第四端。
5.根据权利要求4所述的控制电路,其中该第一电阻群包含:
一第一电阻,耦接于该第一通道配置接脚与该第一控制端之间;
一第二电阻,耦接于该第一控制端与一参考电压之间;以及
一第三电阻,耦接于该第一通道配置接脚与该第一晶体管之间。
6.根据权利要求5所述的控制电路,其中该第二电阻群包含:
一第四电阻,耦接于该第二通道配置接脚与该第二控制端之间;
一第五电阻,耦接于该第二控制端与该参考电压之间;以及
一第六电阻,耦接于该第二通道配置接脚与该第二晶体管之间。
7.根据权利要求4所述的控制电路,其中该第一晶体管为N型金属氧化物半导体场效应晶体管且其源极接地。
8.根据权利要求4所述的控制电路,其中该偏压电路包含:
一电阻,耦接该第三晶体管的该第二端以及该第四晶体管的该第四端;
一第一二极管,耦接于该第一通道配置接脚与该电阻之间;以及
一第二二极管,耦接于该第二通道配置接脚与该电阻之间。
9.根据权利要求4所述的控制电路,其中该偏压电路包含:
一电阻,耦接该第三晶体管的该第二端以及该第四晶体管的该第四端;
一第五晶体管,耦接于该第一通道配置接脚与该电阻之间;以及
一第六晶体管,耦接于该第二通道配置接脚与该电阻之间;
其中该第五晶体管的栅极耦接该第六晶体管的漏极,以及该第六晶体管的栅极耦接该第五晶体管的漏极。
10.根据权利要求4至9中任一项所述的控制电路,其中该第三晶体管为空乏型金属氧化物半导体场效应晶体管,且其栅极接地。
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