[发明专利]一种实现数据同步的装置和方法有效
申请号: | 201811564486.6 | 申请日: | 2018-12-20 |
公开(公告)号: | CN111355484B | 公开(公告)日: | 2023-09-05 |
发明(设计)人: | 李鹏 | 申请(专利权)人: | 深圳市中兴微电子技术有限公司 |
主分类号: | H03L7/06 | 分类号: | H03L7/06;H04B7/0413 |
代理公司: | 北京天昊联合知识产权代理有限公司 11112 | 代理人: | 姜春咸;冯建基 |
地址: | 518055 广东省深*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 实现 数据 同步 装置 方法 | ||
1.一种实现数据同步的装置,其特征在于,包括:
多射频芯片间同步电路,和/或,单芯片内多通道同步电路;
其中,所述多射频芯片间同步电路,用于实现多个射频芯片间的工作时钟同步;
所述单芯片内多通道同步电路,用于实现单芯片内多个通道的数据同步;
其中,所述多射频芯片间同步电路,包括:
锁相环电路,用于接收参考时钟信号,以及输出频率是所述参考时钟信号频率n倍的高频信号,n大于或等于2;
分频器电路,用于对锁相环电路输出的高频信号分频,得到芯片所需频率的工作时钟信号;
相位差计算电路,用于比较所述参考时钟信号和所述工作时钟信号的延时差;
相位同步控制电路,用于将所述延时差与预设延迟阈值比较,若延时差大于所述预设延迟阈值,控制锁相环电路调整输出的高频信号相位。
2.根据权利要求1所述的实现数据同步的装置,其特征在于,所述相位差计算电路,用于比较所述参考时钟信号和所述工作时钟信号的延时差,包括:
采用所述锁相环电路输出的高频信号采样所述参考时钟信号和所述工作时钟信号的相位差,得到参考时钟沿与工作时钟沿之间的最小差值后,将这一差值乘以用于采样的所述高频信号的时钟周期即得到所述参考时钟信号和所述工作时钟信号的延时差。
3.根据权利要求1或2所述的实现数据同步的装置,其特征在于,
所述单芯片内多通道同步电路针对每个通道设置:
第一同步单元,用于通过第一同步信号使多个通道抽取的数据保持一致;
第二同步单元,用于在数据从第一同步单元传输到第二同步单元时,使各通道同时读取数据;
第三同步单元,用于在数据从第二同步单元传输到第三同步单元时,使各通道同时读取数据。
4.根据权利要求3所述的实现数据同步的装置,其特征在于,
所述第二同步单元、第三同步单元,用于使各通道同时读取数据,包括:
将数据写入双端口随机存储器RAM中,通过第二同步信号使各通道在同一时刻读取所述RAM中的数据。
5.一种实现数据同步的方法,其特征在于,包括:
实现多个射频芯片间的工作时钟同步;和/或
实现单芯片内多个通道的数据同步;
其中,所述实现多个射频芯片间的工作时钟同步,包括:
接收参考时钟信号,以及输出频率是所述参考时钟信号频率n倍的高频信号,n大于或等于2;
对所述高频信号分频,得到芯片所需频率的工作时钟信号;
比较所述参考时钟信号和所述工作时钟信号的延时差,若延时差大于预设延迟阈值,调整输出的高频信号相位。
6.根据权利要求5所述的实现数据同步的方法,其特征在于,所述比较所述参考时钟信号和所述工作时钟信号的延时差,包括:
采用所述高频信号采样所述参考时钟信号和所述工作时钟信号的相位差,得到参考时钟沿与工作时钟沿之间的最小差值后,将这一差值乘以用于采样的所述高频信号的时钟周期即得到所述参考时钟信号和所述工作时钟信号的延时差。
7.根据权利要求5或6所述的实现数据同步的方法,其特征在于,所述实现单芯片内多个通道的数据同步,包括:
通过第一同步信号使多个通道抽取的数据保持一致;
在所述抽取的数据传输过程中,使各通道同时读取所述数据。
8.根据权利要求7所述的实现数据同步的方法,其特征在于,在所述抽取的数据传输过程中,使各通道同时读取所述数据,包括:
将数据写入双端口随机存储器RAM中,通过第二同步信号使各通道在同一时刻读取所述RAM中的数据。
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