[实用新型]基于PCIE与FPGA结合的多核JTAG调试代理系统有效
申请号: | 201820605360.8 | 申请日: | 2018-04-25 |
公开(公告)号: | CN208596371U | 公开(公告)日: | 2019-03-12 |
发明(设计)人: | 胡晓磊;金予 | 申请(专利权)人: | 北京化工大学 |
主分类号: | G06F11/26 | 分类号: | G06F11/26;G06F15/78 |
代理公司: | 北京细软智谷知识产权代理有限责任公司 11471 | 代理人: | 刘静荣 |
地址: | 100020 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 本实用新型 代理系统 目标机 多核 发送 调试指令 接收模块 驱动程序 依次相连 上位机 宿主机 传输 配合 保证 | ||
1.基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,包括:依次相连的宿主机、JTAG仿真器、目标机,JTAG仿真器包括:
PICEIP核,与宿主机相连;
发送接收模块,与PICE IP核相连,用于传递数据和指令;BRAM模块,用于存储数据;
Process模块,用于对BRAM模块的数据进行处理及JTAG指令转换,并且Process模块还包括多核选择调试接口模块和多核JTAG控制器,其中多核JTAG控制器与目标机相连;
Control模块,用于控制Process模块及发送接收模块对BRAM模块的读写;
FPGA电路单元,用于对JTAG仿真器进行编程;
PCIE接口,通过PCIEIP核与宿主机连接。
2.根据权利要求1所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,发送接收模块包括:
TX模块,提取的BRAM模块的数据和指令经TX模块传递给PICE IP核;
RX模块,PICE IP核接收的数据和指令经RX模块传递给BRAM模块进行储存。
3.根据权利要求1所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,宿主机包括:
基于ECLIPSE的CDT插件的开发环境,用于用户编写调试程序,下载调试程序及调试程序操作;
编译器,用于将源文件编译为可执行文件并翻译为汇编语言;
调试器,能够基于所述的可执行文件通过调试代理经JTAG仿真器向目标机发送指令并接受数据。
4.根据权利要求1所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,宿主机还包括GDB模块,其用于接受指令并向下位机下发GDB指令;与GDB模块对应的设有调试代理模块,其用于接受所述的GDB指令并转化其指令为JTAG指令。
5.根据权利要求4所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,调试代理模块包括本地单元和PICE单元,其中,本地单元与GDB建立连接,用于接受GDB指令、解析、校验;PCIE单元用于负责接受、缓存调试指令,转化为JTAG指令发送到目标机。
6.根据权利要求5所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,所述的本地单元调试代理通过建立四个并行的线程等待宿主机调用,并且各线程间同时刻只容许一个线程在线调试,当该线程结束调试或调试挂起状态时,其它线程才可处于运行状态,PCIE单元调试代理通过JTAG菊花链连接多核选择调试接口的方式并配合本地单元调试代理实现多核并行调试。
7.根据权利要求1所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,宿主机与JTAG仿真器基于PICE层结构进行数据传输,PICE层结构包括:
事务层,能够根据来自应用层和应用程序的信息组建事务层包,等待推向下层;
数据链路层,在事务层包上再连接若干序号和CRC校验附加信息,形成数据链路层包;
物理层,在数据链路层包上添加起始帧字符和结束帧字符;
应用层,能够为事务层启动事务,生成事务层提供所必须的信息。
8.根据权利要求7所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,物理层主要由逻辑物理层和电气物理层组成,其中,逻辑物理层与数据链路层直接相连;电气物理层为物理层与链路的模拟接口,由各通路差分信号的驱动器和接收器组成。
9.根据权利要求7所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,应用层提供的所述的信息包括:事务类型、地址、要传送的数据量、数据、传输类别和消息索引。
10.根据权利要求7所述的一种基于PCIE与FPGA结合的多核JTAG调试代理系统,其特征在于,事务层按照数据传输方向分为发送和接受两部分,分别负责组建事务层包和拆解事务层包。
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