[实用新型]一种集成操作箱功能的涌流抑制装置有效

专利信息
申请号: 201820752464.1 申请日: 2018-05-21
公开(公告)号: CN208782466U 公开(公告)日: 2019-04-23
发明(设计)人: 许学芳;丁俊健;胡恩俊;罗铭 申请(专利权)人: 南京国电南自维美德自动化有限公司
主分类号: H02H7/26 分类号: H02H7/26
代理公司: 南京纵横知识产权代理有限公司 32224 代理人: 董建林
地址: 210032 江苏*** 国省代码: 江苏;32
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摘要:
搜索关键词: 主板 涌流抑制装置 模件 控制芯片 操作箱 管理芯片 高性能处理器 本实用新型 高速处理器 控制和通信 一体化设计 操作回路 高速串口 模件连接 双CPU 智能 融入
【权利要求书】:

1.一种集成操作箱功能的涌流抑制装置,其特征是,包括主板、BLVDS总线、AC模件、DI模件、DO模件,所述主板通过BLVDS总线分别与AC模件、DI模件和DO模件连接;

所述主板主要包括两个CPU芯片和主板FPGA芯片,其中两个CPU芯片分别为控制芯片和管理芯片,所述管理芯片通过高速串口与控制芯片连接,所述控制芯片与主板FPGA芯片连接后连接到BLVDS总线。

2.根据权利要求1所述的一种集成操作箱功能的涌流抑制装置,其特征是,所述控制芯片和管理芯片均采用基于ARM Cortex-A8的AM3352分别用于保护控制和实现MMI、规约通信,所述主板FPGA芯片采用EP4CE10F256,实现控制芯片同BLVDS总线上其它各模件间的数据交换。

3.根据权利要求1所述的一种集成操作箱功能的涌流抑制装置,其特征是,所述控制芯片和管理芯片的串行线上串接匹配电阻用于提高信号质量。

4.根据权利要求1所述的一种集成操作箱功能的涌流抑制装置,其特征是,所述AC模件主要由8通道并行AD转换芯片ADS8548、AC模件FPGA芯片M2S00A、电压互感器以及电流互感器组成,ADS8548的输入端分别与电源侧电压互感器和受控侧电流互感器连接,ADS8548的输出端连接到AC模件FPGA芯片M2S00A,M2S00A通过BLVDS总线与主板FPGA芯片连接。

5.根据权利要求1所述的一种集成操作箱功能的涌流抑制装置,其特征是,所述DI模件主要由DI模件FPGA芯片M2S00A和多路开入量转换电路组成,转换电路包括:数字电源VCC3V3、数字地DGND、电阻R6~R9,继电器K1、二极管D7、D8、电容C1、光耦U3,电阻R6同继电器K1的常闭触点串联连接后并联在开入回路两端,电阻R7同继电器动作线圈串联后并联在开入回路两端,开入量正极性经电阻R8同二极管D7串联后接到光耦U3的第一输入端,光耦U3的第二输入端接开入量负极性端,光耦U3的第二输出端4接到M2S00A的单端IO端口,同时经过上拉电阻R9接到数字电源VCC3V3,光耦U3的第一输出端接数字地DGND,电容C1和二极管D8均并联在开入回路两端,其中二极管D8的正极连接到开入量负极性端。

6.根据权利要求1所述的一种集成操作箱功能的涌流抑制装置,其特征是,所述DO模件主要由DO模件FPGA芯片M2S00A、跳闸操作回路和合闸操作回路组成,M2S00A接收来至BLVDS总线上的分合闸命令,通过第一输出端口启动跳闸操作回路或通过第二输出端口启动合闸操作回路,实现带有操作回路的断路器分、合闸操作。

7.根据权利要求6所述的一种集成操作箱功能的涌流抑制装置,其特征是,所述跳闸操作回路包括:电源+24V、+24V地系统24GND、数字地DGND、限流电阻R1、光耦继电器U1、中间继电器BTJ、跳闸保持继电器TBJ、大电流二极管D1、D2、分流电阻R3以及合闸位置继电器HWJ1~HWJ5,M2S00A的第一输出端经过限流电阻R1接到光耦继电器U1的第一输入端上,U1的第二输入端接数字地DGND,U1的第一输出端接到24GND,U1的第二输出端接到BTJ的动作线圈,BTJ动作线圈另一端引入+24V, 其常开触点BTJ_1同跳闸保持继电器TBJ的常开触点TBJ_1并联后一端引入工作电源L+,另一端接到TBJ的动作线圈,TBJ的动作线圈另一端接到跳闸线圈TQ上用于启动跳闸,二极管D1、D2组成的串联回路同TBJ并联,R3同TBJ与D1、D2组成的并联回路并联,HWJ1、HWJ2、HWJ3、HWJ4、HWJ5串联后并联在跳闸回路上。

8.根据权利要求7所述的一种集成操作箱功能的涌流抑制装置,其特征是,所述合闸操作回路包括:电源+24V、+24V地系统24GND、数字地DGND、限流电阻R2、光耦继电器U2、中间继电器BHJ、合闸保持继电器HBJ、大电流二极管D3、D4、分流电阻R4、整流二极管D5、D6、防跳继电器FTJ、分压电阻R5、以及跳闸位置继电器TWJ1~TWJ5,M2S00A的第二输出端经过限流电阻R2接到光耦继电器U2的第一输入端上,U1的第二输入端接数字地DGND,U1的第一输出端接24GND,U1的第二输出端接到BHJ动作线圈,BHJ动作线圈另一端引入+24V, 其常开触点BHJ_1同HBJ常开触点HBJ_1并联后一端引入工作电源L+,另一端接到合闸保持继电器HBJ动作线圈,HBJ动作线圈另一端引出两个分支,分支一通过FTJ与R5组成的串联回路引到工作电源负端L-,分支二通过整流二极管D5与FTJ常闭触点FTJ_1组成的串联回路引到合闸线圈HQ启动合闸,大电流二极管D3、D4组成的串联支路同HBJ并联,R4同HBJ与D3、D4组成的并联回路并联,FTJ常开触点FTJ_2与整流二极管D6组成的串联支路同HBJ并联,中间继电器BTJ的常开触点BTJ_2与跳闸保持继电器TBJ的常开触点TBJ_2并联后一端引入工作电源L+,另一端接到HBJ动作线圈另一端, TWJ1、TWJ2、TWJ3、TWJ4、TWJ5串联后并联在合闸回路上。

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