[实用新型]一种基于双龙芯处理器的高性能数据处理装置有效
申请号: | 201821483475.0 | 申请日: | 2018-09-11 |
公开(公告)号: | CN208622092U | 公开(公告)日: | 2019-03-19 |
发明(设计)人: | 刘理鹏;王冲;刘贵 | 申请(专利权)人: | 湖南航天捷诚电子装备有限责任公司 |
主分类号: | G06F15/163 | 分类号: | G06F15/163 |
代理公司: | 长沙市护航专利代理事务所(特殊普通合伙) 43220 | 代理人: | 莫晓齐 |
地址: | 410205 湖南省长沙市*** | 国省代码: | 湖南;43 |
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摘要: | |||
搜索关键词: | 龙芯 处理器单元 数据处理单元 数据处理装置 龙芯处理器 多处理器 桥片单元 并行数据处理 数据处理性能 本实用新型 插座连接 恶劣环境 插座 联合 | ||
1.一种基于双龙芯处理器的高性能数据处理装置,其特征在于,包括第一龙芯3号处理器单元、第二龙芯3号处理器单元、龙芯2号桥片单元、PCI数据处理单元和CPCI插座,其中:第一龙芯3号处理器单元与第二龙芯3号处理器单元连接,第一龙芯3号处理器单元、PCI数据处理单元均与龙芯2号桥片单元连接,第一龙芯3号处理器单元、PCI数据处理单元均与CPCI插座连接。
2.根据权利要求1所述的基于双龙芯处理器的高性能数据处理装置,其特征在于,所述第一龙芯3号处理器单元为主处理器,第二龙芯3号处理器单元为副处理器。
3.根据权利要求2所述的基于双龙芯处理器的高性能数据处理装置,其特征在于,所述第一龙芯3号处理器单元为龙芯3号处理器,第一龙芯3号处理器单元的龙芯3号处理器包括DDR3控制器、DDR3内存以及高速HT总线接口,通过第一龙芯3号处理器单元的高速HT总线接口分别与第二龙芯3号处理器单元、龙芯2号桥片单元相连接。
4.根据权利要求3所述的基于双龙芯处理器的高性能数据处理装置,其特征在于,所述第二龙芯3号处理器单元为龙芯3号处理器,第二龙芯3号处理器单元的龙芯3号处理器包括DDR3控制器、DDR3内存以及高速HT总线接口,通过第二龙芯3号处理器单元的高速HT总线接口与第一龙芯3号处理器单元相连接。
5.根据权利要求4所述的基于双龙芯处理器的高性能数据处理装置,其特征在于,所述龙芯2号桥片单元为龙芯2号处理器,龙芯2号桥片单元的龙芯2号处理器包括DDR3控制器、DDR3内存、高速HT总线接口、PCIe总线控制器以及高速PCIe总线接口,龙芯2号桥片单元通过高速HT总线接口与第一龙芯3号处理器单元相连接,龙芯2号桥片单元通过高速PCIe总线接口与PCI数据处理单元相连接。
6.根据权利要求5所述的基于双龙芯处理器的高性能数据处理装置,其特征在于,所述PCI数据处理单元采用PCI总线转PCIe总线模块,通过PCIe总线接口与龙芯2号桥片单元连接,通过CPCI总线接口与CPCI插头连接。
7.根据权利要求1至6任一项所述的基于双龙芯处理器的高性能数据处理装置,其特征在于,所述装置还包括FPGA数据处理单元,所述第一龙芯3号处理器单元、第二龙芯3号处理器单元、龙芯2号桥片单元、CPCI插座均与FPGA数据处理单元连接。
8.根据权利要求7所述的基于双龙芯处理器的高性能数据处理装置,其特征在于,所述FPGA数据处理单元通过I2C总线接口与第一龙芯3号处理器单元连接、FPGA数据处理单元通过UART总线接口与第二龙芯3号处理器单元连接、FPGA数据处理单元通过SPI串行总线接口与龙芯2号桥片单元连接,FPGA数据处理单元通过I2C总线与CPCI插头连接。
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