[实用新型]高速信号处理系统用上电时序控制电路有效
申请号: | 201821979668.5 | 申请日: | 2018-11-28 |
公开(公告)号: | CN209201037U | 公开(公告)日: | 2019-08-02 |
发明(设计)人: | 邹斌阳;李世杰;陈大川;王军平;李志攀 | 申请(专利权)人: | 中国空空导弹研究院 |
主分类号: | H03K17/22 | 分类号: | H03K17/22;H03K19/20 |
代理公司: | 中国航空专利中心 11008 | 代理人: | 杜永保 |
地址: | 471009 *** | 国省代码: | 河南;41 |
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摘要: | |||
搜索关键词: | 引脚 高速信号处理系统 上电时序控制电路 本实用新型 连接电阻 上电 数字信号处理电路 输出供电电压 数字电路技术 供电输出端 供电输入端 参数设定 管理芯片 输入电压 稳定控制 延时可调 非隔离 数字地 体积小 可调 门限 延迟 电路 电源 输出 | ||
1.一种高速信号处理系统用上电时序控制电路,其特征在于:包括非隔离可调DC/DC电源模块U1和延时可调管理芯片U2;其中,U1的引脚VOADJUST连接电阻R3后与U1的引脚SMARTSYNC、引脚GND和引脚SENSE-共同连接到数字地DGND,U1的引脚TURBOTRANS连接电阻R1后与U1的引脚VO、引脚SENSE+共同连接到供电输出端,U1的引脚VI与供电输入端连接;U2的引脚RESET#与U1的引脚TRACK连接后经电阻R2与供电输入端连接,U2的引脚CT连接电容C2后与U2的引脚GND共同连接到数字地DGND,U2的引脚VDD和U2的引脚SENSE连接后一端连接到供电输入端,另一端接电容C1后连接到数字地DGND。
2.根据权利要求1所述的高速信号处理系统用上电时序控制电路,其特征在于:U1的引脚INHIBIT接悬空,U2的引脚MR#接悬空。
3.根据权利要求1或2任一项所述的高速信号处理系统用上电时序控制电路,其特征在于:供电输入端与数字地DGND之间并有钽电解电容,供电输出端与数字地DGND之间并有钽电解电容。
4.根据权利要求3所述的高速信号处理系统用上电时序控制电路,其特征在于:U1和U2分别为PTH08T230W和TPS3808G50。
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