[实用新型]片上系统有效

专利信息
申请号: 201822017399.0 申请日: 2018-11-28
公开(公告)号: CN209168101U 公开(公告)日: 2019-07-26
发明(设计)人: 周清睿;王海力 申请(专利权)人: 京微齐力(北京)科技有限公司
主分类号: G06F15/78 分类号: G06F15/78
代理公司: 北京亿腾知识产权代理事务所(普通合伙) 11309 代理人: 陈霁
地址: 100080 北京市海淀区*** 国省代码: 北京;11
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摘要:
搜索关键词: 输入输出端 管脚 外围设备接口 现场可编程门阵列FPGA 微控制单元MCU 片上系统 耦合到 一对一 本实用新型 管脚分配 外设接口 此系统 自定义 封装 空闲 冲突 分配 配置
【说明书】:

本实用新型提供一种片上系统,包括:微控制单元MCU,微控制单元MCU包括第一数目个外围设备接口;现场可编程门阵列FPGA,现场可编程门阵列FPGA包括多个输入输出端;第二数目个管脚PIN;第一数目个外围设备接口中的至少一个接口一对一地耦合到多个输入输出端中的第一部分个输入输出端,第二数目个管脚PIN中的至少一个管脚PIN一对一地耦合到多个输入输出端中的空闲的输入输出端中的第二部分个输入输出端;通过配置现场可编程门阵列FPGA,在第一数目个外围设备接口中的任一外围设备接口与第二数目个管脚PIN中的任一管脚之间建立一条通路。通过此系统,能够使MCU完全自定义地封装分配外设接口管脚,由此更好地解决管脚分配的冲突。

技术领域

本说明书一个或多个实施例涉及计算机技术领域,尤其涉及一种片上系统。

背景技术

随着计算机技术的发展,微控制单元(Microcontroller Unit,MCU)得到了迅猛的发展。MCU又称单片微型计算机(Single Chip Microcomputer)或者单片机,是把中央处理器(Central Process Unit,CPU)的频率与规格做适当缩减,并将内存(Memory)、闪存(NAND)、计数器(Timer)、通用串行总线(Universal Serial Bus;USB)、模/数(A/D)转换、通用异步收发传输器(Universal Asynchronous Receiver/Transmitter,UART)、串行外设接口(Serial Peripheral Interface,SPI)等周边接口,甚至LCD驱动电路都整合在单一芯片上,形成芯片级的计算机,为不同的应用场合做不同组合控制。

现有市场上绝大部分的MCU产品,很多外设接口是复用到芯片封装固定的管脚上,这限制了用户在印制电路板(Printed Circuit Board,PCB)上相关器件的放置,也导致用户的应用可能会出现管脚分配的冲突,想要用的外设接口在某些封装上无法满足需求,而不得不选用成本更高管脚更多的封装。有时,在产品即将投入市场时,用户突然发现需要对此产品进行改动以添加某些外设接口或重新分配管脚,但是面对这种基于固定的MCU管脚的产品,用户有可能不得不重新设计PCB。PCB的重新设计使得产品上市的时间大大延长。虽然市场上也有个别MCU产品可以部分地有限度地分配外设接口的管脚,但也不能完全自定义地封装分配管脚。

因此,希望能有改进的方案,提供一种片上系统使MCU完全自定义地封装分配外设接口管脚,更好地解决管脚分配的冲突。

发明内容

本说明书一个或多个实施例描述了一种片上系统,能够使MCU完全自定义地封装分配外设接口管脚,由此更好地解决管脚分配的冲突。

根据第一方面,提供一种片上系统,包括:

微控制单元MCU,所述微控制单元MCU包括第一数目个外围设备接口;

现场可编程门阵列FPGA,所述现场可编程门阵列FPGA包括多个输入输出端;

第二数目个管脚PIN;

所述第一数目个外围设备接口中的至少一个接口一对一地耦合到所述多个输入输出端中的第一部分个输入输出端,所述第二数目个管脚PIN中的至少一个管脚PIN一对一地耦合到所述多个输入输出端中的空闲的输入输出端中的第二部分个输入输出端;

通过配置所述现场可编程门阵列FPGA,在所述第一数目个外围设备接口中的任一外围设备接口与所述第二数目个管脚PIN中的任一管脚之间建立一条通路。

可选地,所述通路通过下述方式建立:所述现场可编程门阵列FPGA还包括多个路由交叉开关和多条总线,每个路由交叉开关在四个方向上通过与之相耦合的总线耦合至最近的邻居路由交叉开关或所述输入输出端。

可选地,所述通路是所述外围设备接口与所述管脚之间建立的最短通路。

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