[发明专利]人工智能处理器及其所应用的处理方法有效
申请号: | 201880002767.4 | 申请日: | 2018-01-15 |
公开(公告)号: | CN109564638B | 公开(公告)日: | 2023-05-26 |
发明(设计)人: | 肖梦秋 | 申请(专利权)人: | 深圳鲲云信息科技有限公司 |
主分类号: | G06N3/063 | 分类号: | G06N3/063;G06F15/78 |
代理公司: | 深圳智汇远见知识产权代理有限公司 44481 | 代理人: | 郑江燕 |
地址: | 518000 广东省深圳市*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 人工智能 处理器 及其 应用 处理 方法 | ||
1.一种人工智能处理器,其特征在于,包括:
可编程逻辑电路,其包括:
卷积处理模块,通信连接至外部存储器,其中,所述外部存储器存储有第一待处理数据及第一权重参数;所述卷积处理模块包括:第一参数缓存、第一输入缓存、卷积运算电路及第一输出缓存;
所述第一参数缓存,用于读取并输出所述第一权重参数,所述第一参数缓存包括:多个相连的行缓存,其中,各所述行缓存每输出一位数据则集合形成一列数据输出;
所述第一输入缓存,用于读取并输出所述第一待处理数据,所述第一输入缓存包括多个相连的行缓存,所述第一输入缓存输出的所述第一待处理数据为所述多个相连的行缓存的输出所构成的矩阵;
所述卷积运算电路,用于从第一输入缓存读取所述第一待处理数据以及从第一参数缓存读取第一权重参数,据以进行卷积运算并输出卷积运算结果;
所述第一输出缓存,用于接收所述卷积运算结果,并将该卷积运算结果向所述外部存储器输出;
所述可编程逻辑电路还包括:
反卷积处理模块,通信连接至外部存储器,其中,所述外部存储器存储有第二待处理数据及第二权重参数;所述反卷积处理模块包括:第二参数缓存、第二输入缓存、反卷积运算电路及第二输出缓存;
所述第二参数缓存,用于读取并输出所述第二权重参数;
所述第二输入缓存,其包括:多个相连的行缓存,用于读取并输出所述第二待处理数据;其中,各所述行缓存每输出一位数据则集合形成一列数据输出;
所述反卷积运算电路,用于从第二输入缓存读取所述第二待处理数据以及从第二参数缓据以进行反卷积运算并输出反卷积运算结果;
所述第二输出缓存,用于接收所述反卷积运算结果,并输出该反卷积运算结果至所述外部存储器。
2.根据权利要求1所述的人工智能处理器,其特征在于,卷积处理模块还包括:池化运算电路,用于对所述卷积运算结果进行池化后向外部存储器输出。
3.根据权利要求1所述的人工智能处理器,其特征在于,所述可编程逻辑部分还包括:全连接运算电路,用于根据所述卷积运算结果进行分类并输出。
4.根据权利要求1所述的人工智能处理器,其特征在于,包括:第一DMA,通信连接在所述外部存储器与卷积处理模块之间。
5.根据权利要求1所述的人工智能处理器,其特征在于,所述卷积处理模块所包括的各内部部件之间以及卷积处理模块与外部存储器之间通过先入先出数据接口连接。
6.根据权利要求1所述的人工智能处理器,其特征在于,还包括:处理系统电路,其包括:中央处理模块,用于配置所述可编程逻辑电路中卷积处理模块的运行参数。
7.根据权利要求1所述的人工智能处理器,其特征在于,所述第一待处理数据包含多个通道数据;所述第一权重参数包含多层子参数,每层子参数分别一一对应各个通道数据;所述卷积运算电路有多个,用于一一对应地并行计算各个通道数据的卷积运算结果。
8.根据权利要求1所述的人工智能处理器,其特征在于,包括:共享缓存,作为所述第一输入缓存及第二输入缓存,供卷积运算电路及反卷积运算电路分时复用地传输接受自外部存储器的数据。
9.根据权利要求1所述的人工智能处理器,其特征在于,包括:第二DMA,通信连接在所述外部存储器与反卷积处理模块之间。
10.根据权利要求1所述的人工智能处理器,其特征在于,所述反卷积处理模块所包括的各内部部件之间以及反卷积处理模块与外部存储器之间通过先入先出数据接口连接。
11.根据权利要求1所述的人工智能处理器,其特征在于,还包括:处理系统电路,其包括:中央处理模块,用于配置所述可编程逻辑电路中卷积处理模块及反卷积处理模块的运行参数。
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