[发明专利]低功率模数转换器在审

专利信息
申请号: 201880019528.X 申请日: 2018-03-21
公开(公告)号: CN110463043A 公开(公告)日: 2019-11-15
发明(设计)人: 克里斯蒂安·M·伯梅勒 申请(专利权)人: 雷神公司
主分类号: H03M1/08 分类号: H03M1/08;H03M1/56
代理公司: 11227 北京集佳知识产权代理有限公司 代理人: 杜诚;马骁<国际申请>=PCT/US20
地址: 美国马*** 国省代码: 美国;US
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摘要:
搜索关键词: 电压电平 计数器 比较器输出 脉冲发生器 单斜率模数转换器 比较器 触发器 锁存器 耦合到 脉冲 输出
【权利要求书】:

1.一种单斜率模数转换器(ADC),包括:

比较器,其具有正输入和负输入以及比较器输出;

计数器;

锁存器,其被连接到所述计数器的输出,并包括触发器输入;以及

脉冲发生器,其被耦合到所述比较器输出,每当所述负输入上的信号从低于所述正输入上的电压电平的电压电平转变为高于所述正输入上的电压电平的电压电平时,所述脉冲发生器产生具有限定宽度的脉冲。

2.根据权利要求1所述的ADC,其中所述脉冲发生器包括耦合到所述触发器输入的脉冲发生器输出,并且其中所述脉冲发生器包括具有第一逻辑门输入和第二逻辑门输入的门,所述第一逻辑门输入被耦合到所述比较器输出,并且所述第二逻辑门输入被耦合到所述比较器输出的延迟版本。

3.根据权利要求2所述的单斜率ADC,其中所述比较器输出的所述延迟版本被反相。

4.根据权利要求3所述的单斜率ADC,其中所述脉冲发生器具有第一脉冲发生器输入,并且还包括:

延迟元件;以及

与所述延迟元件串联连接的反相器;

其中所述反相器和所述延迟元件被连接在所述第一脉冲发生器输入和所述第二逻辑门输入之间。

5.根据权利要求1所述的单斜率ADC,其中所述计数器是格雷码计数器。

6.根据权利要求1所述的单斜率ADC,其中所述比较器包括:

第一比较器,其具有第一正输入和第一负输入以及第一比较器输出;

第二比较器,其具有第二正输入和第二负输入以及第二比较器输出;

其中所述第二负输入被连接到所述第一负输入。

7.一种单斜率模数转换器(ADC),包括:

第一比较器,其具有正输入和负输入以及第一比较器输出;

第一计数器;

第一锁存器,其被连接到所述第一计数器的输出,并包括第一触发器输入;以及

第一脉冲发生器,其被耦合到所述第一比较器输出,每当所述第一比较器的所述负输入上的信号从低于所述第一比较器的所述正输入上的电压电平的电压电平转变为高于所述第一比较器的所述正输入上的所述电压电平的电压电平时,所述第一脉冲发生器产生具有限定宽度的脉冲;

第二比较器,其具有正输入和负输入以及第二比较器输出;

第二计数器;

第二锁存器,其被连接到所述第二计数器的输出,并包括第二触发器输入;以及

第二脉冲发生器,其被耦合到所述第二比较器输出,每当所述第二比较器的所述负输入上的信号从低于所述第二比较器的所述正输入上的电压电平的电压电平转变为高于所述第二比较器的所述正输入上的所述电压电平的电压电平时,所述第二脉冲发生器产生具有限定宽度的脉冲。

8.根据权利要求7所述的ADC,其中所述第一脉冲发生器包括被耦合到所述第一锁存器的所述触发器输入的第一脉冲发生器输出,并且其中所述第一脉冲发生器包括具有第一逻辑门输入和第二逻辑门输入的门,所述第一逻辑门输入被耦合到所述第一比较器输出,并且所述第二逻辑门输入被耦合到所述第一比较器输出的延迟版本。

9.根据权利要求8所述的单斜率ADC,其中所述比较器输出的所述延迟版本被反相。

10.根据权利要求9所述的单斜率ADC,其中所述第一脉冲发生器包括第一脉冲发生器输入,并且还包括:

延迟元件;以及

与所述延迟元件串联连接的反相器;

其中所述反相器和所述延迟元件被连接在所述第一脉冲发生器输入和所述第二逻辑门输入之间。

11.根据权利要求7所述的单斜率ADC,其中所述计数器是格雷码计数器。

12.根据权利要求7所述的单斜率ADC,其中所述第二比较器的所述负输入被连接到所述第一比较器的所述负输入。

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