[发明专利]包分类与加时间戳系统和方法有效

专利信息
申请号: 201880058391.9 申请日: 2018-08-27
公开(公告)号: CN111194529B 公开(公告)日: 2022-02-18
发明(设计)人: B·布兰斯科姆;L·埃勒加德;K·埃勒斯;T·约根森 申请(专利权)人: 美高森美存储解决方案股份有限公司
主分类号: H04J3/06 分类号: H04J3/06;H04L43/028;H04L43/106;H04L69/22;H04L69/28;H04L69/323
代理公司: 上海专利商标事务所有限公司 31100 代理人: 陈斌
地址: 美国亚*** 国省代码: 暂无信息
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摘要:
搜索关键词: 分类 时间 系统 方法
【权利要求书】:

1.一种间接分类加时间戳系统,包括:

至少一个物理层PHY,所述至少一个PHY中的每一个呈现出口侧;和

至少一个包处理器,所述至少一个PHY中的每一个与所述至少一个包处理器之一通信,

其中所述至少一个包处理器中的每一个包括:

分类器;

处理器出口戳功能;和

第一发射器,

其中所述分类器被布置为:

接收数据包;以及

根据预定分类规则为接收的数据包生成分类,生成的分类选自多个预定分类,

其中所述处理器出口戳功能被布置为响应于生成的分类而:

生成指针;或

为加时间戳操作生成指令,生成的指令选自至少三个预定指令选项,

其中所述第一发射器被布置为将接收的数据包连同生成的指针或指令一起传输到所述PHY的所述出口侧,

其中所述至少一个PHY中的每一个包括:

PHY时钟,所述PHY时钟被布置为生成指示当前时间的第一时间信号;和

PHY出口戳功能,

其中所述PHY出口戳功能被布置为响应于生成的指针或生成的指令而执行多个预定时间戳操作之一,所述多个预定时间戳操作包括:响应于所述生成的时间信号而生成时间戳信号;不生成时间戳信号;或修改接收的数据包中写入的时间戳。

2.根据权利要求1所述的系统,其中所述处理器出口戳功能被布置为生成所述指令,生成的指令指示要执行所述多个预定时间戳操作中的哪个操作。

3.根据权利要求1所述的系统,其中所述至少一个PHY中的每一个还包括存储器,

其中所述处理器出口戳功能被布置为生成所述指针,所述指针指向所述存储器的一部分,所述存储器的所述部分包括指示要执行所述多个预定时间戳操作中的哪个操作的指令。

4.根据权利要求1所述的系统,其中对于生成所述指针的所述处理器出口戳功能的所述布置而言,所述处理器出口戳功能被进一步布置为在向所述PHY出口侧的所述传输之前将生成的指针写入到所述数据包中,所述PHY出口戳功能被进一步布置为从所述数据包提取写入的指针,并且

其中对于生成所述指令的所述处理器出口戳功能的所述布置而言,所述处理器出口戳功能被进一步布置为在向所述PHY出口侧的所述传输之前将生成的指令写入到所述数据包中,所述PHY出口戳功能被进一步布置为从所述数据包提取写入的指令。

5.根据权利要求1中所述的系统,其中所述至少一个PHY中的每一个还呈现入口侧并且还包括:

PHY入口戳功能;和

第二发射器,

其中所述PHY入口戳功能被布置为:

在所述入口侧上接收数据包;以及

响应于生成的时间信号而为接收的入口侧数据包生成预定入口时间戳信号,为所有数据包生成的所述预定入口时间戳信号在所述入口侧上接收,

其中所述第二发射器被布置为将所述入口侧数据包连同生成的入口时间戳信号一起传输到与其通信的所述包处理器。

6.根据权利要求5所述的系统,其中在所述传输之前,所述PHY入口戳功能被进一步布置为将生成的入口时间戳信号写入到所述入口侧数据包中。

7.根据权利要求1所述的系统,其中所述至少一个包处理器包括多个包处理器,并且所述至少一个PHY包括多个PHY,所述多个PHY中的第一组与所述多个包处理器中的第一个通信,并且所述多个PHY中的第二组与所述多个包处理器中的第二个通信。

8.根据权利要求1所述的系统,其中所述至少一个包处理器包括单个包处理器,并且所述至少一个PHY包括多个PHY,所述多个PHY与所述单个包处理器通信。

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