[发明专利]提供多相时钟信号的设备及方法

说明书

本发明描述用于提供多相时钟信号的设备及方法。实例设备包含第一、第二、第三及第四时控反相器、第一及第二时钟端子，及第一及第二锁存器电路。所述第一时控反相器的输入节点及输出节点分别耦合到所述第四时控反相器的输出节点及所述第二时控反相器的输入节点。所述第三时控反相器的输入节点及输出节点耦合到所述第二时控反相器的输出节点及所述第四时控反相器的输入节点。所述第一及第二时钟端子分别供应有第一及第二时钟信号。所述第一锁存器耦合在所述第一及第三时控反相器的所述输出节点之间，且所述第二锁存器电路耦合在所述第二及第四时控反相器的所述输出节点之间。

背景技术

在许多电子系统中使用半导体存储器来存储可在稍后时间检索的数据。随着对于电子系统更快速、更小、具有更大计算能力且消耗更少功率的需求已增加，已持续开发可更快速存取、紧致、存储更多数据且使用更少功率的半导体存储器以满足变化的需求。开发的部分包含创建用于控制且存取半导体存储器的新规格，其中规格从一代到下一代的变化涉及改进电子系统中的存储器的性能。

通常通过向存储器提供命令信号、地址信号、时钟信号而控制半导体存储器。举例来说，可由存储器控制器提供各种信号。命令信号可控制半导体存储器执行各种存储器操作，举例来说，用以从存储器检索数据的读取操作，及用以将数据存储到存储器的写入操作。在最近开发的存储器的情况下，存储器可具备用于对命令信号及地址信号计时的系统时钟信号(举例来说)，且进一步具备用于对由存储器提供的读取数据计时且用于对提供到存储器的写入数据计时的数据时钟信号。

关于使用数据时钟信号的存储器设计，(例如，从存储器控制器)将数据时钟信号提供到存储器以使通过存储器的读取数据的提供或写入数据的接收同步。根据具有相对于存储器命令的接收的时序的规格提供数据时钟信号以便提供数据或接收数据以满足指定时序。存储器响应于有源数据时钟信号且相应地提供或接收数据。

可使用包含于半导体存储器中的时钟电路来产生用于执行各种操作的内部时钟信号。举例来说，一些时钟电路可基于数据时钟信号而提供多相时钟信号。多相时钟信号可(举例来说)用于对通过存储器的数据的提供及/或接收进行计时。多相时钟信号具有与彼此(例如，90度)及与数据时钟信号的相对相位。在一些存储器中，时钟电路提供具有相对于数据时钟信号的相位关系的多相时钟信号，所述相位关系未知，直到通过多相时钟信号中的一或多者的评估而确定。

然而，用于产生内部时钟信号的常规时钟电路通常是麻烦的，包含若干复杂电路，且归因于具有耦合在输入与输出之间的若干复杂电路而可能在接收输入时钟信号与提供输出时钟信号之间具有相对较长路径延迟。另外，当输入时钟信号开始从共同时钟电平计时时，常规时钟电路可具有相对较长恢复时间。

发明内容

描述提供多相时钟信号的设备及方法。本发明的一方面包含一种设备，其包含第一、第二、第三及第四时控反相器、分别供应有第一及第二时钟信号的第一及第二时钟端子，及第一及第二锁存器电路。第一、第二、第三及第四时控反相器中的每一者包含输入节点、输出节点、第一时钟节点及第二时钟节点。第一时控反相器的输入节点及输出节点分别耦合到第四时控反相器的输出节点及第二时控反相器的输入节点。第三时控反相器的输入节点及输出节点分别耦合到第二时控反相器的输出节点及第四时控反相器的输入节点。第一时钟端子耦合到第一及第三时控反相器的第一时钟节点及第二及第四时控反相器的第二时钟节点。第二时钟端子耦合到第一及第三时控反相器的第二时钟节点及第二及第四时控反相器的第一时钟节点。第一锁存器耦合在第一及第三时控反相器的输出节点之间，且第二锁存器电路耦合在第二及第四时控反相器的输出节点之间。