[发明专利]用于工程化衬底上的集成式器件的系统和方法在审
申请号: | 201880078683.9 | 申请日: | 2018-12-04 |
公开(公告)号: | CN111512415A | 公开(公告)日: | 2020-08-07 |
发明(设计)人: | 弗拉基米尔·奥德诺博柳多夫;迪利普·瑞思布德;奥兹古·阿克塔斯;杰姆·巴斯切里 | 申请(专利权)人: | 克罗米斯有限公司 |
主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L21/84;H01L27/12;H01L29/04;H01L29/78 |
代理公司: | 广州华进联合专利商标代理有限公司 44224 | 代理人: | 黄隶凡 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 工程 衬底 集成 器件 系统 方法 | ||
1.一种形成多个器件的方法,包括:
通过以下步骤形成衬底:
提供多晶陶瓷芯;
利用第一粘附壳包封所述多晶陶瓷芯;
利用阻挡层包封所述第一粘附壳;
在所述阻挡层上形成键合层;以及
形成耦合至所述键合层的实质单晶层;
形成耦合至所述实质单晶层的缓冲层;
根据与所述多个器件相关联的需求在所述缓冲层上形成一个或多个III-V族外延层;以及
通过以下步骤在所述衬底上形成所述多个器件:
将设置在所述多个器件之间的所述一个或多个III-V族外延层的一部分移除;以及
将设置在所述多个器件之间的所述缓冲层的一部分移除。
2.根据权利要求1所述的方法,其特征在于,所述一个或多个III-V族外延层包括GaN。
3.根据权利要求1所述的方法,其特征在于,进一步包括:将所述衬底上的所述多个器件平坦化。
4.根据权利要求3所述的方法,其特征在于,所述平坦化进一步包括:
在所述多个器件上形成电介质层;以及
使用化学机械平坦化来使所述多个器件平滑。
5.根据权利要求1所述的方法,其特征在于,进一步包括:在所述多个器件中的第一器件与所述多个器件中的第二器件之间制造一个或多个互连。
6.根据权利要求1所述的方法,其特征在于,进一步包括:
将所述多个器件中的每一个器件上的第一表面键合至临时载体,其中所述第一表面与所述衬底相对;
移除所述衬底,以暴露所述器件中的每一个器件上的第二表面;
在所述第二表面上形成导电层;以及
将载体晶圆键合至所述导电层。
7.根据权利要求6所述的方法,其特征在于,进一步包括:移除所述载体晶圆的一个或多个部分,以形成一个或多个背面接点。
8.根据权利要求1所述的方法,其特征在于,所述多个器件包括:耗尽型高电子迁移率晶体管(HEMT)和增强型高电子迁移率晶体管。
9.根据权利要求1所述的方法,其特征在于,所述多个器件包括:第一耗尽型高电子迁移率晶体管(HEMT)和第二耗尽型高电子迁移率晶体管。
10.根据权利要求1所述的方法,其特征在于,所述多个器件包括:第一增强型高电子迁移率晶体管(HEMT)和第二增强型高电子迁移率晶体管。
11.根据权利要求1所述的方法,其特征在于,所述多个器件包括:高电子迁移率晶体管(HEMT)和垂直型器件。
12.一种形成多个器件的方法,包括:
通过以下步骤形成衬底:
提供多晶陶瓷芯;
利用粘附壳包封所述多晶陶瓷芯;
利用阻挡层包封所述粘附壳;
在所述阻挡层上形成键合层;以及
形成耦合至所述键合层的实质单晶层;
形成耦合至所述实质单晶层的导电层;
形成耦合至所述导电层的缓冲层;
根据所述多个器件中的每一个器件的需求在所述缓冲层上形成一个或多个III-V族外延层;以及
通过以下步骤形成所述多个器件:
将设置在所述多个器件之间的所述一个或多个III-V族外延层的一部分以及所述缓冲层的一部分移除,以暴露所述导电层的一部分;
形成耦合至所述导电层的暴露部分中的一部分的接点;以及
将未耦合至所述接点的所述导电层的剩余的暴露部分移除。
13.根据权利要求12所述的方法,其特征在于,进一步包括:将所述衬底上的所述多个器件平坦化。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造