[发明专利]显示面板以及显示面板的制造方法有效
申请号: | 201880094715.4 | 申请日: | 2018-06-20 |
公开(公告)号: | CN112313730B | 公开(公告)日: | 2023-03-28 |
发明(设计)人: | 中川英俊 | 申请(专利权)人: | 堺显示器制品株式会社 |
主分类号: | G09F9/30 | 分类号: | G09F9/30;G02F1/1345;G09F9/00;H10K59/131;H10K50/80;H05B33/02;H05B33/14 |
代理公司: | 深圳市赛恩倍吉知识产权代理有限公司 44334 | 代理人: | 叶乙梅 |
地址: | 日本国大*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 显示 面板 以及 制造 方法 | ||
1.一种显示面板,其特征在于,包括:
多个像素,其形成在基板的表面并且排列成矩阵状;
一个以上的驱动电路,其形成在由所述表面中的所述多个像素构成的图像显示部的外侧,并向所述多个像素中的排列于同一行或者同一列的像素供给信号;以及
多个导体图案,其形成在所述表面,且各自构成所述驱动电路的一部分并彼此电分离,
所述多个导体图案包含第一导体图案和第二导体图案,
所述第一导体图案具有构成所述一个以上的驱动电路中的任一个驱动电路所包含的第一电路元件的一部分的第一元件形成部,
所述第二导体图案具有构成所述一个以上的驱动电路中的任一个驱动电路所包含的第二电路元件的一部分的第二元件形成部,
在所述第一导体图案以及所述第二导体图案中的至少一个中设有放电部,所述放电部使所述第一导体图案与所述第二导体图案之间的间隔局部地窄于所述第一元件形成部与所述第二元件形成部之间的间隔。
2.根据权利要求1所述的显示面板,其特征在于,
设置于所述第一导体图案中的所述放电部从所述第一元件形成部中的所述第二导体图案侧的第一外缘向所述第二导体图案突出,并且/或者,设置于所述第二导体图案中的所述放电部从所述第二元件形成部中的所述第一导体图案侧的第二外缘向所述第一导体图案突出。
3.根据权利要求2所述的显示面板,其特征在于,
所述放电部的突出长度比所述放电部中的所述第一导体图案与所述第二导体图案之间的间隔长。
4.根据权利要求2或3所述的显示面板,其特征在于,
在所述第一外缘以及所述第二外缘中的至少一个中,形成有隔着绝缘层与该第一外缘以及该第二外缘中的至少一个外缘重叠的导体膜。
5.根据权利要求2或3所述的显示面板,其特征在于,
所述第一电路元件以及所述第二电路元件是同一所述驱动电路的电路元件,
在面向所述图像显示部以及所述驱动电路的第一方向上,所述第一元件形成部与所述第二元件形成部相对,
所述第一外缘以及所述第二外缘向与所述第一方向相交的第二方向延伸。
6.根据权利要求1~3中任一项所述的显示面板,其特征在于,
所述第一导体图案还具有干线图案,所述干线图案构成用于向所述一个以上的驱动电路的每一个输入规定信号的共用布线,
所述第一元件形成部与所述干线图案直接连接。
7.根据权利要求6所述的显示面板,其特征在于,
所述第二导体图案横跨所述一个以上的驱动电路中的第一驱动电路和与所述第一驱动电路不同的第二驱动电路,
所述第二电路元件是所述第一驱动电路的电路元件,
所述第二导体图案还具有第三元件形成部,所述第三元件形成部构成所述第二驱动电路的第三电路元件的一部分。
8.根据权利要求1~3、7中任一项所述的显示面板,其特征在于,
所述多个导体图案还包含第三导体图案,所述第三导体图案与所述多个像素的每一个所具备的像素驱动电路连接,
所述第一导体图案或所述第二导体图案与所述第三导体图案之间在一个或多个位置处绝缘,
所述一个或多个位置的每一个位置处的绝缘距离比所述放电部中的所述第一导体图案与所述第二导体图案之间的间隔短。
9.根据权利要求1~3、7中任一项所述的显示面板,其特征在于,
在所述多个导体图案中,所述第一导体图案或所述第二导体图案具有最大的面积。
10.根据权利要求1~3、7中任一项所述的显示面板,其特征在于,
形成有多个所述驱动电路,
在多个所述驱动电路的每一个中设有所述放电部。
11.一种显示面板的制造方法,其特征在于,至少包含如下工序:
通过在基板的表面形成多个薄膜晶体管来形成像素驱动电路的工序;
通过在所述像素驱动电路上形成液晶层或有机发光层来形成多个像素的工序;以及
通过在所述表面中的要成为所述多个像素的外侧的区域中形成至少一个电路元件,来形成用于向所述像素驱动电路供给信号的驱动电路的工序,
在所述驱动电路以及所述像素驱动电路的形成中,在所述基板的所述表面形成构成所述驱动电路的一部分且彼此电分离的多个导体图案,
所述多个导体图案的形成中,形成第一导体图案和第二导体图案,所述第一导体图案具有构成所述驱动电路所包含的第一电路元件的一部分的第一元件形成部,所述第二导体图案具有构成所述驱动电路所包含的第二电路元件的一部分的第二元件形成部,
在所述第一导体图案以及所述第二导体图案的形成中,在所述第一导体图案以及所述第二导体图案中的至少一个中设置放电部,所述放电部使所述第一导体图案与所述第二导体图案之间的间隔局部地窄于所述第一元件形成部与所述第二元件形成部之间的间隔。
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