[发明专利]NLDMOS器件及其制造方法有效
申请号: | 201910014757.9 | 申请日: | 2019-01-08 |
公开(公告)号: | CN109698239B | 公开(公告)日: | 2021-06-08 |
发明(设计)人: | 刘冬华 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L29/78 | 分类号: | H01L29/78;H01L29/06;H01L29/40;H01L21/336 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 郭四华 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | nldmos 器件 及其 制造 方法 | ||
本发明公开了一种NLDMOS器件,包括:由第一N型深阱组成的漂移区,形成于和第一N型深阱具有间距的第二N型深阱中的P阱,形成于漂移区表面的第一PTOP层和形成于P阱表面的第二PTOP层;源极的金属的延伸到漂移区的顶部并形成的源端金属场板和栅极在漂移区顶部的走线形成的栅端金属场板都向源侧移动用以拉大和漏极延伸形成的漏端金属场板的间距从而提高器件的击穿电压。本发明还公开了一种NLDMOS器件的制造方法。本发明能提高器件的击穿电压,能使器件的导通电阻保持不变和降低。
技术领域
本发明涉及半导体集成电路制造领域,特别是涉及一种N型横向扩散金属氧化物半导体(NLDMOS)器件;本发明还涉及一种NLDMOS器件的制造方法。
背景技术
500V横向扩散金属氧化物半导体(LDMOS)既具有分立器件高压大电流特点,又汲取了低压集成电路高密度智能逻辑控制的优点,单芯片实现原来多个芯片才能完成的功能,大大缩小了面积,降低了成本,提高了能效,符合现代电力电子器件小型化,智能化,低能耗的发展方向。
击穿电压作为衡量500V器件的关键参数而显得尤为重要,现有技术通过在漂移区的表面形成P型顶层(PTOP)层能够增加漂移区的耗尽,实现降低表面电场(Resurf) 效果,如图1所示,是现有NLDMOS器件的结构示意图;在硅衬底1上形成由N型深阱2组成,P阱4和漂移区相隔一定距离,P阱4也被一个N型深阱2包围,场氧3 形成于N型深阱2表面,栅极结构由栅氧化层6和多晶硅栅7组成,源区8b形成于P 阱4中并和多晶硅栅7自对准,P阱引出区9形成于P阱4表面并由P+区组成,漏区 8b形成于漂移区表面并和场氧3的一侧自对准;在场氧3的靠近漏区8a侧形成有多晶硅场板7a,多晶硅场板7a和多晶硅栅7都是同一层多晶硅光刻刻蚀形成。层间膜 10将底部的器件区域覆盖,通过接触孔和正面金属层引出器件的源极11a、漏极11b 和栅极11c。在漂移区的表面形成有PTOP层5,在源区8b侧的P阱4的底部也形成有PTOP层5,PTOP层5能够增加漂移区的耗尽,降低表面电场,最终提高器件的击穿电压。其中,源极11、漏极13和栅极12的正面金属层分别会延伸到漂移区的顶部并形成源端金属场板、漏端金属场板和栅极走线,源端金属场板、漏端金属场板和栅极走线能起到提高漂移区表面峰值电场的作用,使击穿电压增加。
发明内容
本发明所要解决的技术问题是提供一种NLDMOS器件,能提高器件的击穿电压。此,本发明还提供一种NLDMOS器件的制造方法。
为解决上述技术问题,本发明提供的NLDMOS器件包括:
形成于P型半导体衬底中的第一N型深阱和第二N型深阱,所述第一N型深阱和所述第二N型深阱工艺条件相同且相隔一定距离,漂移区由所述第一N型深阱组成。
形成于所述第二N型深阱中的P阱。
形成于所述半导体衬底上方的多晶硅栅,所述多晶硅栅和所述半导体衬底表面隔离有栅介质层,在横向上所述多晶硅栅从所述P阱延伸到所述漂移区上方,被所述多晶硅栅覆盖的所述P阱用于形成沟道;所述多晶硅栅的第一侧面位于所述P阱上方、所述多晶硅栅的第二侧面位于所述漂移区上方。
由N+区组成的源区和漏区,所述源区形成于所述P阱中并和所述多晶硅栅的第一侧面自对准,所述漏区形成于所述漂移区中。
由P+区组成的衬底引出区,所述衬底引出区形成于所述P阱中并用于将所述P 阱引出,所述衬底引出区和所述源区横向接触。
场氧,位于所述P阱和所述漏区之间的所述漂移区上方,所述场氧的第二侧和所述漏区横向接触,所述场氧的第一侧延伸到所述第一N型深阱的第一侧和所述第二N 型深阱的第二侧之间;所述多晶硅栅的第二侧面延伸到所述场氧上方。
第一PTOP层,形成于所述漂移区表面且位于所述场氧的底部。
第二PTOP层,形成于所述P阱中。
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