[发明专利]可定制的多队列DMA接口在审
申请号: | 201910107463.0 | 申请日: | 2019-02-02 |
公开(公告)号: | CN110134623A | 公开(公告)日: | 2019-08-16 |
发明(设计)人: | C·S·塞麻贡德鲁;D·厥;T·余;J·维斯特;H·霍恩格;R·桑卡瓦利 | 申请(专利权)人: | 赛灵思公司 |
主分类号: | G06F13/32 | 分类号: | G06F13/32;G06F13/42 |
代理公司: | 北京市君合律师事务所 11517 | 代理人: | 毛健;徐伊迪 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用户逻辑 可定制 写入 直接存储器存取 半导体材料 旁路操作模式 读取 可编程逻辑 重新配置 多队列 描述符 电路 硬化 关联 传递 | ||
1.一种操作直接存储器存取DMA引擎的方法,其特征在于,所述方法包括:
在所述DMA引擎处从主机接收第一描述符;
在旁路操作模式中,使用DMA接口将所述第一描述符从所述DMA引擎转发到接收逻辑;以及
在所述接收逻辑处确定所述第一描述符是否包括以下之一:对应于第一DMA操作的有效载荷和指向所述有效载荷的存储器指针。
2.根据权利要求1所述的方法,其特征在于,所述方法还包括:
接收多个可用描述符,用于对所述DMA引擎执行所述第一DMA操作,其中所述DMA引擎使用所述DMA接口将所述可用描述符转发到所述接收逻辑。
3.根据权利要求2所述的方法,其特征在于,所述方法还包括:
响应于接收到所述多个可用描述符,向所述DMA引擎发出信用,其中,在将所述第一描述符转发到所述接收逻辑之前,所述DMA引擎被配置为使用所述信用中的至少一个来向所述主机发送请求以获取所述第一描述符。
4.根据权利要求3所述的方法,其特征在于,所述方法还包括:
根据所述接收逻辑的性能参数,确定要发出到所述DMA引擎的所述信用的数量。
5.根据权利要求2所述的方法,其特征在于,所述第一DMA操作包括将被存储在片上系统中的数据写入所述主机,其中所述接收逻辑被配置为响应于接收到所述多个可用描述符而向所述DMA引擎提供预取提示,其中所述预取提示指示在所述可用描述符中的至少一个描述符以从所述DMA队列中预取。
6.根据权利要求2所述的方法,其特征在于,所述方法还包括:
响应于接收到所述可用描述符,提供对应于所述第一DMA操作的有效载荷,其中所述有效载荷是在所述DMA引擎将所述第一描述符发送到所述接收逻辑之前被提供的;和
处理所述第一描述符,而不用在包括从所述DMA引擎接收的多个描述符的缓存中缓冲所述第一描述符。
7.根据权利要求1所述的方法,其特征在于,所述第一描述符包括对应于各个有效载荷的即时数据,其中所述方法包括:
完成所述第一DMA操作,而不用将所述第一描述符转发回所述DMA引擎。
8.根据权利要求1所述的方法,其特征在于,所述第一描述符将对应的指针存储到存储器,其中所述方法包括:
将所述第一描述符从所述接收逻辑转发回所述DMA引擎,其中所述DMA引擎使用所述第一描述符向所述主机发送DMA指令。
9.根据权利要求8所述的方法,其特征在于,所述方法还包括:
在将所述第一描述符转发回所述DMA引擎之前,对所述第一描述符中的对应指针执行虚拟到物理存储器地址转换。
10.根据权利要求1所述的方法,其特征在于,所述方法还包括:
在所述DMA引擎处从所述主机接收多个描述符,其中所述多个描述符包括流格式和存储器映射格式,其中具有所述流格式的描述符对应于写入或读取自所述DMA接口的数据,而具有所述存储器映射格式的描述符对应于写入或读取自集成电路中的存储器的数据,所述集成电路包括所述DMA引擎和所述接收逻辑。
11.一种片上系统SOC,其特征在于,所述SOC包括:
包括电路的DMA引擎;
用户逻辑;和
DMA接口,其包括将所述DMA引擎通信地耦接到所述用户逻辑的信号,
其中在旁路操作模式中,所述DMA引擎被配置为使用所述DMA接口将从主机接收的第一描述符转发到所述用户逻辑,以及
其中所述用户逻辑评估所述第一描述符,以确定所述第一描述符是否包括以下之一:对应于第一DMA操作的有效载荷和指向所述有效载荷的存储器指针。
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