[发明专利]一种基于PCIe总线的在线重构方法有效

专利信息
申请号: 201910137735.1 申请日: 2019-02-25
公开(公告)号: CN109918321B 公开(公告)日: 2021-01-05
发明(设计)人: 俞志群;崔凤勇;张莹;刘博;袁延波;徐星 申请(专利权)人: 浙江中控研究院有限公司
主分类号: G06F13/12 分类号: G06F13/12;G06F13/42
代理公司: 上海汉声知识产权代理有限公司 31236 代理人: 胡晶
地址: 310053 浙江省杭州市*** 国省代码: 浙江;33
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摘要:
搜索关键词: 一种 基于 pcie 总线 在线 方法
【权利要求书】:

1.一种基于PCIe总线的在线重构方法,其特征在于,包括以下步骤:

S1:FPGA经所述PCIe总线接收重构文件的总说明文件,并对所述总说明文件进行存储,所述总说明文件用于记录所述重构文件中分析块之间的总逻辑关系;

S2:所述FPGA经所述PCIe总线接收所述重构文件的分析块报文,并对所述分析块报文的每一帧PCIe总线数据进行解析与存储;

S3:所述FPGA每解析完一帧所述PCIe总线数据,对当前解析完的一帧所述PCIe总线数据中的每一个所述分析块进行在线重构逻辑运算处理,得到所述分析块的处理结果,直至处理完所述分析块报文的每一帧所述PCIe总线数据,其中,所述分析块包括普通分析块和输出分析块;

S4:所述FPGA根据所述分析块之间的总逻辑关系和各个所述分析块的处理结果,解析得到在线重构逻辑。

2.根据权利要求1所述的基于PCIe总线的在线重构方法,其特征在于,所述在线重构逻辑运算处理为:

A1:若所述分析块为所述普通分析块,则执行以下解析:

若所述普通分析块的行数大于1,则对所述普通分析块的每一行串联关系中的各个元素之间进行逻辑与操作,得到每一行串联关系的解析结果,并对每一行串联关系对应的解析结果之间进行逻辑或的操作,得到所述普通分析块的处理结果;

若所述普通分析块的行数等于1,则对所述普通分析块的各个元素之间进行逻辑与的操作,得到所述普通分析块的处理结果;

A2:若所述分析块为所述输出分析块,则执行以下解析:

若所述输出分析块的输出行数大于1,则建立所述输出分析块的多行共用的记录标志,所述输出分析块的每一行根据所述记录标志进行输出结果;

若所述输出分析块的输出行数等于1,则直接输出结果。

3.根据权利要求1或2所述的基于PCIe总线的在线重构方法,其特征在于,所述步骤S4包括以下步骤:

所述FPGA扫描各个所述分析块的类型:

若所述分析块为所述输出分析块,则直接输出结果;

若所述分析块为所述普通分析块,则将各个所述分析块的处理结果代入所述分析块之间的总逻辑关系中执行:若所述分析块之间是串联关系,则执行逻辑与操作;若所述分析块之间是并联关系,则执行逻辑或操作。

4.根据权利要求3所述的基于PCIe总线的在线重构方法,其特征在于,所述重构文件的类型包括梯形图、功能块图、顺序功能图、结构化文本、指令表。

5.根据权利要求3所述的基于PCIe总线的在线重构方法,其特征在于,所述步骤S1之前还设有步骤B1,所述步骤B1包括以下步骤:

B11:所述FPGA进行初始化,并读取上一次保存的重构数据;

B12:所述FPGA经所述PCIe总线接收在线重构的控制指令。

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