[发明专利]多运算芯片的多链式通信系统在审

专利信息
申请号: 201910141294.2 申请日: 2019-02-26
公开(公告)号: CN109656734A 公开(公告)日: 2019-04-19
发明(设计)人: 秦思林 申请(专利权)人: 杭州德旺信息技术有限公司
主分类号: G06F9/54 分类号: G06F9/54
代理公司: 杭州裕阳联合专利代理有限公司 33289 代理人: 姚宇吉
地址: 310000 浙江省杭州市拱墅区莫干山路*** 国省代码: 浙江;33
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摘要:
搜索关键词: 通信链路 运算芯片 控制芯片 数据发送端 数据接收端 通信通道 通信系统 多链 预设 上行通信数据 下行通信数据 简单设计 上行通信 系统运算 下行通信 通信链 串联 分配
【权利要求书】:

1.一种多运算芯片的多链式通信系统,其特征在于,包括一个控制芯片和若干通信链路;

所述控制芯片包括与所述通信链路对应连接的通信通道,每个所述通信通道均包括数据发送端dntx和数据接收端dnrx;

每个所述通信链路包括若干相互串联的运算芯片;每个所述运算芯片包括上行数据发送端uptx,上行数据接收端uprx,下行数据发送端dntx,下行数据接收端dnrx;

在每个所述运算芯片中:

其上行数据发送端uptx连接于前一级运算芯片的下行数据接收端dnrx;

其上行数据接收端uprx连接于前一级运算芯片的下行数据发送端dntx;

其下行数据发送端dntx连接于后一级运算芯片的上行数据接收端uprx;

其下行数据接收端dnrx连接于后一级运算芯片的上行数据发送端uptx;

所述运算芯片为距离所述控制芯片最近的第一级运算芯片:

其上行数据发送端uptx连接于对应所述通信通道的数据接收端dnrx;

其上行数据接收端uprx连接于对应所述通信通道的数据发送端dntx;

其下行数据发送端dntx连接于后一级运算芯片的上行数据接收端uprx;

其下行数据接收端dnrx连接于后一级运算芯片的上行数据发送端uptx;

所述运算芯片为距离所述控制芯片最远的第M级运算芯片:

其上行数据发送端uptx连接于前一级运算芯片的下行数据接收端dnrx;

其上行数据接收端uprx连接于前一级运算芯片的下行数据发送端dntx;

其下行数据发送端dntx悬空;

其下行数据接收端dnrx为无效;

所述控制芯片通过数据发送端dntx基于预设下行通信协议发出下行通信数据,对每个通信链路的任务进行分配;

所述控制芯片通过数据接收端dnrx,接收对应通信链路上的每个运算芯片发出的基于预设上行通信协议的上行通信数据。

2.如权利要求1所述的多运算芯片的多链式通信系统,其特征在于,所述控制芯片发出的下行通信数据,通过通信链路中相互串联运算芯片的下行数据发送端dntx和上行数据接收端uprx发送至指定的运算芯片中。

3.如权利要求1所述的多运算芯片的多链式通信系统,其特征在于,所述控制芯片通过通信链路中相互串联运算芯片的上行数据发送端uptx和下行数据接收端dnrx,完成上行通信数据的接收。

4.如权利要求1所述的多运算芯片的多链式通信系统,其特征在于,所述下行通信协议格式包括通信命令类型command type、运算芯片地址destination chip ID、偏移地址offset address、命令长度command length、命令内容以及CRC校验值。

5.如权利要求4所述的多运算芯片的多链式通信系统,其特征在于,所述下行通信协议包括单播模式和广播模式;

所述单播模式为向指定运算芯片发出的下行通信;

所述广播模式为向所有运算芯片同时发出的下行通信。

6.如权利要求4所述的多运算芯片的多链式通信系统,其特征在于,当下行通信命令command type为CMD0时,表示为寄存器写命令;当下行通信命令command type为CMD1时,表示为寄存器读命令;

当下行通信命令为寄存器读命令时,下行通信协议格式包括下行通信命令commandtype、运算芯片地址destination chip ID、偏移地址offset address以及CRC校验值。

7.如权利要求1所述的多运算芯片的多链式通信系统,其特征在于,所述上行通信协议格式包括通信数据包类型return type、运算芯片地址source chip ID、偏移地址offsetaddress、返回数据包长度data length、返回数据包内容以及CRC校验值。

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