[发明专利]一种COMe板的内核启动时长优化方法在审
申请号: | 201910161674.2 | 申请日: | 2019-03-04 |
公开(公告)号: | CN110007970A | 公开(公告)日: | 2019-07-12 |
发明(设计)人: | 王敏敏;卢联杰;陈秀琼;张锐;梁美红;鲜于琳;陈辉 | 申请(专利权)人: | 湖北三江航天万峰科技发展有限公司 |
主分类号: | G06F9/4401 | 分类号: | G06F9/4401;G06F9/50 |
代理公司: | 武汉东喻专利代理事务所(普通合伙) 42224 | 代理人: | 赵伟 |
地址: | 432000 *** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 内核启动 内存 内核 内存控制器 再次启动 时长 耗时 优化 参数配置文件 配置文件 初始化 屏蔽 更新 | ||
本发明属于内核启动优化技术领域,公开了一种COMe板的内核启动时长优化方法,将内存训练后的参数导入到内存控制器参数配置文件,再次启动内核时利用更新过的内存控制器配置文件对内存进行初始化,屏蔽内存训练,通过改变现有内存启动的流程,在初次启动内核之后,再次启动内核则不需要再次进行内存训练,由此缩短了内核启动耗时,可很好的解决COMe板内核启动耗时长的问题。
技术领域
本发明属于内核启动优化技术领域,更具体地,涉及一种COMe板的内核启动时长优化方法。
背景技术
一些处理器内部集成的内存控制器的设计遵守DDR2/3SDRAM的行业标准(JESD79-2和JESD79-3)。在这类处理器中所实现的所有内存读/写操作都遵守JESD79-2B及JESD79-3的规定;支持最大4个由DDR2SDRAM片选信号实现的片选,一共含有19位的地址总线,包括16位的行列地址总线和3位的逻辑Bank总线。
这类处理器可通过调整DDR2/3控制器参数设置对所选用的内存芯片进行支持;处理器发送的内存请求物理地址可以根据控制器内部不同的配置进行多种不同的地址映射。处理器所集成的内存控制电路只接受来自处理器或者外部设备的内存读/写请求,在所有的内存读/写操作中,内存控制电路处于从设备状态。对于内存控制器参数的调试,即内存训练是在DDR3中,智能配置内存控制器读写操作中各种信号间相位关系的操作,通常包括写训练、读训练和窗口训练。内核启动流程参照图1,首先需要利用内存控制器配置文件对内存进行初始化,然后进行内存训练调整相关内存控制器参数,再利用新参数进行内存配置。写训练和窗口训练完成后重新配置内存参数、更新内存参数配置文件,进入正常工作模式,此时内存可以正常访问,内核正常启动。但这种方式下,但是内存训练耗时很长,影响内核启动时间。
发明内容
针对现有技术的以上缺陷或改进需求,本发明提供了COMe板的内核启动时长优化方法,其目的在于通过省去内存训练所需时间,以缩短内核启动耗时。
为实现上述目的,按照本发明的一个方面,提供了一种COMe板的内核启动时长优化方法,将内存训练后的参数导入到内存控制器参数配置文件,再次启动内核时利用更新过的内存控制器配置文件对内存进行初始化,屏蔽内存训练,由此省去内核再次启动时内存训练所需的时间,缩短了内核启动耗时。
作为一个优选方案,上述的内核启动时长优化方法,具体如下:
(a)初次启动内核时,利用内存控制器配置文件进行内存初始化;再进行内存训练,然后启动内核;
(b)非首次启动内核时,利用已经训练好的内存控制器参数更新内存控制器配置文件,再利用内存控制器配置文件进行内存初始化,同时缩短处理器启动的等待时间,然后进行内核启动。
作为一个优选方案,上述的内核启动时长优化方法,内存训练中,对写操作进行训练时采用经验值作为初值以缩短参数优化时间。
作为一个优选方案,上述的内核启动时长优化方法,其对写操作的训练具体包括如下步骤:
(1)对控制器进行初始化,在Init_start寄存器保持为0的状态下,向控制器除了Init_start寄存器之外的寄存器写入正确的配置值;然后将Init_start寄存器设置为1;
(2)将寄存器Dll_wrdqs_x(0x038,0x058,0x078,……,0x138)中的bit16~bit23设置为0;将Lvl_mode(0x180)寄存器设置为2’b01;
(3)采样Lvl_ready(0x180)寄存器,当该寄存器的值为1时,开始写训练;
(4)将Lvl_req(0x180)寄存器设置为1;
(5)采样Lvl_done(0x180)寄存器,当该寄存器的值为1时,表明一次写训练完成。
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