[发明专利]一种基于GPIO扩展总线通道数量的方法和系统在审
| 申请号： | 201910191457.8 | 申请日： | 2019-03-14 |
| 公开（公告）号： | CN109977051A | 公开（公告）日： | 2019-07-05 |
| 发明（设计）人： | 韩威 | 申请（专利权）人： | 苏州浪潮智能科技有限公司 |
| 主分类号： | G06F13/38 | 分类号： | G06F13/38;G06F13/42 |
| 代理公司： | 济南诚智商标专利事务所有限公司 37105 | 代理人： | 李修杰 |
| 地址： | 215100 江苏省苏州市吴*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 总线通道 主器件 上拉电阻 申请 数据传输效率 器件共用 数据操作 匹配 访问 | ||
1.一种基于GPIO扩展总线通道数量的方法，其特征在于，所述方法包括：
利用主器件的GPIO模拟出多个总线通道，任一所述总线通道中包括SCL信号和SDA信号，所述总线通道包括I2C通道或SMBus通道；
使所有与主器件连接的从器件共用一个SCL信号，且每个从器件采用独立的SDA信号。
2.根据权利要求1所述的一种基于GPIO扩展总线通道数量的方法，其特征在于，当所述主器件有N个GPIO时，利用所述主器件的GPIO模拟出的总线通道数量为N-1个。
3.根据权利要求1所述的一种基于GPIO扩展总线通道数量的方法，其特征在于，所述使所有与主器件连接的从器件共用一个SCL信号，且每个从器件采用独立的SDA信号的方法，具体为：
将所述主器件的任一GPIO模拟为SCL信号，将所述任一GPIO以外的其他GPIO均模拟为SDA信号。
4.根据权利要求3所述的一种基于GPIO扩展总线通道数量的方法，其特征在于，所述任一GPIO所模拟的SCL信号频率与所述任一GPIO所使用的总线工作模式相匹配。
5.根据权利要求1-4中任一所述的一种基于GPIO扩展总线通道数量的方法，其特征在于，所述主器件包括CPU、CPLD或FPGA。
6.一种基于GPIO扩展总线通道数量的系统，其特征在于，所述系统包括：一个主器件、多个从器件、多个总线通道以及多个上拉电阻，所述主器件中设置有多个GPIO，所述主器件通过任一所述总线通道连接一个或多个从器件，任一所述总线通道中包括SCL信号和SDA信号，且多个所述总线通道中的SCL信号相同，每个所述上拉电阻与一个SCL信号或一个SDA信号相匹配。
7.根据权利要求6所述的一种基于GPIO扩展总线通道数量的系统，其特征在于，所述总线通道包括I2C通道或SMBus通道。
8.根据权利要求6或7所述的一种基于GPIO扩展总线通道数量的系统，其特征在于，所述主器件包括CPU、CPLD或FPGA。
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